1
2 43
GIGABYTE GA-M55SLI-S4 Schematics
SHEET TITLE
A
B
01
02
03
04
05
06
07
08
09
10
11
12
13
14
15
COVER SHEET
BOM & PCB MODIFY HISTORY
BLOCK DIAGRAM
M2 CPU Hyper Transport
M2 CPU DDR II
M2 CPU Control
M2 CPU POWER & GND
DDRII A0,B0 MARVELL 88E1116 GbE Phy
DDRII A1,B1
DDRII TERMINATION
CK804 HT
CK804 PCI-EXPRESS
CK804 PCI, LPC, CLOCK
CK804 IDE,SATA
CK804 AC97,USB,MII,GPIO
SHEET TITLE
26
27
28
29
30
31
32
IDE, FDD
ATX POWER CONNCTOR
VCORE POWER
Discrete Power
DDRII Power & Standby Power
BIOS (LPC ROM & SPI Flash)
FRONT PANEL
33
34
35
36
TI 1394A
NV-SLI Swirch Board
COMA , LPT
37
38
39
40
Revision:1.0
16
17
18
19
C
20
21
22
23
24
25
CK804 POWER,GND
PCI EXPRESS X16 SLOT
41
42
PCI EXPRESS X8 SLOT 43
PCI EXPRESS X1 SLOT1,2
PCI 1,2 SLOT
CODEC 850/655/658
AUDIO JACK, F_AUDIO
IT8712KX
FAN, H/W Monitor
KB_MS/FUSEVCC/PS2
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
Cover Sheet
GA-M55SLI-S4
1 36Wednesday, May 24, 2006
1.0
5
4
3
2
1
Model Name:GA-M55SLI-S4 1.0
Component value change history
Date Change Item Reason
D D
95.03.27_0.1
C C
Rev 0.1 pilot-run BOM
M55SLI-S3-00-02
Change RN29 to 220/8P4R For signals level
Add R536 to 8.2K ohm
M55SLI-S3-00-10A95/05/22
Location: COAXITL change 11NR6-501004-81 to 11NR6-501004-81R
Change COMA to COM/GE/SC-6mm/RA/1/D
Remove R255, change C222 to 2.2n/4
Del socket_M2 10SC1-A01940-21
Change F1_1394,F2_1394 to PH/2*5K9/GY/2.54/VA/D
Change PCB to rev:1.0
替料
Circuit or PCB layout change for next version
Date Change Item Reason
95.03.27_0.1
95/04/26
1'st version pilot-run
REV:0.2
For LPC enableNB_HS改Footprint:BGAHSINK45X45-5
Del LPC flash rom
Add DDR protect
Change R0603 to R0402-2
REV:1.095/05/22
Modify COAXIAL pin 1
Del VCC15_OV2
B B
A A
GIGABYTE Technology
Title
Size Document Number Rev
Custom
5
4
3
2
Date: Sheet of
BOM & PCB MODIFY HISTORY
GA-M55SLI-S4
2 36Wednesday, May 24, 2006
1
1.0
1
2 3 4
BLOCK DIAGRAM
A
POWER
SUPPLY
CONNECTOR
VREG
SOCKET 940
K8
200/266/333/400MHZ
DDRII SDRAM CONN 0
DDRII SDRAM CONN 1
DDRII SDRAM CONN 2
PEX X16
PEX X1
PEX X1
B
FLOPPY CONN
PS2/KBRD CONN
PARALLEL CONN
SERIAL CONN
SERIAL HDR
SIO
ITE8712
PRIMARY IDE
SECONDARY IDE
X4 - SATA CONN
C
PCI EXPRESS X16 GRAPHICS
PCI EXPRESS
PCI EXPRESS
ATA 133
INTEGRATED SATA
LPC BUS 33MHZ
LPC HDR
4MB FLASH
HT 16X16 1GHZ
NFORCE
CRUSH K804
740BGA
RGMII
PCI 33MHZ
AC97
X10 USB2
MII/RGMII
AC97
BACK PANEL CONN
USB2 PORTS 5-4
DOUBLE STACK
USB2 PORTS 3-2
X2/GBIT LAN
FRONT PANEL HDR
USB2 PORTS 1-0
USB2 PORTS 7-6
USB2 PORTS 9-8
DDRII SDRAM CONN 3
PCI SLOT 1
PCI SLOT 2
PCI SLOT 3
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
BLOCK DIAGRAM
GA-M55SLI-S4
3 36Wednesday, May 24, 2006
1.0
1
2 43
L0_CADIN_L[0..15]
L0_CADIN_H[0..15]
L0_CLKIN_L[0..1]
L0_CLKIN_H[0..1]
L0_CADOUT_L[0..15]
A
L0_CADOUT_H[0..15]
L0_CLKOUT_L[0..1]
L0_CLKOUT_H[0..1]
L0_CADIN_L[0..15] 11
L0_CADIN_H[0..15] 11
L0_CLKIN_L[0..1] 11
L0_CLKIN_H[0..1] 11
L0_CADOUT_L[0..15] 11
L0_CADOUT_H[0..15] 11
L0_CLKOUT_L[0..1] 11
L0_CLKOUT_H[0..1] 11
CPU_VDD_RUN = VCORE
CPU_VDDA_RUN = VDDA25
VLDT_RUN = VCC12_HT
CPU_VDDIO_SUS = DDR18V
CPU_VTT_SUS = DDRVTT
VLDT_A = VCC12_HT
VLDT_B = HT12B
SOCKET_M2A
L0_CLKIN_H1
L0_CLKIN_L1
L0_CLKIN_H0
L0_CLKIN_L0
VCC12_HT
L0_CTLIN_H011
L0_CTLIN_L011
VCORE
B
SC1
0.01U/4/Y5V/50V/Z
CLOSE CHIPSET &
CROSSING BOUNDARY
SC2
0.01U/4/Y5V/50V/Z
SC3
0.01U/4/Y5V/50V/Z
L0_CTLIN_H0
L0_CTLIN_L0
L0_CADIN_H15
L0_CADIN_L15
L0_CADIN_H14
L0_CADIN_L14
L0_CADIN_H13
L0_CADIN_L13
L0_CADIN_H12
L0_CADIN_L12
L0_CADIN_H11
L0_CADIN_L11
L0_CADIN_H10
L0_CADIN_L10
L0_CADIN_H9
L0_CADIN_L9
L0_CADIN_H8
L0_CADIN_L8
L0_CADIN_H7
L0_CADIN_L7
L0_CADIN_H6
L0_CADIN_L6
L0_CADIN_H5
L0_CADIN_L5
L0_CADIN_H4
L0_CADIN_L4
L0_CADIN_H3
L0_CADIN_L3
L0_CADIN_H2
L0_CADIN_L2
L0_CADIN_H1
L0_CADIN_L1
L0_CADIN_H0
L0_CADIN_L0
N6
P6
N3
N2
49.9/4/1R1
V4
49.9/4/1R2
V5
U1
V1
U6
V6
T4
T5
R6
T6
P4
P5
M4
M5
L6
M6
K4
K5
J6
K6
U3
U2
R1
T1
R3
R2
N1
P1
L1
M1
L3
L2
J1
K1
J3
J2
HYPERTRANSPORT
L0_CLKIN_H(1)
L0_CLKIN_L(1)
L0_CLKIN_H(0)
L0_CLKIN_L(0)
L0_CTLIN_H(1)
L0_CTLIN_L(1)
L0_CTLIN_H(0)
L0_CTLIN_L(0)
L0_CADIN_H(15)
L0_CADIN_L(15)
L0_CADIN_H(14)
L0_CADIN_L(14)
L0_CADIN_H(13)
L0_CADIN_L(13)
L0_CADIN_H(12)
L0_CADIN_L(12)
L0_CADIN_H(11)
L0_CADIN_L(11)
L0_CADIN_H(10)
L0_CADIN_L(10)
L0_CADIN_H(9)
L0_CADIN_L(9)
L0_CADIN_H(8)
L0_CADIN_L(8)
L0_CADIN_H(7)
L0_CADIN_L(7)
L0_CADIN_H(6)
L0_CADIN_L(6)
L0_CADIN_H(5)
L0_CADIN_L(5)
L0_CADIN_H(4)
L0_CADIN_L(4)
L0_CADIN_H(3)
L0_CADIN_L(3)
L0_CADIN_H(2)
L0_CADIN_L(2)
L0_CADIN_H(1)
L0_CADIN_L(1)
L0_CADIN_H(0)
L0_CADIN_L(0)
CPU-SK/940AM2/S/15u
L0_CLKOUT_H(1)
L0_CLKOUT_L(1)
L0_CLKOUT_H(0)
L0_CLKOUT_L(0)
L0_CTLOUT_H(1)
L0_CTLOUT_L(1)
L0_CTLOUT_H(0)
L0_CTLOUT_L(0)
L0_CADOUT_H(15)
L0_CADOUT_L(15)
L0_CADOUT_H(14)
L0_CADOUT_L(14)
L0_CADOUT_H(13)
L0_CADOUT_L(13)
L0_CADOUT_H(12)
L0_CADOUT_L(12)
L0_CADOUT_H(11)
L0_CADOUT_L(11)
L0_CADOUT_H(10)
L0_CADOUT_L(10)
L0_CADOUT_H(9)
L0_CADOUT_L(9)
L0_CADOUT_H(8)
L0_CADOUT_L(8)
L0_CADOUT_H(7)
L0_CADOUT_L(7)
L0_CADOUT_H(6)
L0_CADOUT_L(6)
L0_CADOUT_H(5)
L0_CADOUT_L(5)
L0_CADOUT_H(4)
L0_CADOUT_L(4)
L0_CADOUT_H(3)
L0_CADOUT_L(3)
L0_CADOUT_H(2)
L0_CADOUT_L(2)
L0_CADOUT_H(1)
L0_CADOUT_L(1)
L0_CADOUT_H(0)
L0_CADOUT_L(0)
AD5
AD4
AD1
AC1
Y6
W6
W2
W3
Y5
Y4
AB6
AA6
AB5
AB4
AD6
AC6
AF6
AE6
AF5
AF4
AH6
AG6
AH5
AH4
Y1
W1
AA2
AA3
AB1
AA1
AC2
AC3
AE2
AE3
AF1
AE1
AG2
AG3
AH1
AG1
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CTLOUT_H1
L0_CTLOUT_L1
L0_CTLOUT_H0
L0_CTLOUT_L0
L0_CADOUT_H15
L0_CADOUT_L15
L0_CADOUT_H14
L0_CADOUT_L14
L0_CADOUT_H13
L0_CADOUT_L13
L0_CADOUT_H12
L0_CADOUT_L12
L0_CADOUT_H11
L0_CADOUT_L11
L0_CADOUT_H10
L0_CADOUT_L10
L0_CADOUT_H9
L0_CADOUT_L9
L0_CADOUT_H8
L0_CADOUT_L8
L0_CADOUT_H7
L0_CADOUT_L7
L0_CADOUT_H6
L0_CADOUT_L6
L0_CADOUT_H5
L0_CADOUT_L5
L0_CADOUT_H4
L0_CADOUT_L4
L0_CADOUT_H3
L0_CADOUT_L3
L0_CADOUT_H2
L0_CADOUT_L2
L0_CADOUT_H1
L0_CADOUT_L1
L0_CADOUT_H0
L0_CADOUT_L0
1
TP1
1
TP2
L0_CTLOUT_H0 11
L0_CTLOUT_L0 11
SOCKET_M2
C
K8-940AM2/RM/BP-M/SC/BK/3M/[12KRC-04K807-41R]
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU HYPER TRANSPORT
GA-M55SLI-S4
4 36Wednesday, May 24, 2006
1.0
1
2 43
SOCKET_M2B
DCLKA2
-DCLKA2
DCLKA1
-DCLKA1
DCLKA0
-DCLKA0
MODT_A0
DCLKA5
-DCLKA5
DCLKA4
-DCLKA4
DCLKA3
-DCLKA3
MODT_A1
-SCASA
-SWEA
-SRASA
SBAA2
SBAA1
SBAA0
CKEA1
CKEA0
DQSA7
-DQSA7
DQSA6
-DQSA6
DQSA5
-DQSA5
DQSA4
-DQSA4
DQSA3
-DQSA3
DQSA2
-DQSA2
DQSA1
-DQSA1
DQSA0
-DQSA0
DMA7
DMA6
DMA5
DMA4
DMA3
DMA2
DMA1
DMA0
AG21
AG20
AC25
AA24
AC28
AE20
AE19
AD27
AA25
AC27
AB25
AB27
AA26
AA27
AC26
AD15
AE15
AG18
AG19
AG24
AG25
AG27
AG28
AF15
AF19
AJ25
AH29
G19
H19
U27
U26
G20
G21
V27
W27
N25
Y27
L27
M25
M27
N24
N26
P25
Y25
N27
R24
P27
R25
R26
R27
T25
U25
T27
W24
D29
C29
C25
D25
E19
F19
F15
G15
B29
E24
E18
H15
A
B
MAAA[0..15]8,9,10 MAAB[0..15]8,9,10
-DQSA[0..7] -DQSB[0..7]
DQSA[0..7]
-DQSA[0..7] 8,9
DQSA[0..7] 8,9
DCLKA28,10
-DCLKA28,10
DCLKA18,10
-DCLKA18,10
DCLKA08,10
-DCLKA08,10
-CSA18,10
-CSA08,10
MODT_A08,10
DCLKA59,10
-DCLKA59,10
DCLKA49,10
-DCLKA49,10
DCLKA39,10 DCLKB39,10
-DCLKA39,10
-CSA39,10
-CSA29,10
MODT_A19,10
-SCASA8,9,10
-SWEA8,9,10
-SRASA8,9,10
SBAA28,9,10
SBAA18,9,10
SBAA08,9,10
CKEA19,10
CKEA08,10
MAAA15
MAAA14
MAAA13
MAAA12
MAAA11
MAAA10
MAAA9
MAAA8
MAAA7
MAAA6
MAAA5
MAAA4
MAAA3
MAAA2
MAAA1
MAAA0
C
MEMORY INTERFACE A
MA0_CLK_H(2)
MA0_CLK_L(2)
MA0_CLK_H(1)
MA0_CLK_L(1)
MA0_CLK_H(0)
MA0_CLK_L(0)
MA0_CS_L(1)
MA0_CS_L(0)
MA0_ODT(0)
MA1_CLK_H(2)
MA1_CLK_L(2)
MA1_CLK_H(1)
MA1_CLK_L(1)
MA1_CLK_H(0)
MA1_CLK_L(0)
MA1_CS_L(1)
MA1_CS_L(0)
MA1_ODT(0)
MA_CAS_L
MA_WE_L
MA_RAS_L
MA_BANK(2)
MA_BANK(1)
MA_BANK(0)
MA_CKE(1)
MA_CKE(0)
MA_ADD(15)
MA_ADD(14)
MA_ADD(13)
MA_ADD(12)
MA_ADD(11)
MA_ADD(10)
MA_ADD(9)
MA_ADD(8)
MA_ADD(7)
MA_ADD(6)
MA_ADD(5)
MA_ADD(4)
MA_ADD(3)
MA_ADD(2)
MA_ADD(1)
MA_ADD(0)
MA_DQS_H(7)
MA_DQS_L(7)
MA_DQS_H(6)
MA_DQS_L(6)
MA_DQS_H(5)
MA_DQS_L(5)
MA_DQS_H(4)
MA_DQS_L(4)
MA_DQS_H(3)
MA_DQS_L(3)
MA_DQS_H(2)
MA_DQS_L(2)
MA_DQS_H(1)
MA_DQS_L(1)
MA_DQS_H(0)
MA_DQS_L(0)
MA_DM(7)
MA_DM(6)
MA_DM(5)
MA_DM(4)
MA_DM(3)
MA_DM(2)
MA_DM(1)
MA_DM(0)
CPU-SK/940AM2/S/15u
MA_DATA(63)
MA_DATA(62)
MA_DATA(61)
MA_DATA(60)
MA_DATA(59)
MA_DATA(58)
MA_DATA(57)
MA_DATA(56)
MA_DATA(55)
MA_DATA(54)
MA_DATA(53)
MA_DATA(52)
MA_DATA(51)
MA_DATA(50)
MA_DATA(49)
MA_DATA(48)
MA_DATA(47)
MA_DATA(46)
MA_DATA(45)
MA_DATA(44)
MA_DATA(43)
MA_DATA(42)
MA_DATA(41)
MA_DATA(40)
MA_DATA(39)
MA_DATA(38)
MA_DATA(37)
MA_DATA(36)
MA_DATA(35)
MA_DATA(34)
MA_DATA(33)
MA_DATA(32)
MA_DATA(31)
MA_DATA(30)
MA_DATA(29)
MA_DATA(28)
MA_DATA(27)
MA_DATA(26)
MA_DATA(25)
MA_DATA(24)
MA_DATA(23)
MA_DATA(22)
MA_DATA(21)
MA_DATA(20)
MA_DATA(19)
MA_DATA(18)
MA_DATA(17)
MA_DATA(16)
MA_DATA(15)
MA_DATA(14)
MA_DATA(13)
MA_DATA(12)
MA_DATA(11)
MA_DATA(10)
MA_DATA(9)
MA_DATA(8)
MA_DATA(7)
MA_DATA(6)
MA_DATA(5)
MA_DATA(4)
MA_DATA(3)
MA_DATA(2)
MA_DATA(1)
MA_DATA(0)
MA_DQS_H(8)
MA_DQS_L(8)
MA_DM(8)
MA_CHECK(7)
MA_CHECK(6)
MA_CHECK(5)
MA_CHECK(4)
MA_CHECK(3)
MA_CHECK(2)
MA_CHECK(1)
MA_CHECK(0)
AE14
AG14
AG16
AD17
AD13
AE13
AG15
AE16
AG17
AE18
AD21
AG22
AE17
AF17
AF21
AE21
AF23
AE23
AJ26
AG26
AE22
AG23
AH25
AF25
AJ28
AJ29
AF29
AE26
AJ27
AH27
AG29
AF27
E29
E28
D27
C27
G26
F27
C28
E27
F25
E25
E23
D23
E26
C26
G23
F23
E22
E21
F17
G17
G22
F21
G18
E17
G16
E15
G13
H13
H17
E16
E14
G14
J28
J27
J25
K25
J26
G28
G27
L24
K27
H29
H27
MDA63
MDA62
MDA61
MDA60
MDA59
MDA58
MDA57
MDA56
MDA55
MDA54
MDA53
MDA52
MDA51
MDA50
MDA49
MDA48
MDA47
MDA46
MDA45
MDA44
MDA43
MDA42
MDA41
MDA40
MDA39
MDA38
MDA37
MDA36
MDA35
MDA34
MDA33
MDA32
MDA31
MDA30
MDA29
MDA28
MDA27
MDA26
MDA25
MDA24
MDA23
MDA22
MDA21
MDA20
MDA19
MDA18
MDA17
MDA16
MDA15
MDA14
MDA13
MDA12
MDA11
MDA10
MDA9
MDA8
MDA7
MDA6
MDA5
MDA4
MDA3
MDA2
MDA1
MDA0
MDA[0..63] 8,9 MDB[0..63] 8,9
DQSB[0..7]
DMB[0..7]DMA[0:7]
-DQSB[0..7] 8,9
DQSB[0..7] 8,9
DMB[0..7] 8,9DMA[0..7] 8,9
DCLKB2
DCLKB28,10
-DCLKB2
-DCLKB28,10
DCLKB1
DCLKB18,10
-DCLKB1
-DCLKB18,10
DCLKB0
DCLKB08,10
-DCLKB0
-DCLKB08,10
-CSB18,10
-CSB08,10
MODT_B0
MODT_B08,10
DCLKB5
DCLKB59,10
-DCLKB5
-DCLKB59,10
DCLKB4
DCLKB49,10
-DCLKB4
-DCLKB49,10
DCLKB3
-DCLKB3
-DCLKB39,10
-CSB39,10
-CSB29,10
MODT_B1
MODT_B19,10
-SCASB
-SCASB8,9,10
-SWEB
-SWEB8,9,10
-SRASB
-SRASB8,9,10
SBAB2
SBAB28,9,10
SBAB1
SBAB18,9,10
SBAB0
SBAB08,9,10
CKEB1
CKEB19,10
CKEB0
CKEB08,10
MAAB15
MAAB14
MAAB13
MAAB12
MAAB11
MAAB10
MAAB9
MAAB8
MAAB7
MAAB6
MAAB5
MAAB4
MAAB3
MAAB2
MAAB1
MAAB0
DQSB7
-DQSB7
DQSB6
-DQSB6
DQSB5
-DQSB5
DQSB4
-DQSB4
DQSB3
-DQSB3
DQSB2
-DQSB2
DQSB1
-DQSB1
DQSB0
-DQSB0
DMB7
DMB6
DMB5
DMB4
DMB3
DMB2
DMB1
DMB0
SOCKET_M2C
AJ19
MB0_CLK_H(2)
AK19
MB0_CLK_L(2)
A18
MB0_CLK_H(1)
A19
MB0_CLK_L(1)
U31
MB0_CLK_H(0)
U30
MB0_CLK_L(0)
AE30
MB0_CS_L(1)
AC31
MB0_CS_L(0)
AD29
MB0_ODT(0)
AL19
MB1_CLK_H(2)
AL18
MB1_CLK_L(2)
C19
MB1_CLK_H(1)
D19
MB1_CLK_L(1)
W29
MB1_CLK_H(0)
W28
MB1_CLK_L(0)
AE29
MB1_CS_L(1)
AB31
MB1_CS_L(0)
AD31
MB1_ODT(0)
AC29
MB_CAS_L
AC30
MB_WE_L
AB29
MB_RAS_L
N31
MB_BANK(2)
AA31
MB_BANK(1)
AA28
MB_BANK(0)
M31
MB_CKE(1)
M29
MB_CKE(0)
N28
MB_ADD(15)
N29
MB_ADD(14)
AE31
MB_ADD(13)
N30
MB_ADD(12)
P29
MB_ADD(11)
AA29
MB_ADD(10)
P31
MB_ADD(9)
R29
MB_ADD(8)
R28
MB_ADD(7)
R31
MB_ADD(6)
R30
MB_ADD(5)
T31
MB_ADD(4)
T29
MB_ADD(3)
U29
MB_ADD(2)
U28
MB_ADD(1)
AA30
MB_ADD(0)
AK13
MB_DQS_H(7)
AJ13
MB_DQS_L(7)
AK17
MB_DQS_H(6)
AJ17
MB_DQS_L(6)
AK23
MB_DQS_H(5)
AL23
MB_DQS_L(5)
AL28
MB_DQS_H(4)
AL29
MB_DQS_L(4)
D31
MB_DQS_H(3)
C31
MB_DQS_L(3)
C24
MB_DQS_H(2)
C23
MB_DQS_L(2)
D17
MB_DQS_H(1)
C17
MB_DQS_L(1)
C14
MB_DQS_H(0)
C13
MB_DQS_L(0)
AJ14
MB_DM(7)
AH17
MB_DM(6)
AJ23
MB_DM(5)
AK29
MB_DM(4)
C30
MB_DM(3)
A23
MB_DM(2)
B17
MB_DM(1)
B13
MB_DM(0)
CPU-SK/940AM2/S/15u
MEMORY INTERFACE B
MB_DATA(63)
MB_DATA(62)
MB_DATA(61)
MB_DATA(60)
MB_DATA(59)
MB_DATA(58)
MB_DATA(57)
MB_DATA(56)
MB_DATA(55)
MB_DATA(54)
MB_DATA(53)
MB_DATA(52)
MB_DATA(51)
MB_DATA(50)
MB_DATA(49)
MB_DATA(48)
MB_DATA(47)
MB_DATA(46)
MB_DATA(45)
MB_DATA(44)
MB_DATA(43)
MB_DATA(42)
MB_DATA(41)
MB_DATA(40)
MB_DATA(39)
MB_DATA(38)
MB_DATA(37)
MB_DATA(36)
MB_DATA(35)
MB_DATA(34)
MB_DATA(33)
MB_DATA(32)
MB_DATA(31)
MB_DATA(30)
MB_DATA(29)
MB_DATA(28)
MB_DATA(27)
MB_DATA(26)
MB_DATA(25)
MB_DATA(24)
MB_DATA(23)
MB_DATA(22)
MB_DATA(21)
MB_DATA(20)
MB_DATA(19)
MB_DATA(18)
MB_DATA(17)
MB_DATA(16)
MB_DATA(15)
MB_DATA(14)
MB_DATA(13)
MB_DATA(12)
MB_DATA(11)
MB_DATA(10)
MB_DATA(9)
MB_DATA(8)
MB_DATA(7)
MB_DATA(6)
MB_DATA(5)
MB_DATA(4)
MB_DATA(3)
MB_DATA(2)
MB_DATA(1)
MB_DATA(0)
MB_DQS_H(8)
MB_DQS_L(8)
MB_DM(8)
MB_CHECK(7)
MB_CHECK(6)
MB_CHECK(5)
MB_CHECK(4)
MB_CHECK(3)
MB_CHECK(2)
MB_CHECK(1)
MB_CHECK(0)
AH13
AL13
AL15
AJ15
AF13
AG13
AL14
AK15
AL16
AL17
AK21
AL21
AH15
AJ16
AH19
AL20
AJ22
AL22
AL24
AK25
AJ21
AH21
AH23
AJ24
AL27
AK27
AH31
AG30
AL25
AL26
AJ30
AJ31
E31
E30
B27
A27
F29
F31
A29
A28
A25
A24
C22
D21
A26
B25
B23
A22
B21
A20
C16
D15
C21
A21
A17
A16
B15
A14
E13
F13
C15
A15
A13
D13
J31
J30
J29
K29
K31
G30
G29
L29
L28
H31
G31
MDB63
MDB62
MDB61
MDB60
MDB59
MDB58
MDB57
MDB56
MDB55
MDB54
MDB53
MDB52
MDB51
MDB50
MDB49
MDB48
MDB47
MDB46
MDB45
MDB44
MDB43
MDB42
MDB41
MDB40
MDB39
MDB38
MDB37
MDB36
MDB35
MDB34
MDB33
MDB32
MDB31
MDB30
MDB29
MDB28
MDB27
MDB26
MDB25
MDB24
MDB23
MDB22
MDB21
MDB20
MDB19
MDB18
MDB17
MDB16
MDB15
MDB14
MDB13
MDB12
MDB11
MDB10
MDB9
MDB8
MDB7
MDB6
MDB5
MDB4
MDB3
MDB2
MDB1
MDB0
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU DDRII MEMORY
GA-M55SLI-S4
5 36Wednesday, May 24, 2006
1.0
-CPURST_C
CPU_PWRGD_C
HTSTOP_L_C
A
-CPURST
CPU_PWRGD
HTSTOP_L
BC1
0.01U/4/Y5V/50V/ZC60.1U/6/Y5V/25V/Z
COREFB+28
B
COREFB+28
C
1
DDR18V
R3 300/4/X
R4 300/4/X
R5 300/4/X
VDDA25
R8 1K/4
R9 1K/4
R11 1K/4
CPUVREF
20/15/20 ( < 6" )
CPU_M_VREF
COREFB-28
COREFB-28
VCORE_PWOK28,29
PWOK23,27,29,30
R36
100K/4
CPU_PWRGD11
-CPURST11
-CPURST_1
HTSTOP_L_1
CPU_PWRGD_1 CPU_PWRGD_C
DDR18V
BC2
0.1U/4/Y5V/16V/Z
SC4
0.1U/4/Y5V/16V/Z/X
R34 0/4/SHT/X
R35
0/4/X
PWOK_TTL
CPU_PWRGD_1
PWOK_TTL
-CPURST_1
RN29 220/8P4R/6
VDDA25
FB1 0/6/SHT/X
CPUCLK0_H11
CPUCLK0_L11
R12
150/4/1
R17
150/4/1
10mil
10mil
U5
1
1A
2
1B
3
1Y
4
2A
5
2B
6
2Y
7 8
GND 3Y
74LVC08A/SO14
-CPURST_C
78
HTSTOP_L_C
56
34
12
2.5V/0.11A
CPUCLK0_H
CPUCLK0_L
Other Signal
TMPIN3+
TMPIN3-
Other Signal
14
VCC
13
4B
12
4A
11
4Y
10
3B
9
3A
C1
C2
3.3N/4/X7R/50V/K
4.7U/8/Y5V/10V/Z
3.9N/4/X7R/50V/KC4
3.9N/4/X7R/50V/KC5 169/4/1
R15 300/4
DDR18V
R16 300/4
DDR18V
15mil
12mil
15mil
3VDUAL
BC3
0.1U/6/Y5V/25V/Z
HTSTOP_L 11
PWOK_TTL
HTSTOP_L_1
R38 0/4/SHT/X
THERMTRIP_CPU_L
-CPURST_C
HTSTOP_L_C
CPU_PWRGD_C
RN30 270/8P4R/6
SI_CLK23
SI_DAT23
COREFB+28
COREFB-28
DDRVTT
CPU_M_VREF
DDR18V
TMPIN3-23
TMPIN3+23,24
THERMTRIP_L
R39
0/4/X
78
56
34
12
C3
0.1U/6/Y5V/25V/Z
CLKIN_H
R10
CLKIN_L
CPU_PWRGD_C
HTSTOP_L_C
-CPURST_C
CPU_PRESENT_L
R13 300/4/X
SI_CLK
SI_DAT
SI_CLK
TP4
SI_DAT
TP6
TP7
TP8
TP9
R19 0/6/SHT/X
300/4R25
300/4R26
CPU_TEST17
TP12
CPU_TEST16
TP14
CPU_TEST15
TP16
CPU_TEST14
TP18
CPU_TEST12
TP19
R441 0/4/X
VCC3
R37
1K/4/X
THERMTRIP_CPU_L 11
2 43
DDR18V
RESERVE
SOCKET_M2D
39.2/4/1R21
39.2/4/1R23
CPU_TEST25_H
CPU_TEST25_L
CPU_TEST19
CPU_TEST18
0/4R28
0/4R29
THERMDTHERMD+
C10
VDDA1
D10
VDDA2
A8
CLKIN_H
B8
CLKIN_L
C9
PWROK
D8
LDTSTOP_L
C7
RESET_L
AL3
CPU_PRESENT_L
AL6
SIC
AK6
SID
AL10
TDI
AJ10
TRST_L
AH10
TCK
AL9
TMS
A5
DBREQ_L
G2
VDD_FB_H
G1
VDD_FB_L
E12
VTT_SENSE
F12
M_VREF
AH11
M_ZN
AJ11
M_ZP
A10
TEST25_H
B10
TEST25_L
F10
TEST19
E9
TEST18
AJ7
TEST13
F6
TEST9
D6
TEST17
E7
TEST16
F8
TEST15
C5
TEST14
AH9
TEST12
E5
TEST7
AJ5
TEST6
AG9
THERMDC
AG8
THERMDA
AH7
TEST3
AJ6
TEST2
CPU-SK/940AM2/S/15u
MISC
THERMTRIP_L
PROCHOT_L
VDDIO_FB_H
VDDIO_FB_L
TEST29_H
TEST29_L
TEST28_H
TEST28_L
VID(5)
VID(4)
VID(3)
VID(2)
VID(1)
VID(0)
DBRDY
PSI_L
HTREF1
HTREF0
TEST24
TEST23
TEST22
TEST21
TEST20
TEST27
TEST26
TEST10
TEST8
TDO
RN1
300/8P4R/6/X
1 2
3 4
5 6
7 8
D2
VID5
D1
VID4
C1
VID3
E3
VID2
E2
VID1
E1
VID0
AK7
AL7
AK10
B6
AK11
R18 0/6/SHT/X
AL11
F1
V8
V7
C11
D11
CPU_TEST24
AK8
CPU_TEST23
AH8
CPU_TEST22
AJ9
CPU_TEST21
AL8
CPU_TEST20
AJ8
J10
H9
AK9
CPU_TEST26
AK5
G7
D4
LAYOUT: Route trace 50 mils wide and
THERMTRIP_L
-PROCHOT
TP5
TP10
TP11
44.2/4/1R20
44.2/4/1R22
R24 80.6/6/1
TP13
TP15
TP17
TP20
VDDIO_FB_H 30
VCC12_HT
500 to 750 mils long between these caps.
R6
R7
300/4/X
300/4
TP3
VID5 28
VID4 28
VID3 28
VID2 28
VID1 28
VID0 28
R14 300/4
DDR18V
Route as 80-Ohm differential impedance
Keep trace to resistor less than 1" from CPU pin
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
CPU_TEST26
CPU_PRESENT_L
CPU_TEST25_H
CPU_TEST25_L
CPU_TEST21
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
L25
L26
L31
L30
W26
W25
AE27
U24
V24
AE28
Y31
Y30
AG31
V31
W31
AF31
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU CONTROL
R27 300/4
R30 1K/4
R31 510/4
R32 510/4
R33 300/4
SOCKET_M2E
INTERNAL MISC
RSVD1
RSVD2
RSVD3
RSVD4
RSVD5
RSVD6
RSVD7
RSVD8
RSVD9
RSVD10
RSVD11
RSVD12
RSVD13
RSVD14
RSVD15
RSVD16
CPU-SK/940AM2/S/15u
GA-M55SLI-S4
RSVD17
RSVD18
RSVD19
RSVD20
RSVD21
RSVD22
RSVD23
RSVD24
RSVD25
RSVD26
RSVD27
RSVD28
RSVD29
RSVD30
RSVD31
RSVD32
RSVD33
RSVD34
RSVD35
RSVD36
RSVD37
RSVD38
DDR18V
E20
B19
AL4
AK4
AK3
F2
F3
G4
G3
G5
AD25
AE24
AE25
AJ18
AJ20
C18
C20
G24
G25
H25
V29
W30
6 36Wednesday, May 24, 2006
1.0
1
2 43
VLDT_RUN_B is connected to the VLDT_RUN power
supply through the package or on the die. It is only connected
VCORE
SOCKET_M2F
VDD1
A4
VDD1
A6
VDD2
AA8
VDD3
A
B
C
AA10
VDD4
AA12
VDD5
AA14
VDD6
AA16
VDD7
AA18
VDD8
AB7
VDD9
AB9
VDD10
AB11
VDD11
AC4
VDD12
AC5
VDD13
AC8
VDD14
AC10
VDD15
AD2
VDD16
AD3
VDD17
AD7
VDD18
AD9
VDD19
AE10
VDD20
AF7
VDD21
AF9
VDD22
AG4
VDD23
AG5
VDD24
AG7
VDD25
AH2
VDD26
AH3
VDD27
B3
VDD28
B5
VDD29
B7
VDD30
C2
VDD31
C4
VDD32
C6
VDD33
C8
VDD34
D3
VDD35
D5
VDD36
D7
VDD37
D9
VDD38
E4
VDD39
E6
VDD40
E8
VDD41
E10
VDD42
F5
VDD43
F7
VDD44
F9
VDD45
F11
VDD46
G6
VDD47
G8
VDD48
G10
VDD49
G12
VDD50
H7
VDD51
H11
VDD52
H23
VDD53
J8
VDD54
J12
VDD55
J14
VDD56
J16
VDD57
J18
VDD58
J20
VDD59
J22
VDD60
J24
VDD61
K7
VDD62
K9
VDD63
K11
VDD64
K13
VDD65
K15
VDD66
K17
VDD67
K19
VDD68
K21
VDD69
K23
VDD70
L4
VDD71
L5
VDD72
L8
VDD73
L10
VDD74
L12
VDD75
Y17
VDD150
Y19
VDD151
CPU-SK/940AM2/S/15u
VSS1
VSS2
VSS3
VSS4
VSS5
VSS6
VSS7
VSS8
VSS9
VSS10
VSS11
VSS12
VSS13
VSS14
VSS15
VSS16
VSS17
VSS18
VSS19
VSS20
VSS21
VSS22
VSS23
VSS24
VSS25
VSS26
VSS27
VSS28
VSS29
VSS30
VSS31
VSS32
VSS33
VSS34
VSS35
VSS36
VSS37
VSS38
VSS39
VSS40
VSS41
VSS42
VSS43
VSS44
VSS45
VSS46
VSS47
VSS48
VSS49
VSS50
VSS51
VSS52
VSS53
VSS54
VSS55
VSS56
VSS57
VSS58
VSS59
VSS61
VSS62
VSS63
VSS64
VSS65
VSS66
VSS67
VSS68
VSS69
VSS70
VSS71
VSS72
VSS73
VSS74
VSS75
VSS240
VSS241
A3
A7
A9
A11
AA4
AA5
AA7
AA9
AA11
AA13
AA15
AA17
AA19
AA21
AA23
AB2
AB3
AB8
AB10
AB12
AB14
AB16
AB18
AB20
AB22
AC7
AC9
AC11
AC13
AC15
AC17
AC19
AC21
AC23
AD8
AD10
AD12
AD14
AD16
AD20
AD22
AD24
AE4
AE5
AE9
AE11
AF2
AF3
AF8
AF10
AF12
AF14
AF16
AF18
AF20
AF22
AF24
AF26
AF28
AG10
AG11
AH14
AH16
AH18
AH20
AH22
AH24
AH26
AH28
AH30
AK2
AK14
AK16
AK18
Y14
Y16
VCORE
SOCKET_M2G
L14
VDD1
L16
VDD2
L18
VDD3
M2
VDD4
M3
VDD5
M7
VDD6
M9
VDD7
M11
VDD8
M13
VDD9
M15
VDD10
M17
VDD11
M19
VDD12
N8
VDD13
N10
VDD14
N12
VDD15
N14
VDD16
N16
VDD17
N18
VDD18
P7
VDD19
P9
VDD20
P11
VDD21
P13
VDD22
P15
VDD23
P17
VDD24
P19
VDD25
R4
VDD26
R5
VDD27
R8
VDD28
R10
VDD29
R12
VDD30
R14
VDD31
R16
VDD32
R18
VDD33
R20
VDD34
T2
VDD35
T3
VDD36
T7
VDD37
T9
VDD38
T11
VDD39
T13
VDD40
T15
VDD41
T17
VDD42
T19
VDD43
T21
VDD44
U8
VDD45
U10
VDD46
U12
VDD47
U14
VDD48
U16
VDD49
U18
VDD50
U20
VDD51
V9
VDD52
V11
VDD53
V13
VDD54
V15
VDD55
V17
VDD56
V19
VDD57
V21
VDD58
W4
VDD59
W5
VDD60
W8
VDD61
W10
VDD62
W12
VDD63
W14
VDD64
W16
VDD65
W18
VDD66
W20
VDD67
Y2
VDD68
Y3
VDD69
Y7
VDD70
Y9
VDD71
Y11
VDD72
Y13
VDD73
Y15
VDD74
Y21
VDD75
CPU-SK/940AM2/S/15u
VDD2
VSS1
VSS2
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VSS28
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VSS31
VSS32
VSS33
VSS34
VSS35
VSS36
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VSS38
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VSS65
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VSS68
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VSS73
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VSS75
AK20
AK22
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AK28
AK30
AL5
B4
B9
B11
B14
B16
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B20
B22
B24
B26
B28
B30
C3
D14
D16
D18
D20
D22
D24
D26
D28
D30
E11
F4
F14
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G9
G11
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H30
J4
J5
J7
J9
J11
J13
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J21
J23
K2
K3
K8
K10
K12
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K22
Y18
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AA20
AA22
AB13
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AB23
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AC22
AD11
AD23
AE12
AF11
M21
M23
W22
SOCKET_M2H
VDD1
VDD2
VDD3
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Y23
VDD32
CPU-SK/940AM2/S/15u
VDD3
VSS1
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VSS65
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N17
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P2
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P8
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P22
R7
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R19
R21
R23
T8
T10
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T20
T22
U4
U5
U7
U9
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U23
V2
V3
V10
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V18
V20
V22
W9
W11
W13
W15
W17
W19
W21
W23
Y8
Y10
Y12
W7
Y20
Y22
on the board to decoupling near the CPU package.
VCC12_HT
DDRVTT
DDR18V
SOCKET_M2I
AJ4
VLDT_A1
AJ3
VLDT_A2
AJ2
VLDT_A3
AJ1
VLDT_A4
D12
VTT1
C12
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B12
VTT3
A12
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VDDIO4
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VDDIO24
Y24
VDDIO25
Y26
VDDIO26
Y28
VDDIO27
Y29
VDDIO28
CPU-SK/940AM2/S/15u
VDDIO
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VLDT_B2
VLDT_B3
VLDT_B4
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VTT7
VTT8
VTT9
VSS1
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VSS5
VSS6
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VSS28
H6
H5
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K24
K26
K28
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L7
L9
L11
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L21
L23
M8
M10
M12
M14
M16
M18
M20
M22
N4
N5
N7
N9
N11
N13
N15
BUTTOM SIDE
VCORE
SC19
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VCORE
SC27
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SC20
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SC21
10U/8/X5R/10V/K
SC29
10U/8/X5R/10V/K
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22U/8/X5R/6.3V/M/X
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SC22
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SC30
22U/8/X5R/6.3V/M/X
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BC4
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VCORE
0.22U/6/Y5V/16V/Z/X
SC23
22U/8/X5R/6.3V/M/X
SC31
10U/8/X5R/10V/K
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DDR18V
SC12
22U/8/X5R/6.3V/M/X
SC14
1U/6/Y5V/10V/Z
SC24
22U/8/X5R/6.3V/M/X
SC32
10U/8/X5R/10V/K
SC6
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22U/8/X5R/6.3V/M/X
0.1U/6/Y5V/25V/Z
GND
SC13
10U/8/Y5V/10V/Z
BUTTOM SIDE
SC15
SC25
SC33
SC16
0.1U/6/Y5V/25V/Z
SC26
10U/8/X5R/10V/K
BUTTOM SIDE
SC7
SC8
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SC10
SC11
10U/8/Y5V/10V/Z
SC17
0.01U/6/X7R/50V/K
10P/6/NPO/50V/J/X
10P/6/NPO/50V/J/X
SC18
SC9
VCC12_HT
C19
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C20
4.7U/8/Y5V/10V/Z
C21
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C22
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C24
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C15
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C18
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C7
4.7U/8/Y5V/10V/Z
DDRVTT
C25
4.7U/8/Y5V/10V/Z
C8
4.7U/8/Y5V/10V/Z
C26
4.7U/8/Y5V/10V/Z
C9
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C10
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C29
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C12
1N/6/X7R/50V/K/X
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1N/6/X7R/50V/K/X
C13
C31
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C1410P/6/NPO/50V/J/X
10P/6/NPO/50V/J/X
C32
10P/6/NPO/50V/J/X
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU POWER & GND
GA-M55SLI-S4
7 36Wednesday, May 24, 2006
1.0
8
DDR_SMBCLK
D1
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3
1
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SOT23
D2
2
3
1
BAV99/SOT23/300mA/X
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3VDUAL
D D
DDR_SMBDATA
SOT23
C C
VCC3
BC5
0.1U/6/Y5V/25V/Z/X
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R42
59/4/1
R45
59/4/1
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C34
0.1U/6/Y5V/25V/Z
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DDR_SMBDATA9
DDR_VREF
BC6
0.1U/6/Y5V/25V/Z/X
BC7
0.1U/6/Y5V/25V/Z/X
8
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-CSA15,10
-CSA05,10
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DCLKA25,10
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-DCLKA05,10
DCLKA05,10
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MAAA8
MAAA9
MAAA10
MAAA11
MAAA12
MAAA13
MAAA14
MAAA15
SBAA25,9,10
-SCASA5,9,10
-SRASA5,9,10
-SWEA5,9,10
BC8
1N/6/X7R/50V/K/X
B B
A A
DDR18V
DDR18V
VCC3
DDR_VREF
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DDR_SMBDATA
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SBAA0
CKEA0
-DCLKA2
DCLKA2
-DCLKA1
DCLKA1
-DCLKA0
DCLKA0
SBAA2
-SCASA
-SRASA
-SWEA
7
100
103
106
109
112
115
118
121
124
127
130
133
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139
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145
148
151
154
157
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163
166
169
198
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204
207
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216
219
222
225
228
231
234
237
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194
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120
119
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220
138
137
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185
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180
179
177
176
196
174
173
192
7
DDRII1
2
VSS
5
VSS
8
VSS
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VSS
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VSS
17
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
44
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
51
VDDQ
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VDDQ
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VDDQ
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VDDQ
75
VDDQ
78
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
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VDD
59
VDD
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VDD
VDD
69
VDD
VDD
VDD
VDD
VDD
VDD
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VDD
18
RC1
55
RC0
VDDSPD
1
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SCL
SDA
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SA1
SA0
BA1
71
BA0
CKE1
52
CKE0
76
S1*
S0*
CK2*/RFU
CK2/RFU
CK1*/RFU
CK1/RFU
CK0*
CK0
A0
A1
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A2
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A4
60
A5
A6
58
A7
A8
A9
70
A10/AP
57
A11
A12
A13
A14
A15
54
A16/BA2
74
CAS*
RSA*
73
WE*
DDR2/240/YL/VA/D
-DQSA[0..7]
DQSA[0..7]
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6
68
NC
102
NC/TEST
19
NC
77
ODT1
195
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42
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43
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48
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7
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6
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NC/DQS17*
3
DQ(0)
4
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9
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5
4
3
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DDRII2
2
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5
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SBAB0
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-DCLKB2
DCLKB2
-DCLKB1
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-DCLKB0
DCLKB0
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-SRASB
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VSS
139
VSS
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VSS
145
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
169
VSS
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VSS
201
VSS
204
VSS
207
VSS
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VSS
213
VSS
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VSS
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VSS
222
VSS
225
VSS
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VSS
231
VSS
234
VSS
237
VSS
51
VDDQ
56
VDDQ
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VDDQ
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VDDQ
75
VDDQ
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VDDQ
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VDDQ
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VDDQ
181
VDDQ
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VDDQ
170
VDDQ
53
VDD
59
VDD
64
VDD
197
VDD
69
VDD
172
VDD
187
VDD
184
VDD
178
VDD
189
VDD
67
VDD
18
RC1
55
RC0
238
VDDSPD
1
VREF
120
SCL
119
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101
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SA1
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171
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52
CKE0
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S1*
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A6
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A9
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57
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192
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WE*
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C33
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MEM_SMBDATA
100P/4/NPO/50V/J/X
5
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C35
C36
100P/4/NPO/50V/J/X
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VCC3
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DCLKB25,10
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-DCLKB05,10
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4
68
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102
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7
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-DQSB0
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NC/DQS17*
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DQS(6)
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DQS8
DQS8*
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45
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126
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135
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147
155
156
202
203
211
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223
224
232
233
164
165
MDB0
3
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MDB4
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MDB59
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MDB61
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MDB62
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MDB63
236
GIGABYTE Technology
Title
Size Document Number Rev
Custom
Date: Sheet of
2
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-DQSB[0..7]
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DMB2
DMB3
DMB4
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DMB6
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1
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-DQSB[0..7] 5,9
DMB[0..7] 5,9
8 36
1
8
D D
-DQSB[0..7]
-DQSB[0..7] 5,8
DQSB[0..7]
DQSB[0..7] 5,8
DMB[0..7]
DMB[0..7] 5,8
C C
DDR_VREF DDR_VREF
C37
B B
0.1U/6/Y5V/25V/Z
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VCC3
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DCLKA55,10
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DCLKA45,10
-DCLKA35,10
DCLKA35,10
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A A
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-SRASA5,8,10
7
6
DDRII3
2
VSS
5
VSS
8
VSS
11
VSS
14
VSS
17
VSS
20
VSS
23
VSS
26
VSS
29
VSS
32
VSS
35
VSS
38
VSS
41
VSS
44
VSS
47
VSS
50
VSS
65
VSS
66
VSS
79
VSS
82
VSS
85
VSS
88
VSS
91
VSS
94
VSS
97
VSS
100
VSS
103
VSS
106
VSS
109
VSS
112
VSS
115
VSS
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VSS
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VSS
124
VSS
127
VSS
130
VSS
133
VSS
136
VSS
139
VSS
142
VSS
145
VSS
148
VSS
151
VSS
154
VSS
157
VSS
160
VSS
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VSS
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VSS
169
VSS
198
VSS
201
VSS
204
VSS
207
VSS
210
VSS
213
VSS
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VSS
219
VSS
222
VSS
225
VSS
228
VSS
231
VSS
234
VSS
237
VSS
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VDDQ
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VDDQ
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VDDQ
72
VDDQ
75
VDDQ
78
VDDQ
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VDDQ
194
VDDQ
181
VDDQ
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VDDQ
170
VDDQ
53
VDD
59
VDD
64
VDD
197
VDD
69
VDD
172
VDD
187
VDD
184
VDD
178
VDD
189
VDD
67
VDD
18
RC1
55
RC0
238
VDDSPD
1
VREF
120
SCL
119
SDA
101
SA2
240
SA1
239
SA0
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190
BA1
SBAA0
71
BA0
171
CKE1
CKEA1
52
CKE0
76
S1*
193
S0*
221
CK2*/RFU
DCLKA5
220
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CK1*/RFU
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137
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-DCLKA3
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CK0*
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185
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188
A0
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A1
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A2
182
A3
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A4
60
A5
180
A6
58
A7
179
A8
177
A9
70
A10/AP
57
A11
176
A12
196
A13
174
A14
173
A15
SBAA2
54
A16/BA2
-SCASA
74
CAS*
-SRASA
192
RSA*
-SWEA
73
WE*
SBAA15,8,10
SBAA05,8,10
CKEA15,10
-CSA35,10
-CSA25,10
SBAA25,8,10
-SWEA5,8,10
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VCC3
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MAAA3
MAAA4
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MAAA8
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MAAA14
MAAA15
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DQS*(1)
DQS(2)
DQS*(27)
DQS(3)
DQS*(3)
DQS(4)
DQS*(4)
DQS(5)
DQS*(5)
DQS(6)
DQS*(6)
DQS(7)
DQS*(7)
DQS8*
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NC/DQS17*
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DQ(11)
DQ(12)
DQ(13)
DQ(14)
DQ(15)
DQ(16)
DQ(17)
DQ(18)
DQ(19)
DQ(20)
DQ(21)
DQ(22)
DQ(23)
DQ(24)
DQ(25)
DQ(26)
DQ(27)
DQ(28)
DQ(29)
DQ(30)
DQ(31)
DQ(32)
DQ(33)
DQ(34)
DQ(35)
DQ(36)
DQ(37)
DQ(38)
DQ(39)
DQ(40)
DQ(41)
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DQ(46)
DQ(47)
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DQ(49)
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DQ(51)
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DQ(53)
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DQ(55)
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DQ(57)
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DQ(59)
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ODT1
ODT0
CB(0)
CB(1)
CB(2)
CB(3)
CB(4)
CB(5)
CB(6)
CB(7)
DQS8
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DQ(1)
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DQ(8)
DQ(9)
5
-DQSA[0..7]
DQSA[0..7]
68
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102
19
NC
77
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195
42
43
48
49
161
162
167
168
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7
-DQSA0
6
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-DQSA4
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-DQSA6
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DQSA7
114
-DQSA7
113
46
45
DMA0
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126
DMA1
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DMA3
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DMA4
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203
DMA5
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DMA6
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DMA7
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233
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165
MDA0
3
MDA1
4
MDA2
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MDA4
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MDA9
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22
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132
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25
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30
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39
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MDA58
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117
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229
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230
MDA62
235
MDA63
236
DMA[0..7]
MODT_A1 5,10 MODT_B1 5,10
MDA[0..63] 5,8
MAAB[0..15]5,8,10
4
-DQSA[0..7]5,8
DQSA[0..7] 5,8
DMA[0..7] 5,8
C38 0.1U/6/Y5V/25V/Z
DDR_SMBCLK8
DDR_SMBDATA8
VCC3
3
2
DDRII4
2
VSS
5
VSS
8
VSS
11
VSS
14
VSS
17
VSS
20
VSS
23
VSS
26
VSS
29
VSS
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VSS
35
VSS
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VSS
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VSS
44
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
121
VSS
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VSS
127
VSS
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VSS
166
VSS
169
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56
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DCLKB5
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59
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VDD
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VDD
184
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189
VDD
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18
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55
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238
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119
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DQS*(3)
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GIGABYTE Technology
Title
Size Document Number Rev
Custom
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6
5
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Date: Sheet of
2
DDRII CHANNEL B
GA-M55SLI-S4 1.0
9 36
1
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1.5p/4/NPO/50V/B
C43
1.5p/4/NPO/50V/B
C44
1.5p/4/NPO/50V/B
C45
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MAAB5
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MAAB6
C67 22P/4/NPO/50V/J
MAAB7
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MAAB8
C72 22P/4/NPO/50V/J
MAAB9
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MAAB10
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MAAB11
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MAAB14
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MAAB15
C84 22P/4/NPO/50V/J
-SWEB
-SWEB5,8,9
-SCASB5,8,9
-SRASB5,8,9
C88 22P/4/NPO/50V/J
-SCASB
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SBAB1
C93 22P/4/NPO/50V/J
SBAB2
C94 22P/4/NPO/50V/J
A A
GIGABYTE Technology
Title
Size Document Number Rev
B
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7
6
5
4
3
Date: Sheet of
2
DDRII TERMINATOR
GA-M55SLI-S4
10 36Wednesday, May 24, 2006
1
1.0
8
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6
5
4
3
2
1
U1A
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D D
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C C
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132
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8.2K/4/X
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132
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VCC3
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L0_CTLOUT_L04
R112 8.2K/4
R113 49.9/4/1
R114 150/4/1
C115
0.01U/4/Y5V/50V/Z
HTSTOP_L6
HT1_VLD29
CPU_VLD29
HT1VDD_EN29
CPUVDD_EN28
L0_CADOUT_L10
L0_CADOUT_L11
L0_CADOUT_L12
L0_CADOUT_L13
L0_CADOUT_L14
L0_CADOUT_L15
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CTLOUT_H0
L0_CTLOUT_L0
-HT_REQ
HTSTOP_L
HT_COMP1
HT_COMP2
HT1_VLD
CPU_VLD
MEM_VLD
HT1VDD_EN
CPUVDD_EN
C116
0.1U/6/Y5V/25V/Z
AG30
HT_RXD0
AF30
HT_RXD1
AE29
HT_RXD2
AD27
HT_RXD3
AC29
HT_RXD4
AB30
HT_RXD5
AA30
HT_RXD6
AA28
HT_RXD7
AE26
HT_RXD8
AD26
HT_RXD9
AC24
HT_RXD10
AC26
HT_RXD11
AB26
HT_RXD12
Y22
HT_RXD13
Y24
HT_RXD14
Y26
HT_RXD15
AG29
HT_RXD0*
AF29
HT_RXD1*
AE28
HT_RXD2*
AD28
HT_RXD3*
AB28
HT_RXD4*
AB29
HT_RXD5*
AA29
HT_RXD6*
AA27
HT_RXD7*
AF26
HT_RXD8*
AD25
HT_RXD9*
AD24
HT_RXD10*
AC25
HT_RXD11*
AB25
HT_RXD12*
AA22
HT_RXD13*
Y23
HT_RXD14*
Y25
HT_RXD15*
AC27
HT_RX_CLK0
AC28
HT_RX_CLK0*
AB24
HT_RX_CLK1
AB23
HT_RX_CLK1*
Y28
HT_RXCTL
W27
HT_RXCTL*
M22
HT_REQ*/GPIO
N22
HT_STOP*
AF27
HT_CAL_GND1
AF28
HT_CAL_GND2
AK5
HT_VLD
AJ4
CPU_VLD
AK4
MEM_VLD
AE3
HTVDD_EN
AD3
CPUVDD_EN
AG28
+3.3V_PLL_HT
AG27
+3.3V_PLL_CPU
I101
CRUSHK804-SLI-A04/BGA740/[10HB1-080741-30]
SEC 1 OF 7
CRUSHK804/S
HT_TXD0
HT_TXD1
HT_TXD2
HT_TXD3
HT_TXD4
HT_TXD5
HT_TXD6
HT_TXD7
HT_TXD8
HT_TXD9
HT_TXD10
HT_TXD11
HT_TXD12
HT_TXD13
HT_TXD14
HT_TXD15
HT_TXD0*
HT_TXD1*
HT_TXD2*
HT_TXD3*
HT_TXD4*
HT_TXD5*
HT_TXD6*
HT_TXD7*
HT_TXD8*
HT_TXD9*
HT_TXD10*
HT_TXD11*
HT_TXD12*
HT_TXD13*
HT_TXD14*
HT_TXD15*
HT_TX_CLK0
HT_TX_CLK0*
HT_TX_CLK1
HT_TX_CLK1*
HT_TXCTL
HT_TXCTL*
CPU_CLK
CPU_CLK*
CPU_CLK_66
CPU_PWROK
CPU_RST*
THERMTRIP*/GPIO
CPU_COMP
TRST*
TCK
TDI
TDO
TMS
L0_CADIN_H0
N27
L0_CADIN_H1
N29
L0_CADIN_H2
P29
L0_CADIN_H3
P28
L0_CADIN_H4
T28
L0_CADIN_H5
U28
L0_CADIN_H6
U30
L0_CADIN_H7
V29
L0_CADIN_H8
P25
L0_CADIN_H9
P26
L0_CADIN_H10
P22
L0_CADIN_H11
T25
L0_CADIN_H12
U22
L0_CADIN_H13
V26
L0_CADIN_H14
V24
L0_CADIN_H15
V22
L0_CADIN_L0
N28
L0_CADIN_L1
N30
L0_CADIN_L2
P30
L0_CADIN_L3
R29
L0_CADIN_L4L0_CADOUT_L4
U27
L0_CADIN_L5
U29
L0_CADIN_L6L0_CADOUT_L6
V30
L0_CADIN_L7
V28
L0_CADIN_L8
P24
L0_CADIN_L9
N26
L0_CADIN_L10
P23
L0_CADIN_L11
T26
L0_CADIN_L12
T22
L0_CADIN_L13
U26
L0_CADIN_L14
V25
L0_CADIN_L15
?
V23
R28
L0_CLKIN_L0
R27
L0_CLKIN_H1
T23
L0_CLKIN_L1
T24
L0_CTLIN_H0
W29
L0_CTLIN_L0
W28
SR2 0/6/SHT/X
L28
SR3 0/6/SHT/X
L29
TP_CPU_CLK_66
L27
CPU_PWRGD
M26
-CPURST
M28
THERMTRIP_CPU_L
AF25
CPU_COMP
M25
CK8_TCK
AD5
CK8_TDI
AC6
CK8_TDO
AB6
CK8_TMS
AC3
-CK8_TRST
AC5
1
1
TP22
L0_CADIN_H[0..15]
L0_CADIN_L[0..15]
CPUCLK0_H
CPUCLK0_L
TP21
R540 549/4/1
R116 8.2K/4
R117 8.2K/4
R118 8.2K/4
R119 8.2K/4
L0_CADIN_H[0..15] 4
FAN SINK/[12SP2-01A002-61R_12SP2-01A002-62R]
L0_CADIN_L[0..15] 4
L0_CLKIN_H0 4
L0_CLKIN_L0 4
L0_CLKIN_H1 4
L0_CLKIN_L1 4
L0_CTLIN_H04
L0_CTLIN_L0 4
CPUCLK0_H 6
CPUCLK0_L 6
CPU_PWRGD6
-CPURST 6
THERMTRIP_CPU_L6
VCC3
CPUCLK0_HL0_CLKIN_H0
N.B FANSINK
2
SR1 261/4/1/X
CPUCLK0_H
CPUCLK0_L
NB_HS
RESERVED
R110 200/4/X
R111 200/4/X
1
CPUCLK0_L
VCC3
A A
8
FB3 0/6/SHT/X
C117
0.1U/6/Y5V/25V/Z/X
COUPON1
COUPON2
COUPON1 COUPON/X
COUPON2 COUPON/X
7
21
21
C118
0.1U/6/Y5V/25V/Z
VCORE
C119
0.01U/4/Y5V/50V/Z
6
BC24
10U/8/Y5V/10V/Z
Title
Size Document Number Rev
B
5
4
3
Date: Sheet of
2
CK804 (HOST)
GA-M55SLI-S4 1.0
11 36Wednesday, May 24, 2006
1
GIGABYTE Technology
VCC3_PLL_CPU