5
Digitally signed by dd
DN: cn=dd, o=dd, ou=dd,
email=dddd@yahoo.com, c=US
Date: 2009.10.23 06:55:25
+07'00'
4
3
2
1
Model Name: 8AENXP-D
SHEET TITLE
01
D D
02
03
04
05
06
07
08
09
C C
10
11
12
13
14
COVER SHEET
BLOCK DIAGRAM
BOM & PCB MODIFY HISTORY
P4_LGA775_A
P4_LGA775_B
P4_LGA775_C
P4_LGA775_D
GMCH-GRANTSDALE_HOST
GMCH-GARNTSDALE_DDR
GMCH-GRANTSDALE_PCI E, DMI
GMCH-GRANTSDALE_INT VGA
GMCH-GRANTSDALE_GND
GMCH-GRANTSDALE_PWR
DDRII CHANNEL A 1,2
Revision 1.01
SHEET TITLE
28
29
30
31
IDE
KB_PS2,GAME PORT
FRONT PANEL
USBFRONT CONNECTOR
CPU_FAN & SYS_FAN32
33
34
35
36
37
38
39
40
41
AZALIA CODEC ALC880
AUDIO JACK 1
AUDIO JACK 2
MARVELL 88E8001 LAN
DISCRETE POWER
CYPRESS USB HUB
ITE 8712GB
COM_LPT
BROADCOM BCM5751 LAN
15
16
17
B B
18
19
20
21
22
23
24
A A
25
DDRII CHANNEL A 3
DDRII CHANNEL B 1,2
DDRII CHANNEL B 3
DDRII TERMINATION
PCI EXPRESS*16 SLOT
ICH6 PCI, USB, DMI, LAN
ICH6 IDE, GPIO, SATA, CTRL
ICH6 VCC, GND
FWH
GB/CK410M CLOCK.
PCI SLOT 1, 2,3
42
43
44
45
46
47
48
SILICON IMAGE SIL3114
TI 1394B-1
TI 1394B-2
ATX POWER CONN.
DPS-1
DPS-2
DPS-3
26
27
PCI EXPRESS*1 SLOT 1,2,3
H/W MONITOR
5
4
Title
Size Document Number Rev
Custom
3
2
Date: Sheet
Intel Confidential
Cover Sheet
8AENXP-D
148Wednesday, November 24, 2004
1
1.01
of
5
4
3
2
1
BLOCK DIAGRAM
INTEL Pentium4
LGA775
D D
CLOCK GENERATOR
CKVDD = 3.3V
PAGE 24
VCORE = 1.4V
VCC3
PAGE 4, 5, 6,7
VID0~4
DPS
VCORE = 1.40V (2.8GHz)
5VSB,-12V,+12V,VCC,VCC3,3VDUAL
PAGE 46,47,48
CHANNEL A
GAD0~31
ADSTB0,ADSTB0ADSTB1,ADSTB1-
PCI EXPRESS X16
VDDQ = 1.5V (AGP POWER 4X)
VCC3 = 3.3V
+12V = 12V
3VDUAL = 3.3V
VCC = 5V
C C
PAGE 19
SBA0~7
SBSTB,SBSTB-
GCBE0~3ST0~2
AGP BUS
PCI EXPRESS X1 SLOT
1,2,3
VDDQ = 1.5V (AGP POWER 4X)
VCC3 = 3.3V
+12V = 12V
3VDUAL = 3.3V
VCC = 5V
PAGE 25
MCH
ALDERWOOD
VCORE = 1.75V / SLEEP : 1.3V
2_5VSTR = 2.5V(MEMORY)
VDDQ = 1.5V (AGP POWER 4X, HUBLINK)
HL0~10
CONTROL BUS
ICH6R
PAGE 8 ,9,10,11,12,13
HUB LINK
MAA0~14
MAA_CPC1~5
MAB_CPC1~5
MDD0~63
-DQSD0~7
DM0~7
USB PORTS 0~7
VCC = 5V
5VSB = 5V
5VUSB = 5V
PAGE 31,36,41
VCC25 = 2.5V(I/O,MEMORY/I,VLINK/I)
3VDUAL = 3.3V(SUSPEND POWER)
VCC3 = 3.3V
RTCVDD = 3.3V
PAGE 20,21,22
DDRII SDRAM DIMM X 3
1.8VSTR = 1.8V(MEMORY,SUSPEND POWER)
VTT_DDR = 0.9V
PAGE 14,15
CHANNEL B
DDRII SDRAM DIMM X 3
1.8VSTR = 1.8V(MEMORY,SUSPEND POWER)
VTT_DDR = 0.9V
PAGE 16,17
IDE Primary
VCC = 5V
PAGE 28
SERIAL ATA
VCC = 5V
PAGE 21
B B
CYPRESS USB PORTS
VCC3 = 3.3V
PAGE 38
AC97/Azalia ALC880
+12V = 12V
VCC = 5V 5VSB = 5V
AVDD = 5V
PAGE 33
AC97 LINK
PCI BUS
PCI SLOT 1,2
+12 = 12V
-12 = -12V
VCC = 5V
VCC3 = 3V
3VDUAL = 3V
MARVELL 88E8001
PAGE 26
PAGE 36
LPC BUS
FWH/HWMO
VCC = 5V
VCC3 = 3V
LPC I/O ITE8712GB-IX
VCC = 5VVCC3 = 3.3V
VBAT = 3V
PAGE 27
PAGE 39
SATA 3114
A A
AUDIO PORTS :
LIN_ OUT
TELE
CD_IN
LINE_IN
AUX_IN
5
FRONT AUDIO
MIC
PAGE 34,35
PAGE 42
FRONT PANEL /CPU FAN
VCC = 5V
5VSB = 5V
+12 = 12V
PVCC = 5V
4
PAGE 32
3
I/O PORTS :
COMB
COMA IR
LPT
2
PS2
FDD
PAGE 29,40
Title
Size Document Number Rev
Custom
Date: Sheet
Intel Confidential
BOM & PCB MODIFY HISTORY
8AENXP-D
1
of
248Wednesday, November 24, 2004
1.01
5
4
3
2
1
Model Name: 8AENXP-D
Circuit or PCB layout change
for next version
Version: 1.01
PAGE Change Item Reason
D D
Component value change
history
Data Change Item Reason
01'05'04 1.Remove High Side MoSFET
2.Change Q45 to SUD50N024-09P
3.Rmove MOSFET HSINK
4. Approve LAN Power
01'08'04
C C
02'18'04
04'22'04 1.Change GMCH to B0
B B
05'11'04
05'17'04
05'18'04
05'20'04 1.0C ECN
A A
05'31'04 1.0C ECN
1.Change MOSFET Gate from 0/6 to 1/6
2.Remove EC80,EC35,EC45,EC71,EC70,EC72,
EC74,LEC9,EC61,EC79
3.Change U24 to 10HL6-184201-10 ICS
CK410M
4.Change U17 to 10GL4-15b252-10
5.Change DU3 to 10TA1-0F8266-10
1.Change GMCH to A2
2.Change ICH6 to A1
3.Change CLOCK GEN. to ICS 954271
4.Remove Onboard DPS
5. Add PROCESSOR HOT CIRCUIT
2.Change ICH6 to B0
3.Change On-Lan to Broadcom 5751
4.Change PCB to 0.3
1.Change GMCH to B1
2.Chabge ICH6 to B1
2.Change BCM5751 to A1
4.CHange PCB to 1.0
1.Change C256 0.1U to C256 100
1.Remove U77,U78 Socket
2.Add L15,L10
1.Remove DQ43
2.Remove DR219
3.Change CU1 to P/N:10HP5-366880-31
4.Add ITE8712F/IX3
5.Remove BU1,PCI_BT,R552
1.Add DU5 LM324 TI
5
替料
替料
替料
4
07/08/04 1.0E 1.Fix P4 Extreme CPU
07/13/04 1.1A
2004/08/02 2.0A
2004/08/10 2.1A
2004/08/17 2.1B
2004/09/02 2.2A
2004/10/11 1.0A
2004/10/22 1.0B
2004/11/08 1.0C
2004/11/17 1.0D
2004/11/24 1.0E
3
1.Fix Processor Hot Circuit06/10/04
2.Remove SLBC1,SLBC2
3.Change PCI Single Pull High to VCC 2.2K/8P4R
1.Support DDR2-600
2.Support VTT_GMCH Over Voltage
1.Change MCH to B1
2.Change PCB to 2.0
1.Change MCH to B2
1.Change F_USB to 5VDual
2.Fix Smart Fan
3.Change 330U to 470U
1.Change Vcore Choke to 0.6uH
2.Support Cedar Mill CPU
1.Change to 8AENXP-D 1.0A
1.Change Green_USB to USB 2.0
2.BOM Change to PVT
1.Change LBC51 to 10U/8/Y/10V 1.Approve AVDD25 Voltage
1.Change U19 to ICH6R/B2
1.Remove Turbo 0 Circuit
Title
Size Document Number Rev
Custom
2
Date: Sheet
Intel Confidential
BOM & PCB MODIFY HISTORY
8AENXP-D
1
348Wednesday, November 24, 2004
1.01
of
5
VCORE
BC1
10U/12/X/6.3V
D D
BC2
10U/12/X/6.3V
BC3
10U/12/X/6.3V
BC4
10U/12/X/6.3V
100U/2V/SPCAP/X P/N:10CL3-201000-11
VCORE
+
+
EC163
100U/2V/SPCAP/X P/N:10CL3-201000-11
EC164
4
VCORE
+
+
EC161
EC162
100U/2V/SPCAP/X P/N:10CL3-201000-11
100U/2V/SPCAP/X P/N:10CL3-201000-11
VCORE
10U/12/X/6.3V
BC6
3
BC7
10U/12/X/6.3V
BC8
10U/12/X/6.3V
BC9
10U/12/X/6.3V
2
1
AB6
AA4
AD6
AA5
AB5
AC5
AB4
AG6
AG4
AG5
AH4
AH5
AC4
AE4
AD5
U1A
L5
A03#
P6
A04#
M5
A05#
L4
A06#
M4
A07#
R4
A08#
T5
A09#
U6
A10#
T4
A11#
U5
A12#
U4
A13#
V5
A14#
V4
A15#
W5
A16#
N4
RSVD
P5
RSVD
K4
REQ0#
J5
REQ1#
M6
REQ2#
K6
REQ3#
J6
REQ4#
R6
ADSTB0#
G5
PCREQ#
A17#
W6
A18#
Y6
A19#
Y4
A20#
A21#
A22#
A23#
A24#
A25#
A26#
AF5
A27#
AF4
A28#
A29#
A30#
A31#
A32#
A33#
AJ5
A34#
AJ6
A35#
RSVD
RSVD
ADSTB1#
LGA775
ADS#
BNR#
HIT#
RSP#
BPRI#
DBSY#
DRDY#
HITM#
IERR#
INIT#
LOCK#
TRDY#
BINIT#
DEFER#
EDRDY#
MCERR#
AP0#
AP1#
BR0#
TESTHI08
TESTHI09
TESTHI10
DP0#
DP1#
DP2#
DP3#
GTLREF
RESET#
RS0#
RS1#
RS2#
D2
C2
D4
H4
G8
B2
C1
E4
AB2
P3
C3
E3
AD3
G7
F2
AB3
U2
U3
F3
G3
G4
H5
J16
H15
H16
J17
H1
G23
B3
F5
A3
-HADS
-BNR
-HIT
-BPRI
-DBSY
-DRDY
-HITM
-IERR
-HINIT
-HLOCK
-HTRDY
-DEFER
-EDRDY
CPU_TP1
CPU_TP2
-BR0
TESTHI8
TESTHI9
TESTHI10
CPU_TP3
CPU_TP4
CPU_TP5
CPU_TP6
-CPURST
-RS0
-RS1
-RS2
-HADS 8
-BNR 8
-HIT 8
-BPRI 8
-DBSY 8
-DRDY 8
-HITM 8
-HLOCK 8
-HTRDY 8
-DEFER 8
-EDRDY 8
-BR0 8
220P/4/N/25V
GTLREF
-RS0 8
-RS1 8
-RS2 8
Closed to
Pin-H1
R1
VTT_OL
VTT_OL
VTT_GMCH
VTT_OL
VTT_OL
49.9/6/1
BC11
0.01U/4/X/16V
R2
100/6/1
RN122 62/8P4R
7 8
5 6
3 4
1 2
R1525 62/6
R6 62/6/X
R7 62/6C4
R8 62/6
VTT_OR
-HINIT 21
C2
33P/4/N/50V
C1
-CPURST 8
22P/4/N/50V
C3
1U/6/Y/10V
TESTHI8
TESTHI9
TESTHI10
-IERR
-IERR
-BR0
-CPURST
GTLREF
HA[3..16]8
C C
HA[17..31]8
SP-CAP X 4PCS
VCORE
B B
+
100U/2V/SPCAP/X P/N:10CL3-201000-11
+
EC2
100U/2V/SPCAP/X P/N:10CL3-201000-11
+
EC3
EC4
100U/2V/SPCAP/X P/N:10CL3-201000-11
HA[3..16]
HA[17..31]
HA3
HA4
HA5
HA6
HA7
HA8
HA9
HA10
HA11
HA12
HA13
HA14
HA15
HA16
-HREQ08
-HREQ18
-HREQ28
-HREQ38
-HREQ48
-HADSTB08
-HPCREQ8
HA17
HA18
HA19
HA20
HA21
HA22
HA23
HA24
HA25
HA26
HA27
HA28
HA29
HA30
HA31
-HADSTB18
-HREQ0
-HREQ1
-HREQ2
-HREQ3
-HREQ4
-HADSTB0
-HPCREQ
-HADSTB1
CR1
VCORE
BC21
10U/12/X/6.3V/X
A A
VCORE
BC30
10U/12/X/6.3V/X
BC31
10U/12/X/6.3V/X
5
VCORE
BC25
10U/12/X/6.3V/X
4
BC26
10U/12/X/6.3V/X
BC23
10U/12/X/6.3V/X
BC28
10U/12/X/6.3V/X
BC20
10U/12/X/6.3V/X
BC29
10U/12/X/6.3V/X
3
CPU RETAINTION/X
Title
Size Document Number Rev
Custom
2
Date: Sheet
Intel Confidential
P4_LGA775-A
8AENXP-D
1
448Wednesday, November 24, 2004
1.01
of
5
D D
4
3
2
1
HD[0..15]8
C C
HD[16..31]8
B B
HD[0..15]
HD[16..31]
HD0
HD1
HD2
HD3
HD4
HD5
HD6
HD7
HD8
HD9
HD10
HD11
HD12
HD13
HD14
HD15
-DBI08
STBN08
STBP08
-DBI18
STBN18
STBP18
-DBI0
STBN0
STBP0
HD16
HD17
HD18
HD19
HD20
HD21
HD22
HD23
HD24
HD25
HD26
HD27
HD28
HD29
HD30
HD31
-DBI1
STBN1
STBP1
U1B
B4
D00#
C5
D01#
A4
D02#
C6
D03#
A5
D04#
B6
D05#
B7
D06#
A7
D07#
A10
D08#
A11
D09#
B10
D10#
C11
D11#
D8
D12#
B12
D13#
C12
D14#
D11
D15#
A8
DBI0#
C8
DSTBN0#
B9
DSTBP0
G9
D16#
F8
D17#
F9
D18#
E9
D19#
D7
D20#
E10
D21#
D10
D22#
F11
D23#
F12
D24#
D13
D25#
E13
D26#
G13
D27#
F14
D28#
G14
D29#
F15
D30#
G15
D31#
G11
DBI1#
G12
DSTBN1#
E12
DSTBP1
LGA775
D32#
D33#
D34#
D35#
D36#
D37#
D38#
D39#
D40#
D41#
D42#
D43#
D44#
D45#
D46#
D47#
DBI2#
DSTBN2#
DSTBP2
D48#
D49#
D50#
D51#
D52#
D53#
D54#
D55#
D56#
D57#
D58#
D59#
D60#
D61#
D62#
D63#
DBI3#
DSTBN3#
DSTBP3
HD32
G16
HD33
E15
HD34
E16
HD35
G18
HD36
G17
HD37
F17
HD38
F18
HD39
E18
HD40
E19
HD41
F20
HD42
E21
HD43
F21
HD44
G21
HD45
E22
HD46
D22
HD47
G22
-DBI2
D19
G20
G19
D20
D17
A14
C15
C14
B15
C18
B16
A17
B18
C21
B21
B19
A19
A22
B22
C20
A16
C17
STBN2
STBP2
HD48
HD49
HD50
HD51
HD52
HD53
HD54
HD55
HD56
HD57
HD58
HD59
HD60
HD61
HD62
HD63
-DBI3
STBN3
STBP3
-DBI2 8
STBN2 8
STBP2 8
-DBI3 8
STBN3 8
STBP3 8
HD[32..47] 8
HD[48..63] 8
A A
Title
Size Document Number Rev
Custom
5
4
3
2
Date: Sheet
Intel Confidential
P4_LGA775-C
8AENXP-D
1
548Wednesday, November 24, 2004
1.01
of
5
Note:
VCCA & VCOREPLL
GS
BSEL166_239
BSEL166_139
define doesn't same as
old P4 design kit
+
EC5
100U/D/10V/57
As close as possible to
CPU socket
C1274
33P/4/N/50V
C1273
33P/4/N/50V
FSBSEL1
3
Q273
D
2N7002/SOT23/X
2
1
R1582 0/6/X
FSBSEL0
VCCA
R17
0/SHT/X
VSSA
VCOREPLL
-STPCLK
FSBSEL1
Q268
CPU_TEMP27,39
THERMDC39
VTT_GMCH
Q267
VTT_GMCH
BC34
1N/4/X/50V
R1540
132
R1541
1K/6
132
1K/6
2N7002/SOT23
VTT_GMCH
L1
10UH/8/S
D D
L2
10UH/8/S
VCC_SENSE46,48
VSS_SENSE46,48
C C
VTT_GMCH
R1569
1K/6/X
B B
A A
Q274
C6
1U/6/Y/10V
C7
1U/6/Y/10V
VCC
MMBT2222/SOT23/X
132
ATXGPO4
5
BC33
10U/12/X/6.3V/X
BC24
10U/12/X/6.3V/X
R1568
8.2K/6/X
FSBSEL0
48
Trace width doesn't
less than 12 Mil
R1558 8.2K/6
2N7002/SOT23
R1559 8.2K/6
4
C9
1N/4/X/50V
4
VID[0..5]46
CPUCLK24
-CPUCLK24
VCC_SENSE46,48
VSS_SENSE46,48
R1571 62/6/X
R1567 62/6/X
BSEL1
FSBSEL1
BSEL0
-A20M21
-FERR21
INTR21
-IGNNE21
-STPCLK21
VID[0..5]
-SKTOCC46
CPU_TP10
-SYS_RST21,23,24,30,46
TP43
TP44
R1570 0/6
-SMI21
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-CPUCLK
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-H_ITPCLK
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3
D
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2
1
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VID4
AL4
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W1
MSID0
F6
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RSVD
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RSVD
RSVD
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VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
VTT
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VTT_OUT
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N/C
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A30
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D25
D26
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D29
D30
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2
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-PROCHOT 32
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VTT_OL
VCC3
2
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-FERR
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VTT_OL
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0.1U/6/Y/25V
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TMS
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-TRST
TCK
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VCC
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VCC
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VCC
VCC
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VCC
VCC
VCC
VCC
VCC
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VCC
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VCC
VCC
VCC
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VCC
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VSS
VSS
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VSS
VSS
VSS
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VSS
VSS
VSS
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
LGA7555/VSS_1
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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VSS
VSS
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VSS
VSS
VSS
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1
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STBN25
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H31
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H26
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M31
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M32
N35
N34
K29
J29
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L31
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K33
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P26
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F33
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F26
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K19
B29
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P34
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U9A
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CPU INTERFACE
925XE /Ver.C2
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A A
5
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21
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VCC3
Title
Size Document Number Rev
Custom
3
2
Date: Sheet
Intel Confidential
GMCH-HOST
8AENXP-D
1
848Wednesday, November 24, 2004
1.01
of
5
4
3
2
1
MODT_A[0..3]
D D
C C
B B
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AN25
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AP22
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AR15
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AP13
AR11
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AN10
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AL22
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2
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1
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1
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BC45
1U/6/Y/10V
R121
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+
+
BC60
1
EC23
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1
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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W25
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VCC
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VCC
VCC
VCC
VCC
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+
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+
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13 48Wednesday, November 24, 2004
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DDRII2
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
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RSA*
WE*
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Title
Size Document Number Rev
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B B
A A
C65
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CKEA09,18
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R150
75/6/1
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VSS
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VSS
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VSS
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VSS
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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BA0
CKE1
CKE0
S1*
S0*
CK2*/RFU
CK2/RFU
CK1*/RFU
CK1/RFU
CK0*
CK0
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10/AP
A11
A12
A13
A14
A15
A16/BA2
CAS*
RSA*
WE*
DDR2/240P/YELLOW
6
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CKEA0
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DCLKA2
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MAAA7
MAAA9
MAAA10
MAAA11
MAAA12
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-SCASA
-SRASA
-SWEA
NC/TEST
ODT1
ODT0
CB(0)
CB(1)
CB(2)
CB(3)
CB(4)
CB(5)
CB(6)
CB(7)
DQS(0)
DQS*(0)
DQS(1)
DQS*(1)
DQS(2)
DQS*(27)
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DQS*(3)
DQS(4)
DQS*(4)
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DQS*(5)
DQS(6)
DQS*(6)
DQS(7)
DQS*(7)
DQS8
DQS8*
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NC/DQS17*
DQ(0)
DQ(1)
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DQ(60)
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68
NC
102
19
NC
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48
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49
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SACB6
167
SACB7
168
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7
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6
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16
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DQSA8
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-DQSA8
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DMA0
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126
DMA1
134
135
DMA2
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147
DMA3
155
156
DMA4
202
203
DMA5
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212
DMA6
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224
DMA7
232
233
164
165
MDA0
3
MDA1
4
MDA2
9
MDA3
10
MDA4
122
MDA5
123
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129
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MDA9
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200
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95
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208
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99
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107
MDA51MAAA8
108
MDA52
217
MDA53
218
MDA54
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MDA55
227
MDA56
110
MDA57
111
MDA58
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MDA59
117
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229
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230
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235
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236
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-DQSA[0..8]
DQSA[0..8]
DMA[0:7]
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5
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C346
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-DQSA[0..8] 9,15
DQSA[0..8] 9,15
DMA[0..7] 9,15
SACB[0..7] 9,15
0.1U/6/Y/25V
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VCC3
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SMBDATA15,16,17,19,21,24,25,26,41,46
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DCLKA5
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DCLKA4
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-DCLKA3
-DCLKA39,15
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-SWEA9,15,18
4
8
D D
C C
B B
A A
7
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DQSA[0..8]
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DQSA[0..8] 9,14
DMA[0..7] 9,14
SACB[0..7] 9,14
6
5
VREF_DDRA14
C1255
0.1U/6/Y/25V
MAAA[0..13]9,14,18
SMBDATA14,16,17,19,21,24,25,26,41,46
VCC3
4
2
5
8
11
14
17
20
23
26
29
32
35
38
41
44
47
50
65
66
79
82
85
88
91
94
97
100
103
106
109
112
115
118
121
124
127
130
133
136
139
142
145
148
151
154
157
160
163
166
169
198
201
204
207
210
213
216
219
222
225
228
231
234
237
51
56
62
72
75
78
VREF_DDRA
SMBCLK
SMBDATA
SBAA1
SBAA0
CKEA2
CKEA3
-DCLKA5
DCLKA5
-DCLKA4
DCLKA4
-DCLKA3
DCLKA3
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MAAA2
MAAA3
MAAA4
MAAA5
MAAA6
MAAA7
MAAA9
MAAA10
MAAA11
MAAA12
MAAA13
SBAA2
-SCASA
-SRASA
-SWEA
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194
181
175
170
53
59
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197
69
172
187
184
178
189
67
18
55
238
1
120
119
101
240
239
190
71
171
52
76
193
221
220
138
137
186
185
188
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63
182
61
60
180
58
179
177
70
57
176
196
174
173
54
74
192
73
DDR18V
VCC3
SMBCLK14,16,17,19,21,24,25,26,41,46
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CKEA29,14,18
CKEA39,14,18
-CSA29,14,18
-CSA39,14,18
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DCLKA39,14
SBAA29,14,18
-SCASA9,14,18
-SRASA9,14,18
-SWEA9,14,18
DDRII3
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
RC1
RC0
VDDSPD
VREF
SCL
SDA
SA2
SA1
SA0
BA1
BA0
CKE1
CKE0
S1*
S0*
CK2*/RFU
CK2/RFU
CK1*/RFU
CK1/RFU
CK0*
CK0
A0
A1
A2
A3
A4
A5
A6
A7
A8
A9
A10/AP
A11
A12
A13
A14
A15
A16/BA2
CAS*
RSA*
WE*
3
NC/TEST
ODT1
ODT0
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CB(3)
CB(4)
CB(5)
CB(6)
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DQS*(1)
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DQS*(3)
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DQS*(4)
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DQS*(5)
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DQS*(6)
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DQS*(7)
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DQS8*
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DQ(1)
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DQ(3)
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DQ(5)
DQ(6)
DQ(7)
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2
68
NC
102
19
NC
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SACB2
48
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SACB5
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7
-DQSA0
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DQSA5
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-DQSA5
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-DQSA6
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DQSA7
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-DQSA7
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DQSA8
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DMA0
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126
DMA1
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135
DMA2
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147
DMA3
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156
DMA4
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203
DMA5
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212
DMA6
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224
DMA7
232
233
164
165
MDA0
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9
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25
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30
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31
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33
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39
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MDA31
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MDA47
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MDA51MAAA8
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MDA63
236
1
MDA[0..63] 9,14
DDR2/240P/RED
8
7
6
5
4
3
GIGABYTE CORP.
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DDRII CHANNEL A
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