EVOC JY-1714CLDNA User Guide

JY-1714CLDNA
版本:
A0
嵌入式 CPU 单板,带 CPU /LVDS /LAN /SSD /Audio
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在打开包装箱后请首先依据物件清单检查配件,若发现物件有所
损坏、或是有任何配件短缺的情况,请尽快与您的经销商联络。
þ 1 JY-1714CLDNA 主板 þ 1 条硬盘线 þ 1 条软驱线 þ 1 ISA 转接线 þ 1 EVOC 软件与用户手册光盘 þ 跳线帽
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声明
除列明随产品配置的配件外,本手册包含的内容并不代表本公司
的承诺,本公司保留对此手册更改权利,另行通知。对任何
因安装、使用不当而导致接、接、有无意的损坏及隐患概
负责
订购产品,请经销商详细了解产品性能否符合您的需求 EVOC研祥智能科技股份公司的册商。本手册所涉及到
其他所有权为相应的产品厂家有。
本手册内容,版所有。许可,得以机械的、
电子的或其它任何方式进行复制
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安全使用小常识
1. 产品使用务必仔细阅读产品书;
2. 未准备安装的板应将其防静电护袋中;
3. 从防静电护袋中拿出卡前应将手先置地金属体上 一会儿(比如 10 秒钟)释放身体静电;
4. 佩戴静电,并 且应该养成只触及其边缘 部分习惯
5. 避免人体被或产品损坏,在每次对主板、板卡进行拔插
重新配置先关闭交流交流线从电源插座
拔掉
6. 在需对板整机进行搬动务必先将交流线从电源插座拔掉
7. 产品,增加/减少务必拔掉交流
8. 接或除任何备前须确定所有的线已被拔
9. 避免频繁对产品造成的损后,至少等 30
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目录
第一章 产品介绍.....................................................................................1
简介...........................................................................................................1
操作系统支持...........................................................................................1
微处理器(CPU) ...................................................................................2
芯片组(CHIPSET)...............................................................................2
系统储器(SYSTEM MEMORY) ....................................................2
IDE ...................................................................................................2
USB ..................................................................................................2
显示...................................................................................................2
LAN...................................................................................3
频(AUDIO)功..............................................................................3
扩展总线...................................................................................................3
CF .........................................................................................................3
FPGA ................................................................................................3
WATCHDOG ...................................................................................3
I/O ....................................................................................................4
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...................................................................................................4
其他...................................................................................................4
安装说明 .....................................................................................5
产品外...................................................................................................5
口位置示.......................................................................................6
跳线...........................................................................................7
系统存安...........................................................................................8
USB............................................................................................................9
IRDA/外接口.........................................................................................9
络接口 ...................................................................................................9
盘与鼠接口 .....................................................................................10
IDE ..................................................................................................10
串口 .............................................................................................12
显示.................................................................................................13
频功.................................................................................................14
数字 I/O 接口 ..........................................................................................14
接口 .................................................................................................19
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ISA 线 .................................................................................................19
FPGA 配置端口......................................................................................28
FPGA JTAG 配置端口 ......................................................................28
CF............................................................................................................30
风扇.................................................................................................31
软驱接.................................................................................................31
PCIMG ...........................................................................................32
BIOS 简介.........................................................................33
附录.........................................................................................................34
WATCHDOG 编程指引 .........................................................................34
I/O 址映射表 ..................................................................................38
IRQ 配表.....................................................................................39
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第一章 产品介绍
第一章 产品介绍
简介
JY-1714CLDNA款采Intel 笔记芯片组852GM 254mm×244mm尺寸开发的性能耗嵌入ULV Celeron-M单板,在嵌入单板讯驰核心超低 Celoron-M处理器支持184 DDR266的内条、支持CRT+LVDS
“双显示”Intel 100Mbps络接AC97 AudioPS/2一个40标准ATA-100 IDE接口CompactFlash
两串口,COM2支持422或485串口、个并口、四个USB2.0高速,使嵌入单板的海量移储成为可能、IrDA红外接口、看门
定时器四个数字IO二十四个USER IO标准ISA三个扩展 ISA个PC104提供个PCI总线给客扩展标准PCI 在板提供个高集FPGA编程逻辑口给用户编程
JY-1714CLDNA以其性能耗和丰富扩展使用户无需
增加任何使用,广泛全、信息家电
表、多媒智能产品各种嵌入
操作系统支持
MS-DOS
Windows98SE
Windows XP
Windows 2000
Windows CE
Linux
JY-1714CLDNA - 1 -
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第一章 产品介绍
环境与机械尺寸
l 尺寸254mm×244mm l 0°C60°C l 湿5%90%
微处理器(CPU
讯驰核心ULV Celoron-M超低CPU
芯片组(Chipset
Intel 852GM + 82801DB芯片组
系统存储器(System Memory
提供两184 pin DDR266 DIMM
IDE 功能
40Pin ATA100,支持 2EIDE设
USB 功能
提供四个USB2.0高速,使 嵌入式单板的海量移动存储成为可
显示功能
Intel 852GM显示芯片支持CRT+LVDS“双显示”支持
64MB显示共享
- 2 - JY-1714CLDNA
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第一章 产品介绍
网络功能(LAN
CPU卡集一个Intel82562ET 100Mb太网您提 供高速平台选择
音频(Audio)功能
成一标准的AC97芯片,提供优质效果
扩展总线
标准PICMGPCI扩展总线,一个标准ISA扩展总线,三个ISA 扩展PC104
CF
支持标准TYPE I TYPE IICF满足用户扩展需求
FPGA 模块
在板提供编程FPGA块,FPGA芯片ALTERA 公司 的Cyclone II EP2C5T144C8
Watchdog 功能
l 1~255 编程 l 时事系统 l 看门狗定时器 l 1(秒/分)分辨率8 下计
JY-1714CLDNA - 3 -
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第一章 产品介绍
I/O 功能
l 个高速口,SPP/EPP/ECP 方式 l 两个 RS-232 串口,COM2 支持 422 485 l 4 4 编程数字 I/O l 标准 PS/2 和鼠 l 115kbps IrDA
省电特性
过BIOS可将电ATX关功系统睡眠
/状态
其他特性
l 监测: CPU 传感,用监测 CPU l ATX l 符合 Windows98 规格强型 ACPI配置
支持理功
- 4 - JY-1714CLDNA
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第二章
118mm
安装说明
产品外形
254mm
81mm
246mm
244mm
236mm
123mm
JY-1714CLDNA - 5 -
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接口位置示意图
IR
PC104CD
PC104AB
ISA1
CN6
ATX ON/OFF
RESET
JP2
CN7
CMOS
JTAG
USB34
PICMG
Mic_In
USB12
FDC
LAN
CN5
JP3
Line_Out
Line_In
LCDV
VGA
LPT
COM2
ATXPWR
COM1
JP1
CPUFAN
KB/MS
ISA4
ISA2 ISA3
IDE
CFACARD
LVDS
DDR1 DDR2
- 6 - JY-1714CLDNA
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跳线功能设置
1) COM2口跳线选择
JP1可使COM2RS-232或是RS-422/RS-485。缺RS-232
JP1选择
1-2 3-4 5-6
JP1
RS-232 ON默认 OFF OFF RS-422 OFF ON OFF RS-485 OFF OFF ON
COM2义选择参见串口
2) CMOS:CMOS内容清除/持设置
CMOS的短接帽所处状态来实现此项功
果由BIOS设置不当而系统正常启试清除
CMOS内容便恢所有系统默认值动系统 CMOS的短接帽所状态来实现此
CMOS
[1-2 ] (正常工状态默认) [1-2 ] (清除CMOS内容,所有BIOS
值)
CMOS
3) LCDVLVDS选择
LVDS屏可能,本板提供3.3V5V两种电压选所选择的LVDS电压与所使用的LVDS电压LVDS 屏才正常显示
JY-1714CLDNA - 7 -
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3.3V 5V
()
4) BIOS跳线选择
1-2 System BIOS
JP3
2-3 User BIOS
系统存安装
CPU配有DDR (Double Data Rate) DIMMDual Inline
Memory Modules184pin(图示DDR1DDR2)
装内注意以下几点:
Ø 装时,先对DIMM 条的缺口和 DIMM 的缺
Ø 使用符合 Intel 2.5V DDR266 规格DDR 最大
512MB
Ø 好选择带 SPD(内识别DIMM 条,
- 8 - JY-1714CLDNA
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USB
CPU提供四个USB标准插座了USB管脚
USB12
号名称 1 +5V 2 USB Data-
USB12/USB34
3 USB Data+ 4 GND
IrDA/外接口
提供一组外线组插IR支持IrDA 1.0SIR协议
ASK-IR协议外线传输
IR
1 +5V 2 N.C. 3 IrRx 4 GND 5 IrTx
信号名称
网络接口
此接是主板10/100Mbps太网LILED和ACTLED
口两绿色黄色LED们显示着LAN动和传输状态。请
参考每一个LED状态描
JY-1714CLDNA - 9 -
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TD+,TD-:正/ RD+,RD-:正/ ACTLED状态 LILED路状态
LILED
(绿色灯)
亮 灭 要收
状态
发数据
ACTLED
黄色
状态
键盘鼠标接口
KB/MS
1 3 5
信号名称
Keyboard data
GND
Keyboard clock
2 4 6
信号名称
Mouse data
+5V
Mouse clock
IDE 接口
本单板脑提供一组40IDEIDEIDE设备
注意
Ø IDE 接口可以接两IDE Master
为从Slave接在接在中间
Ø 接使用Ultra100的硬盘,建 使用 80线的(IDE
- 10 -
JY-1714CLDNA
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第一脚)
IDE
管脚
1 Reset IDE 2 GND 3 Host data 7 4 Host data 8 5 Host data 6 6 Host data 9 7 Host data 5 8 Host data 10
9 Host data 4 10 Host data 11 11 Host data 3 12 Host data 12 13 Host data 2 14 Host data 13 15 Host data 1 16 Host data 14 17 Host data 0 18 Host data 15 19 GND 20 Key 21 DRQ0/1 22 GND 23 Host IOW 24 GND 25 Host IOR 26 GND 27 IOCHRDY 28 Host ALE 29 DACK0/1 30 GND 31 IRQ14/15 32 Null 33 Address 1 34 ATA/66 detect 35 Address 0 36 Address 2 37 Chip select 0 38 Chip select 1 39 Activity 40 GND
号名称 管脚
号名称
:IDEIRQ14DMA/IDEDRQ0/DACK0
JY-1714CLDNA - 11 -
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口与串口
1) 并口:依据您的需求接并
LPT
10 P_-ACK 23 GND 11 P_BUSY 24 GND 12 P_PE 25 GND 13 P_SLCT
信号名称
1 OUT_STB- 14 P_-AFD 2 OUT_PD0 15 P_-ERR 3 OUT_PD1 16 P_-INIT 4 OUT_PD2 17 P_-SLIN 5 OUT_PD3 18 GND 6 OUT_PD4 19 GND 7 OUT_PD5 20 GND 8 OUT_PD6 21 GND 9 OUT_PD7 22 GND
信号名称
2) 口:
COM19D-SUB,COM22×5Pin。COM1,COM2
可以RS-232标准制解相机等
COM1
1 DCD,运载 2 RXD, 3 TXD,传输 4 DTR,准备 5 GND, 6 DSR,准备 7 RTS, 8 CTS,清发 9 RI, 响铃指示 10 N.C.
信号名称
信号名称
- 12 -
JY-1714CLDNA
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1 DCD,运载 2 RXD, TX+ RTX+ 3 TXD,传输 4 DTR,准备 5 GND,
COM2
6 DSR,准备 7 RTS, 8 CTS,清发 RX+ X 9 RI, 响铃指示 RX- X
10
显示接口
1) 15DVGA显示器插座
VGA
信号名称
RS-232 RS-422 RS-485
TX- RTX-
N.C.
信号名称
1 Red 2 Green 3 Blue 4 N.C. 5 GND 6 GND 7 GND 8 GND
9 +5V 10 GND 11 N.C. 12 DDCDATA 13 HSYNC 14 VSYNC 15 DDCCLK
信号名称
JY-1714CLDNA - 13 -
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2) LVDSLVDS输出接口
LVDS
信号名称
1 LVDSD0+ 2 LVDSD0­3 GND 4 GND 5 LVDSD1+ 6 LVDSD1­7 GND 8 GND
9 LVDSD2+ 10 LVDSD2­11 GND 12 GND 13 LVDSCLK+ 14 LVDSCLK­15 GND 16 GND 17 LVDSD3+ 18 LVDSD3­19 VDD 20 VDD
信号名称
音频功能
主板提供三个音频/输出音频
Line_In出(Line_Out麦克Mic_In
数字 I/O 接口
主板提供4路输入和4路输编程,接入和
独立的,在CN5置的8 Pin8个数字位
由Winbond W83627THF Super I/O提供的。
CN5
信号名称
1 VCC5 2 GND 3 INPUT0 4 OUTPUT0 5 INPUT 1 6 OUTPUT1 7 INPUT2 8 OUTPUT2 9 INPUT3 10 OUTPUT3
信号名称
OUTPUT(03) W83627THF GPIO Port5 Bit 03(GP50
53)INPUT (03) W83627THF GPIO Port2 Bit 36(GP23
- 14 -
JY-1714CLDNA
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26)JY-1714CLDNA /编程范例
;MASM ;;JY-1714CLDNA GPIO Test Program.. Model Small 386 INDEX_ADDR EQU 02Eh INDEX_DATA EQU 02Fh
;;Read Winbond83627 PnP Register ReadReg macro x mov al, x out INDEX_ADDR, al jmp $+2 in al, INDEX_DATA endm
;;Write Winbond83627 PnP Register WriteReg macro x,y mov al, x out INDEX_ADDR, al jmp $+2 mov al, y out INDEX_DATA, al endm
;;take Winbond83627 to progammable state EnterProgram macro mov al, 087h out INDEX_ADDR, al jmp $+2 out INDEX_ADDR, al endm
JY-1714CLDNA - 15 -
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;;exit/end programmable state ExitProgram macro mov al, 0aah out INDEX_ADDR, al endm ;;select Logical Device Number SelectLDN macro x WriteReg 007h, x endm
code
start proc far push ds xor ax, ax push ax push cs pop ds push cs pop es
EnterProgram ;;output 005h mov al, 05h call outport ;;;input call inport cmp al, 05h jne error_exit
;;output 00Ah
- 16 -
JY-1714CLDNA
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mov al, 0ah call outport ;;input call inport cmp al, 00Ah jne error_exit mov bp, offset OK mov cx, 8 out_string: push cx mov ax, 0300h xor bx, bx int 10h pop cx mov ax, 1301h mov bx, 07h int 10h
ExitProgram ret error_exit: mov bp, offset ERROR mov cx, 6 jmp out_string
OK db "SUCCESS!",'$' ERROR db "ERROR!",'$' start endp
;;read data from I/O port inport proc near ;;input:
JY-1714CLDNA - 17 -
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; none ;;output: ; al: port data ;;destroy: AX SelectLDN 08h ReadReg 0F1h push cx mov cl, 3 shr al, cl pop cx and al, 0fh ret inport endp
;;output data to I/O port outport proc near ;;input: ;; al: port data ;;output: ;; none ;;destroy: AX and al, 00Fh mov ah, al SelectLDN 07h ReadReg 0F4h and al, 0F0h or ah, al WriteReg 0F4h, ah ret outport endp END
- 18 -
JY-1714CLDNA
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接口
14 4
ATX接口
信号名称
信号名称
+3.3V 11 1
-12V 12 2
GND(地) 13 3 GND(地)
PS-ON(
制) GND(地) 15 5 GND(地) GND(地) 16 6
ATXPWR
GND(地) 17 7 GND(地)
-5V 18 8 Power Good +5V 19 9 +5V 20 10
ISA 总线
此主板提供标准16ISA线,方式
l 标准ISAISA1
+3.3V +3.3V
+5V
+5V
+5V SB(
+5V) +12V
l 一组ISA PC104ABPC104CD l 两个ISAISA2ISA3 l 便FPGAI/OISAISA4
JY-1714CLDNA - 19 -
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ISA1 脚定义
管脚
管脚
A1
A2
管脚
号名称
IOCHCK# B1
SD7 B2 A3 A4 A5 A6 A7 A8 A9
A10 IOCHRDY B10 A11 A12 A13 A14 A15 A16 A17 A18 A19 A20 A21 A22 A23 A24 A25 A26 A27 A28 A29 A30 A31
SD6 B3
SD5 B4
SD4 B5
SD3 B6
SD2 B7
SD1 B8
SD0 B9
AEN B11 SMEMW# C11
SA19 B12 SMEMR# C12 SA18 B13 SA17 B14 SA16 B15 DACK3# C15 SA15 B16 SA14 B17 DACK1# C17 SA13 B18 SA12 B19 REFRESH# SA11 B20 SA10 B21
SA9 B22
SA8 B23
SA7 B24
SA6 B25
SA5 B26 DACK2#
SA4 B27
SA3 B28
SA2 B29
SA1 B30
SA0 B31
管脚
号名称
GND C1
RSTDRV C2
VCC C3
IRQ9 C4
-5V C5
DRQ2 C6
-12V C7
NOWS# C8
+12V C9
GND C10 MEMW# D10 DACK5#
IOW# C13 IOR# C14
DRQ3 C16
DRQ1 C18
BCLK IRQ7 IRQ6 IRQ5 IRQ4 IRQ3
TC
BALE
VCC
ISA_SLOT_14M
GND
号名称
SBHE# D1 MEMCS16#
LA23 D2 IOCS16# LA22 D3 LA21 D4 LA20 D5 SA19 D6 SA18 D7 SA17 D8
MEMR# D9
SD8 D11
SD9 D12 DACK6# SD10 D13 SD11 D14 DACK7# SD12 D15 SD13 D16 SD14 D17 MASTER# SD15 D18
号名称
IRQ10 IRQ11 IRQ12 IRQ15 IRQ14
DACK0#
DRQ0
DRQ5
DRQ6
DRQ7
VCC
GND
- 20 -
JY-1714CLDNA
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PC104针孔PC104以方便某些ISA信号线。
管脚
号名称
管脚
号名称 A1 IOCHK# B1 GND A2 SD7 B2 RSTDRV A3 SD6 B3 VCC A4 SD5 B4 IRQ9 A5 SD4 B5 -5V A6 SD3 B6 DRQ2 A7 SD2 B7 -12V A8 SD1 B8 NOWS# A9 SD0 B9 +12V
A10 IOCHRDY B10 GND A11 AEV B11 SMEMW# A12 SA19 B12 SMEMR# A13 SA18 B13 IOW# A14 SA17 B14 IOR# A15 SA16 B15 DACK3# A16 SA15 B16 DRQ3 A17 SA14 B17 DACK1# A18 SA13 B18 DRQ1 A19 SA12 B19 REFRESH# A20 SA11 B20 BCLK
PC104AB
A21 SA10 B21 IRQ7 A22 SA9 B22 IRQ6 A23 SA8 B23 IRQ5 A24 SA7 B24 IRQ4 A25 SA6 B25 IRQ3 A26 SA5 B26 DACK2# A27 SA4 B27 TC A28 SA3 B28 BALE A29 SA2 B29 VCC A30 SA1 B30 PC104_OSC A31 SA0 B31 GND A32 GND B32 GND
JY-1714CLDNA - 21 -
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PC104CD 脚定义
管脚
管脚
1
管脚
D1 GND C1 GND D2 MEMCS16# C2 SBHE# D3 IOCS16# C3 LA23 D4 IRQ10 C4 LA22 D5 IRQ11 C5 LA21 D6 IRQ12 C6 LA20 D7 IRQ15 C7 SA19 D8 IRQ14 C8 SA18
D9 DACK0# C9 SA17 D10 DRQ0 C10 MEMR# D11 DACK5# C11 Memw# D12 DRQ5 C12 SD8 D13 DACK6# C13 SD9
PC104CD
D14 DRQ6 C14 SD10 D15 DACK7# C15 SD11 D16 DRQ7 C16 SD12 D17 VCC C17 SD13 D18 MASTER# C18 SD14 D19 GND C19 SD15 D20 GND C20 GND
ISA2 脚定义
5
9 13 17 21 25 29 33 37 41 45 49
号名称
VCC 2 SD7 3 SD6 4 SD5 SD4 6 SD3 7 SD2 8 SD1
SD0 10 IOW# 14 IRQ5 18
SA7 22
SA4 26
SA2 30
SA0 34 BCLK 38 BALE 42 SA15 46 SA10 50
管脚
管脚
号名称
号名称
VCC 11 AEN 15 DACK1# 16 VCC 19 SA6 23 GND 27 GND 31 GND 35
RSTDRV 39
TC 43 SA14 47 SA11
管脚
号名称
NC 12
SA9 20 SA5 24 SA3 28 SA1 32
MEMW# 36
SA19 40 SA16 44 SA13 48
号名称
号名称
IOR# DRQ1
SA8
+12V
-12V GND
MEMR#
SA18 SA17 SA12
- 22 -
JY-1714CLDNA
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管脚
管脚
1
ISA3 脚定义
管脚
5
9 13 17 21 25 29 33 37 41 45 49
号名称
VCC 2 SD7 3 SD6 4 SD5 SD4 6 SD3 7 SD2 8 SD1 SD0 10
IOW# 14
IRQ 18 SA7 22 SA4 26 SA2 30
SA0 34 BCLK 38 BALE 42 SA15 46 SA10 50
管脚
号名称
VCC 11 AEN 15 VCC 19 SA6 23 GND 27 GND 31 GND 35
RSTDRV 39
TC 43 SA14 47 SA11
号名称
NC 12
DACK# 16
SA9 20 SA5 24 SA3 28 SA1 32
MEMW# 36
SA19 40 SA16 44 SA13 48
号名称
MEMR#
FPGA的配、输/输出端ISA4脚定义
在板提供编程FPGA块,FPGA芯片:ALTERA 公司
IOR# DRQ1
SA8
+12V
-12V GND
SA18 SA17 SA12
Cyclone II EP2C5T144C8 FPGA的配置EEPROMASC列的
EPCS1 1Mb的Flash ,在使用Quartus II译或在线编程注意选择
配置件的型号EVOC将随主板提供部分芯片资料单的
ALTERA下载以及更详细资料和编程访问ALTERAALTERA联络。
http://www.altera.com.cn/literature/lit-cyc2.jsp
ISA4 EP2C5T144C8 的一组I/O引脚如果将 ISA4 用一对 的排线与 ISA3 相连 EP2C5T144C8 的I/O引脚ISA4 的信号定义 就可以定义成 ISA3 一致,方便使用ISA总线信号设计FPGA功能:
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ISA3
IRQx 1-
2
IRQ4
3-
4
IRQ7
5-6
(
) IRQ10
JP2:设置 ISA3/ISA4 17 使用系统中断
JP2
ISA4 脚定义:
将 ISA4 线与 ISA3 连)
1 2 SD7_FPGA 3 SD6_FPGA 5 SD4_FPGA 7 SD2_FPGA
9 SD0_FPGA 11 13 IOW#_FPGA 15 DACK1#_FPGA 97 16 DRQ1_FPGA 17 IRQ_FPGA 19 SA9_FPGA 21 SA7_FPGA 23 SA5_FPGA 25 SA4_FPGA 27 SA3_FPGA
29 SA2_FPGA 31 SA1_FPGA
33 SA0 FPGA 35 MEMW#_FPGA 122 36 MEMR#_FPGA 37 BCLK_FPGA 39 SA19_FPGA 41 BALE_FPGA 43 SA16_FPGA 45 SA15_FPGA 47 SA13_FPGA 49 SA10_FPGA
12 IOR#_FPGA
74 4 SD5_FPGA 76 6 SD3_FPGA 86 8 SD1_FPGA 92 10
94 14 AEN_FPGA
100 18 101 20 SA8_FPGA 104 22 SA6_FPGA 113 24 114 26 115 28
118 30 119 32
120 34
17 38 RSTDRV_FPGA 132 40 SA18_FPGA 126 42 TC_FPGA 129 135 44 SA17_FPGA 136 46 SA14_FPGA 139 48 SA12_FPGA 143 50 SA11_FPGA
73 75 79 87
93 96 99
103 112
121 125 133
134 137 141 142
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ISA4 FPGA I/O 关系如
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FPGA /输出端
FPGA I/O 管脚与用户CN6 使用三个Ti
SN74LVC4245AFPGA3.3V5V8I/O使用I/O
制方向,FPGAI/OCN6关系以及/方向制的关系如
CN6
11 USER IO 10
13 USER IO 12
15 USER IO 14
17 USER IO 16
信号名称 FPGA引脚
USER IO 07
1 USER IO 0 8 2 USER IO 1
3 USER IO 2 24 4 USER IO 3
5 USER IO 4 28 6 USER IO 5
7 USER IO 6 31 8 USER IO 7
9 USER IO 8 41 10 USER IO 9
USER IO 815
方向
USER IO 815
方向
7
40
43 12 USER IO 11
45 14 USER IO 13
48 16 USER IO 15
52
53 18 USER IO 17
信号名称
FPGA引脚
9
25
30
32
42
44
47
51
55
19 USER IO 18
21 USER IO 20
23 USER IO 22
25 VCC 26 GND
57 20 USER IO 19
59 22 USER IO 21
63 24 USER IO 23
58
60
64
FPGA与用户CN6 关系以及入/方向
的的关系如
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FPGA
管脚 号名称 管脚 号名称 1 DCLK 6 nCE 2 GND 7 DATA0
CN7
图示见下图示
FPGA JTAG
JTAG
图示见下图示
3 CONF_DONE 8 nCSO 4 VCC3 9 ASDO 5 nCONFIG 10 GND
管脚 号名称
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管 脚 信号名称
管 脚
号名称
CF
COMPACT FLASH是一储器积很小,使用便随所用的128M256M等CF卡插时只能以一方向图示CFCARD
1 GND 26 NC 2 IDESD3 27 IDESD11 3 IDESD4 28 IDESD12 4 IDESD5 29 IDESD13 5 IDESD6 30 IDESD14 6 IDESD7 31 IDESD15 7 IDESCS0X 32 IDESCS1X 8 GND 33 NC
9 GND 34 IDESIORX 10 GND 35 IDESIOWX 11 GND 36 VCC3V 12 GND 37 IDESINTR 13 VCC3V 38 VCC3V 14 GND 39 GND 15 GND 40 NC 16 GND 41 IDESRSTX 17 GND 42 IDESIORDY 18 IDESA2 43 NC 19 IDESA1 44 VCC3V 20 IDESA0 45 HDDLED 21 IDESD0 46 NC 22 IDESD1 47 IDESD8 23 IDESD2 48 IDESD9 24 IOCS16X 49 IDESD10 25 NC 50 GND
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风扇接口
CPU提供一组标准CPUFAN风扇插座。 使用风扇插座时要注意以点:
Ø 风扇3504.212 Ø 风扇接线插座的接线是否相符线
中间置。线通常黑色和风扇脉冲
线其它颜色。有风扇有转检测,线高达 12V
损坏 CPU 标准接线。建使用测风
Ø 将风扇整成能将热量方向
信号名称
1
CPUFAN
2 +12V 3 脉冲
软驱接口
FDC2.02×17针的座,使用随主板配置的
转接接软盘驱动器使用。
JY-1714CLDNA - 31 -
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信号名称 信号名称
Ground 1 2 RM/LC Ground 3 4 Ground 5 6 Ground 7 8 Index Ground 9 10 Motor enable 0 Ground 11 12 Drive select 1 Ground 13 14 Drive select 0 Ground 15 16 Motor enable 1 Ground 17 18 Direction
FDC
Ground 19 20 Step Ground 21 22 Write data Ground 23 24 Write gate Ground 25 26 Track 00 Ground 27 28 Write protect Ground 29 30 Read data Ground 31 32 Side 1 select Ground 33 34
Diskette
PCIMG 接口
PCI可以支持插一PCI可以通过扩展转接PICMG
线支持最多三个PCI扩展
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JY-1714CLDNA
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BIOS 简介
BIOS 功能简介
JY-1714CLDNA主板BIOS关功能简介照我公司的AMI BIOS
南》
JY-1714CLDNA - 33 -
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附录
Watchdog 编程指引
JY-1714CLDNA提供的,255
编程看门狗定时器(WDT)过编程WDT超时事
系统个可
C语言WDT编程注意在对WDT进行
前,需先入WDT编程模式;结束对WDT操作后,退WDT 对WDT的编程遵循步骤
Ø WDT编程模 Ø WDT方式/WDT/关闭WDT Ø 退WDT编程模
WDT编程,请
#define INDEXP 0x2e #define DATAP 0x2f //Super I/O Watchdog #define STARTPROG { outportb(INDEXP,0x87); outportb(INDEXP,0x87);} #define ENDPROG outportb(INDEXP,0xaa); #define SELEDEV(x) { outportb(INDEXP,7); outportb(DATAP,x); } #define WRITEREG(reg,val) { outportb(INDEXP,reg); outportb(DATAP,val); } //1.Initial Watchdog device short SIOWTD_Setup(short irq)
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JY-1714CLDNA
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/* irq=3,4,5,6,7,9,12,0:disable interrupt,0xff:reset*/ { //start programming Watchdog STARTPROG //Active Watchdog Device SELEDEV(8) //logical device 8 WRITEREG(0x30,0x01) //read IC is 627HF or 627THF outportb(INDEXP, 0x20); unsigned char thfver = inportb(DATAP); //{0x52=HF,0x82=THF} outportb(INDEXP,0x2b); unsigned char oldval=inportb(DATAP); if(irq==0xff) //WatchDog cause System Reset { if(thfver == 0x82) { //is 627THF oldval &= 0xf3; oldval |= 0x04; //bit3,2=01 } else { oldval &= 0xef; //BIT4=0 }
JY-1714CLDNA - 35 -
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WRITEREG(0x2b, oldval); } else //Watchdog cause System Interrupt { if(thfver == 0x82) { //is 627THF oldval &= 0xf3; //bit3,2=00 } else { oldval |= 0x10; //BIT4=1 } WRITEREG(0x2B,oldval) WRITEREG(0xf7,irq) } //end programming watchdog ENDPROG return 0; } //2.start Watchdog to count short SIOWTD_Enable(short time,short unit) /*unit=0:second,=1:minutes */ { if(time<1 || time>255) return -1;
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if(unit<0 || unit>1) return -1; //start programming watchdog STARTPROG SELEDEV(8) //logical device 8 //select Watchdog Timer clock switch(unit) { case 0: WRITEREG(0xf5,0x00) //BIT3=0,secondes break; case 1: WRITEREG(0xf5,0x08) //BIT3=1,minutes break; } WRITEREG(0xF6,time) //set timeout value //end programming watchdog ENDPROG return 0; }
JY-1714CLDNA - 37 -
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附录
I/O 地址映射表
系统I/O64K每一I/O表给CPU部分设I/O 地址分配,PCI (如PCI网软件配置的,表有列
地址 备描述
000h - 00Fh DMA #1
020h - 021h 编程#1
040h - 043h 系统时器
060h - 064h 标准 101/102 Microsoft
070h - 071h 系统 CMOS/时钟
0A0h - 0A1h 编程#2
0C0h - 0DEh DMA #2
0F0h - 0FFh 处理器
170h - 177h IDE
1F0h - 1F7h IDE
295h - 296h 硬件监测
2F8h - 2FFh 端口#2(COM2)
376h IDE(dual FIFO)
378h - 37Fh 端口#1(LPT1)
3B0h - 3DFh
3F6h - 3F6h
3F6h - 3F6h IDE(dual FIFO)
3F8h - 3FFh 端口#1(COM1)
Intel(R) 82852/82855 GM/GME Graphics Controller
Intel(R) 82801DB Ultra ATA Storage Controller–24CB
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附录
IRQ 中断分配表
系统15个中,有已被系统设备独占有未独占
其他使用。ISA独占使用
ISA备才BIOS操作系统分多个PCI备可 享同,并BIOS操作系统分配。CPU部分设
配情况,但没PCI用的
级别 功能
IRQ0 系统时器 IRQ1 标准 101/102Microsoft IRQ2 编程 IRQ3 串口#2 IRQ4 串口#1 IRQ5 Intel(R) 82801DB/DBM USB Universal Host Controller -24C4 IRQ5 ACPI IRQ Holder for PCI IRQ Steering IRQ6 保留 IRQ7 #1 IRQ8 系统 CMOS/时时钟 IRQ9 SCI IRQ used by ACPI bus
IRQ10 Intel(R) 82801DB/DBM USB Universal Host Controller-24C2
IRQ10 Intel(R) 82852/82855 GM/GME Graphics Controller IRQ10 ACPI IRQ Holder for PCI IRQ Steering IRQ11 IRQ12 IRQ13 IRQ14 IRQ15
Realtek AC'97 Audio PS/2 端口 处理器 Intel(R) 82801DB Ultra ATA Storage Controller-24CB Intel(R) 82801DB Ultra ATA Storage Controller-24CB
需了解更公司产品信息,请 http://www.evoc.com.cn
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