GIGABYTE GA-M68SM-S2 Schematics
GA-M68SM-S2
SHEET
01
02
03
04
05
06
07
08
09
10
11
12
13
14
15
TITLE
COVER SHEET
BOM & PCB MODIFY HISTORY
BLOCK DIAGRAM
PROCESSOR HT INTERFACE
PROCESSOR DDR2 INTERFACE
PROCESSOR CONTROL & DEBUG
PROCESSOR Power & Gnd
DIMM 1,2
DIMM 3,4
DIMM TERMINATION
MCP61-CPU
MCP61-PCIe
MCP61-DAC, RGMII
MCP61-PCI
MCP61-SATA, IDE
SHEET
26
27
28
29
30
31
32
TITLE
AUDIO JACK, L_OUT, F_AUDIO
POWER SEQUENCEFRONT PANEL
ATX POWER CONN
PWM ISL6312
VCC12_DUAL,VCC12_HT,VDDA25 POWER
DDRII POWER
TI TSB43AB23 1394
Revision:1.0
16
17
18
19
20
21
22
23
24
25
MCP61-USB, HD-Audio, GPIO
MCP61-Power, Gnd
PCI EXPRESS x16, x1 SLOT
PCI 1,2,SLOT
ITE 8716GB/CX, SPI BIOS.
Realtek 8211BL GIGA LAN
H/W MONITOR & FAN CONTROL
IDE/FDD/COM/LPT
F_USB/ R_USB
ALC888 HD-AUDIO
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
GIGABYTE
BLOCK DIAGRAM
BLOCK DIAGRAM
BLOCK DIAGRAM
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
of
of
of
132Wednesday, July 18, 2007
132Wednesday, July 18, 2007
132Wednesday, July 18, 2007
1.0
1.0
1.0
5
Model Name:GA-M68SM-S2
Revision:1.0
Component value change history
Date
2007.01.30 0.1 E_BOM release PCB:0.1
D D
2007.03.27 0.2 E_BOM release PCB:0.2 Change spec. add LPT port, and remove AM2+ dual plan support.
2007.04.16 0.3 D_BOM release PCB:0.3
Change Item
New BOM release
Change KB/MS source. Change F_USB fuse. Change CD1 .
4
P-Code: A95096-0
Reason
A1 Bug: need to push Power Buttom for 10 secnods to boot up
USB BIAS CHANGE TO 1.1K (R99)
3
2
Circuit or PCB layout change for next version
2007.01.29 0.1 Gerber Out
2007.03.26
2007.04.13 0.3 Gerber Out
2007.06.21 1.0 Gerber Out
0.2 Gerber Out PWM support AM2+. ISL 6323
CPU: VDD=VCORE, CPU_VDDNB=VCORE_NB, VTT=DDRVTT VSS=GND
PWM change back to ISL6312, add LPT port
Adjust PSU Power issue
1
ReasonChange ItemDate
ADD HDCP EEPROM circuit
2007.06.22
2007.07.11 1.0B P_BOM release PCB:1.0 DC5 --> 220P & DR12 --> 5.1K for Choke noies
C C
2007.07.11 1.0C P_BOM release PCB:1.0 ADD R & C & DVI CONN Second source Change 1394+usb CONN 30u ---> goldflash
B B
1.0A D_BOM release PCB:1.0
HDMI ROM CLK/DATA change for Nvidia comments.
Change DVI footprint Change 1394 to grey. 1394 EEPROM free
Add HDCP ROM (I2C and CHIP)
ADD R437 300 ohm (add 5Vsb Loading for PSU issue )
C1065 add 1M res to GND [NV AP NOTE Request ]
LC4,LC5,LC6 -->10P & PCN1,PCN2,PCN3,PCN4 ADD 180P EMI Request
Remove PCB (祥豐) ADD Packing BOM
Fix LED don't light without CPU
74HCT32 back
A A
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
5
4
3
2
Date: Sheet
GIGABYTE
BOM & PCB MODIFY HISTORY
BOM & PCB MODIFY HISTORY
BOM & PCB MODIFY HISTORY
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
1
1.0
1.0
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of
of
of
232Wednesday, July 18, 2007
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BLOCK DIAGRAM
FLOPPY CONN
PS2/KB CONN
SERIAL CONN
POWER
SUPPLY
CONNECTOR
VREG
AMD CPU
SOCKET AM2
HT 16X16 1GHZ
PEX X16 PCI EXPRESS X8 GRAPHICS
PEX X1 VGA
PCI EXPRESS X1 CONNECTOR
NVIDIA
MCP68S
IDE
X4 - SATA CONN
SIO
ITE
8716 CX
4MB LPC FLASH
ATA 133
SATA II
LPC BUS 33MHZ
RGMII
RTL8211BL
GBIT PHY
PCI 33MHZ
AZILIA
USB2.0 X10 PORT
128-BIT 200/266/333/400MHZ
DVI
RTL ALC888 CODEC
BACK PANEL
USB2.0 PORTS 0-1
USB2.0 PORTS 2-3
1394A
GBIT LAN
DDRII 400/533/667/800
DDRII SDRAM CONN 1
DDRII SDRAM CONN 2
DDRII SDRAM CONN 3
DDRII SDRAM CONN 4
PCI SLOT 1
PCI SLOT 2
1L
1H
2L
2H
RJ45
BACK PANEL
FRONT PANEL
USB2.0 PORTS 4-5
USB2.0 PORTS 6-7
USB2.0 PORTS 8-9
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
GIGABYTE
BLOCK DIAGRAM
BLOCK DIAGRAM
BLOCK DIAGRAM
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
of
of
of
332Wednesday, July 18, 2007
332Wednesday, July 18, 2007
332Wednesday, July 18, 2007
1.0
1.0
1.0
L0_CADIN_L[0..15]
L0_CADIN_H[0..15]
L0_CLKIN_L[0..1]
L0_CLKIN_H[0..1]
L0_CADOUT_L[0..15]
L0_CADOUT_H[0..15]
L0_CLKOUT_L[0..1]
L0_CLKOUT_H[0..1]
L0_CADIN_L[0..15] <11>
L0_CADIN_H[0..15] <11>
L0_CLKIN_L[0..1] <11>
L0_CLKIN_H[0..1] <11>
L0_CADOUT_L[0..15] <11>
L0_CADOUT_H[0..15] <11>
L0_CLKOUT_L[0..1] <11>
L0_CLKOUT_H[0..1] <11>
VCC12_HT
L0_CTLIN_H1<11>
L0_CTLIN_L1<11>
GND
CPU_VDD_RUN = VCORE
CPU_VDDA_RUN = VDDA25
VLDT_RUN = VCC12_HT
CPU_VDDIO_SUS = DDR18V
CPU_VTT_SUS = DDRVTT
VLDT_A = VCC12_HT
M2CPUA
M2CPUA
HYPERTRANSPORT
L0_CLKIN_H1
49.9/4/1R3 49.9/4/1R3
49.9/4/1R4 49.9/4/1R4
L0_CTLIN_H0<11>
L0_CTLIN_L0<11>
L0_CLKIN_L1
L0_CLKIN_H0
L0_CLKIN_L0
L0_CTLIN_H1
L0_CTLIN_H0
L0_CTLIN_L0
L0_CADIN_H15
L0_CADIN_L15
L0_CADIN_H14
L0_CADIN_L14
L0_CADIN_H13
L0_CADIN_L13
L0_CADIN_H12
L0_CADIN_L12
L0_CADIN_H11
L0_CADIN_L11
L0_CADIN_H10
L0_CADIN_L10
L0_CADIN_H9
L0_CADIN_L9
L0_CADIN_H8
L0_CADIN_L8
L0_CADIN_H7
L0_CADIN_L7
L0_CADIN_H6
L0_CADIN_L6
L0_CADIN_H5
L0_CADIN_L5
L0_CADIN_H4
L0_CADIN_L4
L0_CADIN_H3
L0_CADIN_L3
L0_CADIN_H2
L0_CADIN_L2
L0_CADIN_H1
L0_CADIN_L1
L0_CADIN_H0
L0_CADIN_L0
N6
P6
N3
N2
V4
V5
U1
V1
U6
V6
T4
T5
R6
T6
P4
P5
M4
M5
L6
M6
K4
K5
J6
K6
U3
U2
R1
T1
R3
R2
N1
P1
L1
M1
L3
L2
J1
K1
J3
J2
L0_CLKIN_H(1)
L0_CLKIN_L(1)
L0_CLKIN_H(0)
L0_CLKIN_L(0)
L0_CTLIN_H(1)
L0_CTLIN_L(1)
L0_CTLIN_H(0)
L0_CTLIN_L(0)
L0_CADIN_H(15)
L0_CADIN_L(15)
L0_CADIN_H(14)
L0_CADIN_L(14)
L0_CADIN_H(13)
L0_CADIN_L(13)
L0_CADIN_H(12)
L0_CADIN_L(12)
L0_CADIN_H(11)
L0_CADIN_L(11)
L0_CADIN_H(10)
L0_CADIN_L(10)
L0_CADIN_H(9)
L0_CADIN_L(9)
L0_CADIN_H(8)
L0_CADIN_L(8)
L0_CADIN_H(7)
L0_CADIN_L(7)
L0_CADIN_H(6)
L0_CADIN_L(6)
L0_CADIN_H(5)
L0_CADIN_L(5)
L0_CADIN_H(4)
L0_CADIN_L(4)
L0_CADIN_H(3)
L0_CADIN_L(3)
L0_CADIN_H(2)
L0_CADIN_L(2)
L0_CADIN_H(1)
L0_CADIN_L(1)
L0_CADIN_H(0)
L0_CADIN_L(0)
HYPERTRANSPORT
L0_CLKOUT_H(1)
L0_CLKOUT_L(1)
L0_CLKOUT_H(0)
L0_CLKOUT_L(0)
L0_CTLOUT_H(1)
L0_CTLOUT_L(1)
L0_CTLOUT_H(0)
L0_CTLOUT_L(0)
L0_CADOUT_H(15)
L0_CADOUT_L(15)
L0_CADOUT_H(14)
L0_CADOUT_L(14)
L0_CADOUT_H(13)
L0_CADOUT_L(13)
L0_CADOUT_H(12)
L0_CADOUT_L(12)
L0_CADOUT_H(11)
L0_CADOUT_L(11)
L0_CADOUT_H(10)
L0_CADOUT_L(10)
L0_CADOUT_H(9)
L0_CADOUT_L(9)
L0_CADOUT_H(8)
L0_CADOUT_L(8)
L0_CADOUT_H(7)
L0_CADOUT_L(7)
L0_CADOUT_H(6)
L0_CADOUT_L(6)
L0_CADOUT_H(5)
L0_CADOUT_L(5)
L0_CADOUT_H(4)
L0_CADOUT_L(4)
L0_CADOUT_H(3)
L0_CADOUT_L(3)
L0_CADOUT_H(2)
L0_CADOUT_L(2)
L0_CADOUT_H(1)
L0_CADOUT_L(1)
L0_CADOUT_H(0)
L0_CADOUT_L(0)
AD5
AD4
AD1
AC1
Y6
W6
W2
W3
Y5
Y4
AB6
AA6
AB5
AB4
AD6
AC6
AF6
AE6
AF5
AF4
AH6
AG6
AH5
AH4
Y1
W1
AA2
AA3
AB1
AA1
AC2
AC3
AE2
AE3
AF1
AE1
AG2
AG3
AH1
AG1
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CTLOUT_H1
L0_CTLOUT_L1L0_CTLIN_L1
L0_CTLOUT_H0
L0_CTLOUT_L0
L0_CADOUT_H15
L0_CADOUT_L15
L0_CADOUT_H14
L0_CADOUT_L14
L0_CADOUT_H13
L0_CADOUT_L13
L0_CADOUT_H12
L0_CADOUT_L12
L0_CADOUT_H11
L0_CADOUT_L11
L0_CADOUT_H10
L0_CADOUT_L10
L0_CADOUT_H9
L0_CADOUT_L9
L0_CADOUT_H8
L0_CADOUT_L8
L0_CADOUT_H7
L0_CADOUT_L7
L0_CADOUT_H6
L0_CADOUT_L6
L0_CADOUT_H5
L0_CADOUT_L5
L0_CADOUT_H4
L0_CADOUT_L4
L0_CADOUT_H3
L0_CADOUT_L3
L0_CADOUT_H2
L0_CADOUT_L2
L0_CADOUT_H1
L0_CADOUT_L1
L0_CADOUT_H0
L0_CADOUT_L0
L0_CTLOUT_H1 <11>
L0_CTLOUT_L1 <11>
L0_CTLOUT_H0 <11>
L0_CTLOUT_L0 <11>
VLDT_B = HT12B
SOCKET_M2
SOCKET_M2
M2/[12KRC-04K807-22R_12KRC-04K807-23R]
M2/[12KRC-04K807-22R_12KRC-04K807-23R]
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
GIGABYTE
CPU HYPER TRANSPORT
CPU HYPER TRANSPORT
CPU HYPER TRANSPORT
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
432Wednesday, July 18, 2007
432Wednesday, July 18, 2007
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of
of
of
1.0
1.0
1.0
M2CPUB
M2CPUB
MEMORY INTERFACE A
DCLKA2
DCLKA2<8,10>
-DCLKA2<8,10>
DCLKA1<8,10>
-DCLKA1<8,10>
DCLKA0<8,10>
-DCLKA0<8,10>
-CSA1<8,10> -CSB1<8,10>
-CSA0<8,10>
MODT_A0<8,10>
DCLKA5<9,10>
-DCLKA5<9,10>
DCLKA4<9,10>
-DCLKA4<9,10>
DCLKA3<9,10>
-DCLKA3<9,10>
-CSA3<9,10>
-CSA2<9,10>
MODT_A1<9,10>
-SCASA<8,9,10>
-SWEA<8,9,10>
-SRASA<8,9,10>
SBAA2<8,9,10>
SBAA1<8,9,10>
SBAA0<8,9,10>
CKEA1<9,10> CKEB1<9,10>
MAAA15
MAAA[0..15]<8,9,10> MAAB[0..15]<8,9,10>
-DQSA[0..7] -DQSB[0..7]
DQSA[0..7]
DMA[0:7] DMB[0..7]
-DQSA[0..7] <8,9>
DQSA[0..7] <8,9>
DMA[0..7] <8,9> DMB[0..7] <8,9>
MAAA14
MAAA13
MAAA12
MAAA11
MAAA10
MAAA9
MAAA8
MAAA7
MAAA6
MAAA5
MAAA4
MAAA3
MAAA2
MAAA1
MAAA0
AG21
-DCLKA2
AG20
DCLKA1
G19
-DCLKA1
H19
DCLKA0
U27
-DCLKA0
U26
AC25
AA24
MODT_A0
AC28
DCLKA5
AE20
-DCLKA5
AE19
DCLKA4
G20
-DCLKA4
G21
DCLKA3
V27
-DCLKA3
W27
AD27
AA25
MODT_A1 MODT_B1
AC27
-SCASA
AB25
-SWEA
AB27
-SRASA
AA26
SBAA2
N25
SBAA1
Y27
SBAA0
AA27
CKEA1 CKEB1
L27
CKEA0
M25
M27
N24
AC26
N26
P25
Y25
N27
R24
P27
R25
R26
R27
T25
U25
T27
W24
DQSA7
AD15
-DQSA7
AE15
DQSA6
AG18
-DQSA6
AG19
DQSA5
AG24
-DQSA5
AG25
DQSA4
AG27
-DQSA4
AG28
DQSA3
D29
-DQSA3
C29
DQSA2
C25
-DQSA2
D25
DQSA1
E19
-DQSA1
F19
DQSA0
F15
-DQSA0
G15
DMA7
AF15
DMA6
AF19
DMA5
AJ25
DMA4
AH29
DMA3
B29
DMA2
E24
DMA1
E18
DMA0
H15
MEMORY INTERFACE A
MA0_CLK_H(2)
MA0_CLK_L(2)
MA0_CLK_H(1)
MA0_CLK_L(1)
MA0_CLK_H(0)
MA0_CLK_L(0)
MA0_CS_L(1)
MA0_CS_L(0)
MA0_ODT(0)
MA1_CLK_H(2)
MA1_CLK_L(2)
MA1_CLK_H(1)
MA1_CLK_L(1)
MA1_CLK_H(0)
MA1_CLK_L(0)
MA1_CS_L(1)
MA1_CS_L(0)
MA1_ODT(0)
MA_CAS_L
MA_WE_L
MA_RAS_L
MA_BANK(2)
MA_BANK(1)
MA_BANK(0)
MA_CKE(1)
MA_CKE(0)
MA_ADD(15)
MA_ADD(14)
MA_ADD(13)
MA_ADD(12)
MA_ADD(11)
MA_ADD(10)
MA_ADD(9)
MA_ADD(8)
MA_ADD(7)
MA_ADD(6)
MA_ADD(5)
MA_ADD(4)
MA_ADD(3)
MA_ADD(2)
MA_ADD(1)
MA_ADD(0)
MA_DQS_H(7)
MA_DQS_L(7)
MA_DQS_H(6)
MA_DQS_L(6)
MA_DQS_H(5)
MA_DQS_L(5)
MA_DQS_H(4)
MA_DQS_L(4)
MA_DQS_H(3)
MA_DQS_L(3)
MA_DQS_H(2)
MA_DQS_L(2)
MA_DQS_H(1)
MA_DQS_L(1)
MA_DQS_H(0)
MA_DQS_L(0)
MA_DM(7)
MA_DM(6)
MA_DM(5)
MA_DM(4)
MA_DM(3)
MA_DM(2)
MA_DM(1)
MA_DM(0)
MA_DATA(63)
MA_DATA(62)
MA_DATA(61)
MA_DATA(60)
MA_DATA(59)
MA_DATA(58)
MA_DATA(57)
MA_DATA(56)
MA_DATA(55)
MA_DATA(54)
MA_DATA(53)
MA_DATA(52)
MA_DATA(51)
MA_DATA(50)
MA_DATA(49)
MA_DATA(48)
MA_DATA(47)
MA_DATA(46)
MA_DATA(45)
MA_DATA(44)
MA_DATA(43)
MA_DATA(42)
MA_DATA(41)
MA_DATA(40)
MA_DATA(39)
MA_DATA(38)
MA_DATA(37)
MA_DATA(36)
MA_DATA(35)
MA_DATA(34)
MA_DATA(33)
MA_DATA(32)
MA_DATA(31)
MA_DATA(30)
MA_DATA(29)
MA_DATA(28)
MA_DATA(27)
MA_DATA(26)
MA_DATA(25)
MA_DATA(24)
MA_DATA(23)
MA_DATA(22)
MA_DATA(21)
MA_DATA(20)
MA_DATA(19)
MA_DATA(18)
MA_DATA(17)
MA_DATA(16)
MA_DATA(15)
MA_DATA(14)
MA_DATA(13)
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MA_DATA(7)
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MA_DATA(5)
MA_DATA(4)
MA_DATA(3)
MA_DATA(2)
MA_DATA(1)
MA_DATA(0)
MA_DQS_H(8)
MA_DQS_L(8)
MA_DM(8)
MA_CHECK(7)
MA_CHECK(6)
MA_CHECK(5)
MA_CHECK(4)
MA_CHECK(3)
MA_CHECK(2)
MA_CHECK(1)
MA_CHECK(0)
AE14
AG14
AG16
AD17
AD13
AE13
AG15
AE16
AG17
AE18
AD21
AG22
AE17
AF17
AF21
AE21
AF23
AE23
AJ26
AG26
AE22
AG23
AH25
AF25
AJ28
AJ29
AF29
AE26
AJ27
AH27
AG29
AF27
E29
E28
D27
C27
G26
F27
C28
E27
F25
E25
E23
D23
E26
C26
G23
F23
E22
E21
F17
G17
G22
F21
G18
E17
G16
E15
G13
H13
H17
E16
E14
G14
J28
J27
J25
K25
J26
G28
G27
L24
K27
H29
H27
MDA63
MDA62
MDA61
MDA60
MDA59
MDA58
MDA57
MDA56
MDA55
MDA54
MDA53
MDA52
MDA51
MDA50
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MDA48
MDA47
MDA46
MDA45
MDA44
MDA43
MDA42
MDA41
MDA40
MDA39
MDA38
MDA37
MDA36
MDA35
MDA34
MDA33
MDA32
MDA31
MDA30
MDA29
MDA28
MDA27
MDA26
MDA25
MDA24
MDA23
MDA22
MDA21
MDA20
MDA19
MDA18
MDA17
MDA16
MDA15
MDA14
MDA13
MDA12
MDA11
MDA10
MDA9
MDA8
MDA7
MDA6
MDA5
MDA4
MDA3
MDA2
MDA1
MDA0
MDA[0..63] <8,9> MDB[0..63] <8,9>
DQSB[0..7]
DCLKB2<8,10>
-DCLKB2<8,10>
DCLKB1<8,10>
-DCLKB1<8,10>
DCLKB0<8,10>
-DCLKB0<8,10>
MODT_B0<8,10>
DCLKB5<9,10>
-DCLKB5<9,10>
DCLKB4<9,10>
-DCLKB4<9,10>
DCLKB3<9,10>
-DCLKB3<9,10>
MODT_B1<9,10>
-SCASB<8,9,10>
-SRASB<8,9,10>
-DQSB[0..7] <8,9>
DQSB[0..7] <8,9>
M2CPUC
M2CPUC
MEMORY INTERFACE B
DCLKB2
AJ19
-DCLKB2
AK19
DCLKB1
A18
-DCLKB1
A19
DCLKB0
U31
-DCLKB0
U30
AE30
MODT_BA0
DCLKB5
-DCLKB5
DCLKB4
-DCLKB4
DCLKB3
-DCLKB3
-SCASB
-SWEB
-SRASB
SBAB2
SBAB1
SBAB0
CKEB0
DQSB7
-DQSB7
DQSB6
-DQSB6
DQSB5
-DQSB5
DQSB4
-DQSB4
DQSB3
-DQSB3
DQSB2
-DQSB2
DQSB1
-DQSB1
DQSB0
-DQSB0
DMB7
DMB6
DMB5
DMB4
DMB3
DMB2
DMB1
DMB0
AC31
AD29
AL19
AL18
W29
W28
AE29
AB31
AD31
AC29
AC30
AB29
AA31
AA28
M31
M29
AE31
AA29
AA30
AK13
AJ13
AK17
AJ17
AK23
AL23
AL28
AL29
AJ14
AH17
AJ23
AK29
C19
D19
N31
N28
N29
N30
P29
P31
R29
R28
R31
R30
T31
T29
U29
U28
D31
C31
C24
C23
D17
C17
C14
C13
C30
A23
B17
B13
-CSB0<8,10>
-CSB3<9,10>
-CSB2<9,10>
-SWEB<8,9,10>
SBAB2<8,9,10>
SBAB1<8,9,10>
SBAB0<8,9,10>
CKEB0<8,10>CKEA0<8,10>
MAAB15
MAAB14
MAAB13
MAAB12
MAAB11
MAAB10
MAAB9
MAAB8
MAAB7
MAAB6
MAAB5
MAAB4
MAAB3
MAAB2
MAAB1
MAAB0
MEMORY INTERFACE B
MB0_CLK_H(2)
MB0_CLK_L(2)
MB0_CLK_H(1)
MB0_CLK_L(1)
MB0_CLK_H(0)
MB0_CLK_L(0)
MB0_CS_L(1)
MB0_CS_L(0)
MB0_ODT(0)
MB1_CLK_H(2)
MB1_CLK_L(2)
MB1_CLK_H(1)
MB1_CLK_L(1)
MB1_CLK_H(0)
MB1_CLK_L(0)
MB1_CS_L(1)
MB1_CS_L(0)
MB1_ODT(0)
MB_CAS_L
MB_WE_L
MB_RAS_L
MB_BANK(2)
MB_BANK(1)
MB_BANK(0)
MB_CKE(1)
MB_CKE(0)
MB_ADD(15)
MB_ADD(14)
MB_ADD(13)
MB_ADD(12)
MB_ADD(11)
MB_ADD(10)
MB_ADD(9)
MB_ADD(8)
MB_ADD(7)
MB_ADD(6)
MB_ADD(5)
MB_ADD(4)
MB_ADD(3)
MB_ADD(2)
MB_ADD(1)
MB_ADD(0)
MB_DQS_H(7)
MB_DQS_L(7)
MB_DQS_H(6)
MB_DQS_L(6)
MB_DQS_H(5)
MB_DQS_L(5)
MB_DQS_H(4)
MB_DQS_L(4)
MB_DQS_H(3)
MB_DQS_L(3)
MB_DQS_H(2)
MB_DQS_L(2)
MB_DQS_H(1)
MB_DQS_L(1)
MB_DQS_H(0)
MB_DQS_L(0)
MB_DM(7)
MB_DM(6)
MB_DM(5)
MB_DM(4)
MB_DM(3)
MB_DM(2)
MB_DM(1)
MB_DM(0)
MB_DATA(63)
MB_DATA(62)
MB_DATA(61)
MB_DATA(60)
MB_DATA(59)
MB_DATA(58)
MB_DATA(57)
MB_DATA(56)
MB_DATA(55)
MB_DATA(54)
MB_DATA(53)
MB_DATA(52)
MB_DATA(51)
MB_DATA(50)
MB_DATA(49)
MB_DATA(48)
MB_DATA(47)
MB_DATA(46)
MB_DATA(45)
MB_DATA(44)
MB_DATA(43)
MB_DATA(42)
MB_DATA(41)
MB_DATA(40)
MB_DATA(39)
MB_DATA(38)
MB_DATA(37)
MB_DATA(36)
MB_DATA(35)
MB_DATA(34)
MB_DATA(33)
MB_DATA(32)
MB_DATA(31)
MB_DATA(30)
MB_DATA(29)
MB_DATA(28)
MB_DATA(27)
MB_DATA(26)
MB_DATA(25)
MB_DATA(24)
MB_DATA(23)
MB_DATA(22)
MB_DATA(21)
MB_DATA(20)
MB_DATA(19)
MB_DATA(18)
MB_DATA(17)
MB_DATA(16)
MB_DATA(15)
MB_DATA(14)
MB_DATA(13)
MB_DATA(12)
MB_DATA(11)
MB_DATA(10)
MB_DATA(9)
MB_DATA(8)
MB_DATA(7)
MB_DATA(6)
MB_DATA(5)
MB_DATA(4)
MB_DATA(3)
MB_DATA(2)
MB_DATA(1)
MB_DATA(0)
MB_DQS_H(8)
MB_DQS_L(8)
MB_DM(8)
MB_CHECK(7)
MB_CHECK(6)
MB_CHECK(5)
MB_CHECK(4)
MB_CHECK(3)
MB_CHECK(2)
MB_CHECK(1)
MB_CHECK(0)
AH13
AL13
AL15
AJ15
AF13
AG13
AL14
AK15
AL16
AL17
AK21
AL21
AH15
AJ16
AH19
AL20
AJ22
AL22
AL24
AK25
AJ21
AH21
AH23
AJ24
AL27
AK27
AH31
AG30
AL25
AL26
AJ30
AJ31
E31
E30
B27
A27
F29
F31
A29
A28
A25
A24
C22
D21
A26
B25
B23
A22
B21
A20
C16
D15
C21
A21
A17
A16
B15
A14
E13
F13
C15
A15
A13
D13
J31
J30
J29
K29
K31
G30
G29
L29
L28
H31
G31
MDB63
MDB62
MDB61
MDB60
MDB59
MDB58
MDB57
MDB56
MDB55
MDB54
MDB53
MDB52
MDB51
MDB50
MDB49
MDB48
MDB47
MDB46
MDB45
MDB44
MDB43
MDB42
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MDB40
MDB39
MDB38
MDB37
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MDB34
MDB33
MDB32
MDB31
MDB30
MDB29
MDB28
MDB27
MDB26
MDB25
MDB24
MDB23
MDB22
MDB21
MDB20
MDB19
MDB18
MDB17
MDB16
MDB15
MDB14
MDB13
MDB12
MDB11
MDB10
MDB9
MDB8
MDB7
MDB6
MDB5
MDB4
MDB3
MDB2
MDB1
MDB0
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
GIGABYTE
CPU DDRII MEMORY
CPU DDRII MEMORY
CPU DDRII MEMORY
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
of
of
of
532Wednesday, July 18, 2007
532Wednesday, July 18, 2007
532Wednesday, July 18, 2007
1.0
1.0
1.0
-HTSTOP_L
-CPURST
CPU_PWRGD
CPUVREF
40 MILS WIDTH
CPU_M_VREF
SBC31
SBC31
SBC12
SBC12
1N/4/X7R/50V/K
1N/4/X7R/50V/K
COREFB-<29>
COREFB+<29>
COREFB-<29>
COREFB+<29>
COREFB-<29>
COREFB+<29>
12
R21 300/4R21 300/4
R22 300/4R22 300/4
R23 300/4R23 300/4
R33 300/4/XR33 300/4/X
SC35
SC35
1u/6/Y5V/10V/Z
1u/6/Y5V/10V/Z
DDR18V
C9
C9
10U/8/Y5V/10V/Z/X
10U/8/Y5V/10V/Z/X
C10
C10
0.1U/6/Y5V/25V/Z/X
0.1U/6/Y5V/25V/Z/X
BC8
BC8
0.1U/4/Y5V/16V/Z
0.1U/4/Y5V/16V/Z
DDR18V
SR19
SR19
16.9/4/1
16.9/4/1
SR20
SR20
16.9/4/1
16.9/4/1
VCC3
VDDA25
2.5V/0.25A
FB1 30/6/4A/SFB1 30/6/4A/S
C3
C3
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
CPUCLK0_H<11>
CPUCLK0_L<11>
CPUCLK0_H
CPUCLK0_L
C1
C1
3.9n/4/X7R/50V/K
3.9n/4/X7R/50V/K
C2
C2
3.9n/4/X7R/50V/K
3.9n/4/X7R/50V/K
R58 NO POP, R17 POP=>AMD Mar.26, 07'
GND
SI_CLK<16,20>
SI_DAT<16,20>
DDR18V
VCORE
C13
C13
3.3n/4/X7R/50V/K
3.3n/4/X7R/50V/K
R5
169/4/1R5169/4/1
CPU_PWRGD<11>
-HTSTOP_L<11>
R58 300/4/XR58 300/4/X
R8 22/4/XR8 22/4/X
R9 22/4/XR9 22/4/X
R17 390/4R17 390/4
R19 300/4/XR19 300/4/X
R1 0/6/XR1 0/6/X
COREFB+<29>
COREFB-<29>
CPU_M_VREF
DDR18V
GND
GND
SR8 1K/4SR8 1K/4
GNDA<20>
TMPIN3<20,22>
C4
C4
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
GND
CLKIN_H
CLKIN_L
-CPURST<11>
CPU_PRESENT_L
TP81TP81
TP83TP83
TP84TP84
TP85TP85
TP86TP86
39.2/6/1R11 39.2/6/1R11
39.2/6/1R12 39.2/6/1R12
CPU_TEST25_H
CPU_TEST25_L
300/4R13 300/4R13
300/4R14 300/4R14
TP89TP89
TP91TP91
TP93TP93
TP95TP95
R15 0/4/SHT/XR15 0/4/SHT/X
R16 0/4/SHT/XR16 0/4/SHT/X
CPU_PWRGD
-HTSTOP_L
-CPURST
SIC
SID
AK6
AL10
AJ10
AH10
AH11
AJ11
AH9
AG9
AG8
AH7
C10
D10
A8
B8
C9
D8
C7
AL3
AL6
AL9
A5
G2
G1
E12
F12
A10
B10
F10
E9
AJ7
F6
D6
E7
F8
C5
E5
AJ5
AJ6
MISC
MISC
VDDA1
VDDA2
CLKIN_H
CLKIN_L
PWROK
LDTSTOP_L
RESET_L
CPU_PRESENT_L
THERMTRIP_L
SIC
SID
TDI
TRST_L
TCK
TMS
DBREQ_L
VDD_FB_H
VDD_FB_L
VTT_SENSE
M_VREF
M_ZN
M_ZP
TEST25_H
TEST25_L
TEST19
TEST18
TEST13
TEST9
TEST17
TEST16
TEST15
TEST14
TEST12
TEST7
TEST6
THERMDC
THERMDA
TEST3
TEST2
M2CPUD
M2CPUD
VID(5)
VID(4)
VID(3)
VID(2)
VID(1)
VID(0)
PROCHOT_L
TDO
DBRDY
VDDIO_FB_H
VDDIO_FB_L
PSI_L
HTREF1
HTREF0
TEST29_H
TEST29_L
TEST24
TEST23
TEST22
TEST21
TEST20
TEST28_H
TEST28_L
TEST27
TEST26
TEST10
TEST8
DDR18V
R65
R74
R74
300/4
300/4
R65
300/4/X
300/4/X
THERMTRIP_L
VCC12_HT
44.2/6/1R53 44.2/6/1R53
44.2/6/1R54 44.2/6/1R54
GND
Route as 80-Ohm differential impedance
D2
D1
C1
E3
E2
E1
AK7
AL7
AK10
B6
AK11
AL11
F1
V8
V7
C11
D11
VID5
VID4
VID3
VID2
VID1
VID0
R68
R68
300/4
300/4
R73
R73
300/4
300/4
TP82TP82
TP87TP87
TP88TP88
R55 80.6/4/1R55 80.6/4/1
Keep trace to resistor less than 1" from CPU pin
AK8
AH8
AJ9
CPU_TEST21
AL8
AJ8
J10
H9
AK9
CPU_TEST26
AK5
G7
D4
LAYOUT: Route trace 50 mils wide and
SR7 1K/4SR7 1K/4
SR5 1K/4SR5 1K/4
SR6 1K/4SR6 1K/4
500 to 750 mils long between these caps.
R56
R56
300/4/X
300/4/X
R57
R57
300/4
300/4
DDR18V
R71
R71
300/4/X
300/4/X
VID5 <29>
VID4 <29>
VID3 <29>
VID2 <29>
VID1 <29>
VID0 <29>
THERMTRIP_L <11>
R60
R60
300/4
300/4
-PROCHOT
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
-PROCHOT <11>
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
CPU_TEST26
CPU_PRESENT_L
CPU_TEST25_H
CPU_TEST25_L
CPU_TEST21
R37 300/4R37 300/4
R49 1K/4R49 1K/4
R42 510/4R42 510/4
R43 510/4R43 510/4
R47 300/4R47 300/4
DDR18V
GND
0.1U/4/Y5V/16V/Z
0.1U/4/Y5V/16V/Z
5VSB
84
U66B
U66B
5
+
+
7
6
-
-
KA393D/SO8/X
KA393D/SO8/X
Plase at PH3 copper
GND
RS3 CLOSE CPU VR MOSFET
VCC
R257
R257
R258
R258
2.4K/4/1/X
2.4K/4/1/X
12K/4/1/X
12K/4/1/X
RS3
RS3
R256
R256
1K/4/1/X
1K/4/1/X
100K/1/6/S/X
100K/1/6/S/X
HR100K/[10RH2-001003-21]
R254 6.98K/4/1/XR254 6.98K/4/1/X
5VSB VCC
84
U66A
U66A
3
+
+
2
-
-
KA393D/SO8/X
KA393D/SO8/X
C223
C223
0.1U/6/Y5V/25V/Z/X
0.1U/6/Y5V/25V/Z/X
M2CPUE
M2CPUE
INTERNAL MISC
INTERNAL MISC
L25
RSVD1
W26
W25
AE27
U24
V24
AE28
Y31
Y30
AG31
V31
W31
AF31
L26
RSVD2
L31
RSVD3
L30
RSVD4
RSVD5
RSVD6
RSVD7
RSVD8
RSVD9
RSVD10
RSVD11
RSVD12
RSVD13
RSVD14
RSVD15
RSVD16
asserted at 131 degree
deasserted at 116 degree
-PROCHOT
R255
R255
680/4/X
680/4/X
1
Q300
Q300
2N7002/SOT23/X
2N7002/SOT23/X
SOT23
SOT23
132
RSVD17
RSVD18
RSVD19
RSVD20
RSVD21
RSVD22
RSVD23
RSVD24
RSVD25
RSVD26
RSVD27
RSVD28
RSVD29
RSVD30
RSVD31
RSVD32
RSVD33
RSVD34
RSVD35
RSVD36
RSVD37
RSVD38
E20
B19
AL4
AK4
AK3
F2
F3
G4
G3
CORE_TYPE_DET
G5
AM2: high, AM2R2: low
AD25
AE24
AE25
AJ18
AJ20
C18
C20
G24
G25
H25
V29
W30
TP98TP98
R66 300/4/XR66 300/4/X
DDR18V
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
GIGABYTE
CPU CONTROL
CPU CONTROL
CPU CONTROL
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
1.0
1.0
1.0
of
of
of
632Wednesday, July 18, 2007
632Wednesday, July 18, 2007
632Wednesday, July 18, 2007
VCORE_NB
VCORE
VCORE_NB
VCORE
VCORE_NB
VCORE
VCORE_NB
VCORE
VCORE_NB
VCORE
VCORE_NB
VCORE
VCORE_NB
VCORE
AA10
AA12
AA14
AA16
AA18
AB11
AC10
AE10
AA8
AB7
AB9
AC4
AC5
AC8
AD2
AD3
AD7
AD9
AF7
AF9
AG4
AG5
AG7
AH2
AH3
E10
G10
G12
H11
H23
K11
K13
K15
K17
K19
K21
K23
Y17
Y19
VLDT_RUN_B is connected to the VLDT_RUN power
supply through the package or on the die. It is only connected
M2CPUF
M2CPUF
VDD1
VDD1
A4
VDD1
A6
VDD2
VDD3
VDD4
VDD5
VDD6
VDD7
VDD8
VDD9
VDD10
VDD11
VDD12
VDD13
VDD14
VDD15
VDD16
VDD17
VDD18
VDD19
VDD20
VDD21
VDD22
VDD23
VDD24
VDD25
VDD26
VDD27
B3
VDD28
B5
VDD29
B7
VDD30
C2
VDD31
C4
VDD32
C6
VDD33
C8
VDD34
D3
VDD35
D5
VDD36
D7
VDD37
D9
VDD38
E4
VDD39
E6
VDD40
E8
VDD41
VDD42
F5
VDD43
F7
VDD44
F9
VDD45
F11
VDD46
G6
VDD47
G8
VDD48
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AF8
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AH26
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M2CPUG
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B28
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C3
D14
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D30
E11
F4
F14
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F24
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F30
G9
G11
H8
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J4
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K2
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Y18
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M2CPUH
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VDD3
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T8
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T22
U4
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U7
U9
U11
U13
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U17
U19
U21
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V2
V3
V10
V12
V14
V16
V18
V20
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W9
W11
W13
W15
W17
W19
W21
W23
Y8
Y10
Y12
W7
Y20
Y22
GND
DDRVTT
on the board to decoupling near the CPU package.
VCC12_HT
DDRVTT
DDR18V
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AD28
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C12
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M24
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P24
P26
P28
P30
T24
T26
T28
T30
V25
V26
V28
V30
Y24
Y26
Y28
Y29
VLDT_A1
VLDT_A2
VLDT_A3
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VTT1
VTT2
VTT3
VTT4
VDDIO1
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VDDIO3
VDDIO4
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VDDIO7
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VDDIO9
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VDDIO12
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VDDIO20
VDDIO21
VDDIO22
VDDIO23
VDDIO24
VDDIO25
VDDIO26
VDDIO27
VDDIO28
M2CPUI
M2CPUI
VDDIO
VDDIO
VLDT_B1
VLDT_B2
VLDT_B3
VLDT_B4
VTT5
VTT6
VTT7
VTT8
VTT9
VSS1
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VSS5
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VSS8
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VSS24
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VSS27
VSS28
H6
H5
H2
H1
AK12
AJ12
AH12
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K24
K26
K28
K30
L7
L9
L11
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L19
L21
L23
M8
M10
M12
M14
M16
M18
M20
M22
N4
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N7
N9
N11
N13
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GND
BUTTOM SIDE
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SC16
SC16
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22u/8/X5R/6.3V/M
VCORE
SC24
SC24
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
SC17
SC17
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22u/8/X5R/6.3V/M/X
GND
SC25
SC25
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
GND
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
SC18
SC18
SC26
SC26
SC19
SC19
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
SC27
SC27
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
HT12B
BC795
BC795
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
VCORE
SC20
SC20
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
SC28
SC28
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
DDR18V
SC2
SC2
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0.22u/6/X5R/10V/K
DDR18V
SC9
SC9
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22u/8/X5R/6.3V/M/X
SC11
SC11
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
GND
SC21
SC21
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
SC29
SC29
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
1021 EMI
DDRVTT
GND
SC10
SC10
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
GND
BUTTOM SIDE
SC12
SC12
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22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
22u/8/X5R/6.3V/M
SC22
SC22
SC30
SC30
SC13
SC13
0.22u/6/X5R/10V/K/X
0.22u/6/X5R/10V/K/X
SC23
SC23
22u/8/X5R/6.3V/M/X
22u/8/X5R/6.3V/M/X
BUTTOM SIDE
SC4
SC4
SC5
SC5
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0.01u/6/X7R/25V/K/X
0.22u/6/X5R/10V/K/X
0.22u/6/X5R/10V/K/X
SC8
SC8
SC7
SC7
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z/X
4.7u/8/Y5V/10V/Z/X
SC14
SC14
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0.01u/6/X7R/25V/K/X
SC6
SC6
180P/6/NPO/50V/J
180P/6/NPO/50V/J
SC31
SC31
180P/6/NPO/50V/J/X
180P/6/NPO/50V/J/X
SC15
SC15
180P/6/NPO/50V/J
180P/6/NPO/50V/J
VCC12_HT
C1328
C1328
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
C1329
C1329
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
C1330
C1330
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1331
C1331
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1332
C1332
180P/6/NPO/50V/J
180P/6/NPO/50V/J
C1333
C1333
180P/6/NPO/50V/J
180P/6/NPO/50V/J
DDR18V
C1324
C1324
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
C1325
C1325
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
C1326
C1326
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1327
C1327
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1316
C1316
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
DDRVTT
C1334
C1334
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
C1317
C1317
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
C1335
C1335
4.7u/8/Y5V/10V/Z
4.7u/8/Y5V/10V/Z
GND
C1318
C1318
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1336
C1336
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1319
C1319
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1337
C1337
0.22u/6/X5R/10V/K
0.22u/6/X5R/10V/K
C1320
C1320
1n/6/X7R/50V/K
1n/6/X7R/50V/K
C1338
C1338
1n/6/X7R/50V/K
1n/6/X7R/50V/K
C1321
C1321
1n/6/X7R/50V/K
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C1339
C1339
1n/6/X7R/50V/K
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C1322
C1322
180P/6/NPO/50V/J
180P/6/NPO/50V/J
C1340
C1340
180P/6/NPO/50V/J
180P/6/NPO/50V/J
C1323
C1323
180P/6/NPO/50V/J
180P/6/NPO/50V/J
C1341
C1341
180P/6/NPO/50V/J
180P/6/NPO/50V/J
BC20
BC20
100P/4/NPO/50V/J
100P/4/NPO/50V/J
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
BC24
BC24
100P/4/NPO/50V/J/X
100P/4/NPO/50V/J/X
GIGABYTE
GIGABYTE
GIGABYTE
CPU POWER & GND
CPU POWER & GND
CPU POWER & GND
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
of
of
of
732Wednesday, July 18, 2007
732Wednesday, July 18, 2007
732Wednesday, July 18, 2007
1.0
1.0
1.0
8
7
6
5
4
3
2
1
DDRII_2
DDRII_1
DDRII_1
2
VSS
5
VSS
8
VSS
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VSS
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29
VSS
VREF_DDRA
SBAA1
SBAA0
CKEA0
-DCLKA2
DCLKA2
-DCLKA1
DCLKA1
-DCLKA0
DCLKA0
SBAA2
-SCASA
-SRASA
-SWEA
32
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
85
VSS
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VDD
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VDD
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VDD
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VDD
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1
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3VDUAL
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BC12
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BC10
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C124
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C125
C125
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100P/4/NPO/50V/X
4
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5
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192
73
C126
C126
100P/4/N/50V/X
100P/4/N/50V/X
DDRII_2
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
VDD
RC1
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VREF
SCL
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WE*
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GIGABYTE
GIGABYTE
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Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
3
Date: Sheet
2
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-DQSB[0..7]
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C C
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DMB[0..8] <5,8>
DDR_VREF DDR_VREF
C121
C121
0.1U/4/Y5V/16V/Z
0.1U/4/Y5V/16V/Z
B B
MEM_SMBCLK<8,16>
MEM_SMBDATA<8,16>
VCC3
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DCLKA5<5,10>
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DCLKA4<5,10>
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DCLKA3<5,10>
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A A
8
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-SCASA<5,8,10>
-SRASA<5,8,10>
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7
DDRII_3
DDRII_3
2
VSS
5
VSS
8
VSS
11
VSS
14
VSS
17
VSS
20
VSS
23
VSS
26
VSS
29
VSS
32
VSS
35
VSS
38
VSS
41
VSS
44
VSS
47
VSS
50
VSS
65
VSS
66
VSS
79
VSS
82
VSS
85
VSS
88
VSS
91
VSS
94
VSS
97
VSS
100
VSS
103
VSS
106
VSS
109
VSS
112
VSS
115
VSS
118
VSS
121
VSS
124
VSS
127
VSS
130
VSS
133
VSS
136
VSS
139
VSS
142
VSS
145
VSS
148
VSS
151
VSS
154
VSS
157
VSS
160
VSS
163
VSS
166
VSS
169
VSS
198
VSS
201
VSS
204
VSS
207
VSS
210
VSS
213
VSS
216
VSS
219
VSS
222
VSS
225
VSS
228
VSS
231
VSS
234
VSS
237
VSS
51
VDDQ
56
VDDQ
62
VDDQ
72
VDDQ
75
VDDQ
78
VDDQ
191
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VCC3
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MEM_SMBDATA
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SBAA0
CKEA1
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-DCLKA3
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MAAA1
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MAAA13
MAAA14
MAAA15
SBAA2
-SCASA
-SRASA
-SWEA
VDDQ
194
VDDQ
181
VDDQ
175
VDDQ
170
VDDQ
53
VDD
59
VDD
64
VDD
197
VDD
69
VDD
172
VDD
187
VDD
184
VDD
178
VDD
189
VDD
67
VDD
18
RC1
55
RC0
238
VDDSPD
1
VREF
120
SCL
119
SDA
101
SA2
240
SA1
239
SA0
190
BA1
71
BA0
171
CKE1
52
CKE0
76
S1*
193
S0*
221
CK2*/RFU
220
CK2/RFU
138
CK1*/RFU
137
CK1/RFU
186
CK0*
185
CK0
188
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183
A1
63
A2
182
A3
61
A4
60
A5
180
A6
58
A7
179
A8
177
A9
70
A10/AP
57
A11
176
A12
196
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74
CAS*
192
RSA*
73
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7
6
6
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NC/DQS17*
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ODT0
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DQS*(4)
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DQS*(5)
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DQS*(6)
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DQS*(7)
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DQS8*
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5
68
NC
102
19
NC
77
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43
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49
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162
167
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46
45
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126
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134
135
DMA2
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147
DMA3
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156
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202
203
DMA5
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224
DMA7
232
233
164
165
MDA0
3
MDA1
4
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9
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129
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132
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199
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206
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90
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108
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236
5
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DQSA[0..7]
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4
-DQSA[0..7] <5,8>
DQSA[0..7] <5,8>
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C122
C122
0.1U/4/Y5V/16V/Z
0.1U/4/Y5V/16V/Z
MEM_SMBCLK<8,16>
MEM_SMBDATA<8,16>
4
3
DDRII_4
DDRII_4
2
VSS
5
VSS
8
VSS
11
VSS
14
VSS
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VSS
20
VSS
23
VSS
26
VSS
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VSS
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VSS
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VSS
38
VSS
41
VSS
44
VSS
47
VSS
50
VSS
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VSS
66
VSS
79
VSS
82
VSS
85
VSS
88
VSS
91
VSS
94
VSS
97
VSS
100
VSS
103
VSS
106
VSS
109
VSS
112
VSS
115
VSS
118
VSS
121
VSS
124
VSS
127
VSS
130
VSS
133
VSS
136
VSS
139
VSS
142
VSS
145
VSS
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VSS
151
VSS
154
VSS
157
VSS
160
VSS
163
VSS
166
VSS
169
VSS
198
VSS
201
VSS
204
VSS
207
VSS
210
VSS
213
VSS
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VSS
219
VSS
222
VSS
225
VSS
228
VSS
231
VSS
234
VSS
237
VSS
51
VDDQ
56
VDDQ
62
VDDQ
72
VDDQ
75
VDDQ
78
VDDQ
191
DDR18V
VCC3
MEM_SMBCLK
MEM_SMBDATA
VCC3
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SBAB0<5,8,10>
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CKEB1<5,10>
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-DCLKB5<5,10>
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-DCLKB4<5,10>
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DCLKB4<5,10>
-DCLKB3
-DCLKB3<5,10>
DCLKB3
DCLKB3<5,10>
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MAAB1
MAAB2
MAAB3
MAAB4
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MAAB6
MAAB7
MAAB8
MAAB9
MAAB10
MAAB11
MAAB12
MAAB13
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MAAB15
SBAB2
SBAB2<5,8,10>
-SCASB
-SCASB<5,8,10>
-SRASB
-SRASB<5,8,10>
-SWEB
-SWEB<5,8,10>
VDDQ
194
VDDQ
181
VDDQ
175
VDDQ
170
VDDQ
53
VDD
59
VDD
64
VDD
197
VDD
69
VDD
172
VDD
187
VDD
184
VDD
178
VDD
189
VDD
67
VDD
18
RC1
55
RC0
238
VDDSPD
1
VREF
120
SCL
119
SDA
101
SA2
240
SA1
239
SA0
190
BA1
71
BA0
171
CKE1
52
CKE0
76
S1*
193
S0*
221
CK2*/RFU
220
CK2/RFU
138
CK1*/RFU
137
CK1/RFU
186
CK0*
185
CK0
188
A0
183
A1
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A2
182
A3
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A4
60
A5
180
A6
58
A7
179
A8
177
A9
70
A10/AP
57
A11
176
A12
196
A13
174
A14
173
A15
54
A16/BA2
74
CAS*
192
RSA*
73
WE*
DDR2/240/RE/VA/D
DDR2/240/RE/VA/D
3
2
68
NC
102
NC/TEST
19
NC
77
ODT1
195
ODT0
42
CB(0)
43
CB(1)
48
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49
CB(3)
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7
DQS(0)
6
DQS*(0)
16
DQS(1)
15
DQS*(1)
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DQS*(27)
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92
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104
DQS*(6)
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113
DQS*(7)
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DQS8
45
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125
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165
NC/DQS17*
3
DQ(0)
4
DQ(1)
9
DQ(2)
10
DQ(3)
122
DQ(4)
123
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128
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129
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21
DQ(10)
22
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132
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141
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25
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31
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143
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150
DQ(23)
33
DQ(24)
34
DQ(25)
39
DQ(26)
40
DQ(27)
152
DQ(28)
153
DQ(29)
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159
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81
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199
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200
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96
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99
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107
DQ(50)
108
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DQ(53)
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DQ(54)
227
DQ(55)
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DQ(56)
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230
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DQ(62)
236
DQ(63)
GIGABYTE
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
Custom
Custom
Custom
Date: Sheet
Date: Sheet
Date: Sheet
2
1
MODT_B1
DQSB0
-DQSB0
DQSB1
-DQSB1
DQSB2
-DQSB2
DQSB3
-DQSB3
DQSB4
-DQSB4
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-DQSB5
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DQSB7
-DQSB7
DMB0
DMB1
DMB2
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DMB4
DMB5
DMB6
DMB7
MDB0
MDB1
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MDB62
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DDRII CHANNEL B
DDRII CHANNEL B
DDRII CHANNEL B
GA-M68SM-S2 1.0
GA-M68SM-S2 1.0
GA-M68SM-S2 1.0
MDB[0..63] <5,8>
of
932
of
932
of
932
1
8
DCLKA2
DCLKA2<5,8>
C102
C102
1.5p/4/NPO/50V/C
-DCLKA2<5,8>
D D
C C
B B
A A
-DCLKA1<5,8>
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-DCLKA3<5,9>
DDRVTT
-DCLKA2
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-DCLKA1
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-DCLKA0
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-DCLKA5
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DCLKA4<5,9>
-DCLKA4
DCLKA3
DCLKA3<5,9>
-DCLKA3
C1354 0.1U/4/Y5V/16V/ZC1354 0.1U/4/Y5V/16V/Z
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SBAA1
SBAB1
MAAB10
SBAA0
-SRASB
GIGABYTE
GIGABYTE
Title
Title
Title
Size Document Number Rev
Size Document Number Rev
Size Document Number Rev
B
B
B
Date: Sheet
Date: Sheet
Date: Sheet
2
GIGABYTE
DDRII TERMINATOR
DDRII TERMINATOR
DDRII TERMINATOR
RN20
RN18
RN18
RN17
RN17
RN16
RN16
RN15
RN15
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RN9
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RN7
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RN6
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RN5
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RN14
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RN13
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RN12
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RN11
RN10
RN10
GA-M68SM-S2
GA-M68SM-S2
GA-M68SM-S2
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12
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10 32Wednesday, July 18, 2007
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