GIGABYTE GA-M55plus-S3G Schematics
Gigabyte confidential
GA-M55plus-S3G
Digitally signed by dd
DN: cn=dd, o=dd,
ou=dd,
email=dddd@yahoo.
com, c=US
Date: 2009.12.17
19:06:51 +07'00'
www.kythuatvitinh.com
SHEET
01
02
03
04
05
06
07
08
09
10
11
12
13
14
15
16
17
18
19
20
21
22
23
24
25
TITLE
COVER SHEET
BOM & PCB MODIFY HISTORY
BLOCK DIAGRAM
PROCESSOR HT INTERFACE
PROCESSOR DDR2 INTERFACE
PROCESSOR DDR2 INTERFACE
PROCESSOR CONTROL & DEBUG
DIMM 1,2
DIMM 3,4
DIMM TERMINATION
C51 CPU
C51 HT
C51 PCI-EXPRESS
C51 RGB
C51 PWR/GND
MCP51 HT BUS
MCP51 PCI BUS/CLOCK/RESET
MCP51 SATA/IDE
MCP51 AZILIA/USB
MCP51 RGMII
MCP51 PWR/GND
PCI EXPRESS X16 SLOT
F_USB1/F_USB2 CONN /PCI_E x1 SLOT
PCI 1,2,3 SLOT
PCI 4 SLOT
SHEET
26
27
28
29
30
31
32
33
34
34
35
36
37
38 TI TSB43AB23 1394
TITLE
CODEC ALC883
AUDIO JACK, L_OUT, F_AUDIO
H/W MONITOR & FAN CONTROL
IDE1/IDE2/FDD
PWM ISL6566
COMA, LPT PORT
DDR18V,DDRVTT,5VDAUL,VCC12, POWER
POWER SEQUENCE
BIOS ATX POWER CONNCTOR
FRONT PANEL
ITE 8716GB/CX
Marvell 88E1116
Revision:1.2
Title
Size Document Number Re v
Custom
Date: Sheet
GIGABYTE
BLOCK DIAGRAM
GA-M55plus-S3G
138Thursday, July 06, 2006
of
1.2
Gigabyte confidential
5
www.kythuatvitinh.com
Model Name:GA-M55plus-S3G
4
3
2
1
Circuit or PCB layout change for next version
Date Change Item Reason
2006.03.17
2006.04.14
2006.06.06
2006.06.13
0.1 Gerber Out
1.0 Gerber Out
1.1 Gerber Out Modify DVI I2C PU ,74LVC08A change to SOIC
1.2 Gerber Out Change VDDA25 generate method.
Rename to GA-M55plus-S3G
BC7 for EMI
Version:1.2
P-Code:
Component value change history
Date Change Item Reason
D D
2006.03.22
2006.04.18 1.0A D_BOM Release. PCB:1.0
2006.05.02 RM change to o range. PCIE x16 change to blue. 11AC1-021164-81R
2006.05.08 1.0B ECN Release. PCB:1.0 Add VGA cap: 12PC1-V00001-01R, and Q74 2n d s o u r ce .
2006.06.07 1.1A E_BOM Release. PCB:1.1 Modify DVI I2C PU ,74LVC08A change to SOIC
2006.06.12 1.2A E_BOM Release. PCB:1.2 Change VDDA25 generate method.
2006.06.28 1.2A P_BOM Release. PCB:1.2 For PVT use. Add packing list.
C C
2006.07.06 1.2B P_BOM Release. PCB:1.2 Add ESD protect Diode. And combine repeat source.
B B
0.1 New BOM Release. PCB:0.1
1.0B P_BOM Release. PCB:1.0
LAN_USB re mov e 11NR6-702010-A1R
TPM no POP, Remove BIOS socket
Remove Power LED dua l col or sc hematic Add AMD Validation circuit
CPU fan speed. 15K-->8.2K Update new packing list
Remove BIOS socket
RM use plastic, F_PANEL use color
A A
Title
Size Document Number Re v
Custom
5
4
3
2
Date: Sheet
GIGABYTE
BOM & PCB MODIFY HISTORY
GA-M55plus-S3G
1
238Thursday, July 06, 2006
1.2
of
Gigabyte confidential
BLOCK DIAGRAM
www.kythuatvitinh.com
POWER
SUPPLY
CONNECTOR
PRIMARY IDE
SECONDARY IDE
SATA2 CONN x4
FLOPPY CONN
PS2/KB CONN
PARALLEL CONN
SERIAL CONN 4MB FLASH
SIO
VREG
ATA 133
INTEGRATED SATA
LPC BUS 33MHZ
AMD K8 CPU
SOCKET AM2
HT 16X16 1GHZ
NVIDIA
C51G
HT 8X8 1GHZ
NVIDIA
MCP51
PCI 33MHZ
AZILIA
USB2.0 X8 PORT
128-BIT 200/266/333/400MHZ
RTL883 CODEC
BACK PANEL
USB2.0 PORTS 0-1
X2/1394
USB2.0 PORTS 2-3
X2/GBIT LAN
DDRII SDRAM CONN 1
DDRII SDRAM CONN 2
DDRII SDRAM CONN 3
DDRII SDRAM CONN 4
PCI SLOT 1
PCI SLOT 2
1L
1H
2L
2H
FRONT PANEL
USB2.0 PORTS 4-5
USB2.0 PORTS 6-7
Title
Size Document Number Re v
Custom
Date: Sheet
GIGABYTE
BLOCK DIAGRAM
GA-M55plus-S3G
338Thursday, July 06, 2006
1.2
of
Gigabyte confidential
L0_CADIN_L[0..15]
www.kythuatvitinh.com
L0_CADIN_H[0..15]
L0_CLKIN_L[0..1]
L0_CLK IN_H[0..1]
L0_CADOUT _L[0..15]
L0_CADOUT_H[0..15]
L0_CLKOUT_L[0..1]
L0_CLKOUT_H[0..1]
L0_CADIN_L[0..15] <11>
L0_CADIN_H[0..15] <11>
L0_CLKIN_L[0..1] <11>
L0_CLKIN_ H[0..1] <11>
L0_CADOUT_L[0..15] <11>
L0_CADOUT_H[0..15] <11>
L0_CLKOUT_L[0..1] <11>
L0_CLKOUT_H[0..1] <11>
CPU_VDD_RUN = VCORE
CPU_VDDA_RUN = VDDA25
VLDT_RUN = VCC12_HT
CPU_VDDIO_SUS = DDR18V
CPU_VTT_SUS = DDRVTT
VLDT_A = VCC12_HT
VLDT_B = HT12B
VCC12_HT
L0_CTLIN_H0<11>
GND
L0_CTLIN_L0<11>
L0_CLKIN_H1
L0_CLKIN_L1
L0_CLKIN_H0
L0_CLKIN_L0
R3 49.9/4/1
R4 49.9/4/1
L0_CTLIN_H0
L0_CTLIN_L0
L0_CADIN_H15
L0_CADIN_L15
L0_CADIN_H14
L0_CADIN_L14
L0_CADIN_H13
L0_CADIN_L13
L0_CADIN_H12
L0_CADIN_L12
L0_CADIN_H11
L0_CADIN_L11
L0_CADIN_H10
L0_CADIN_L10
L0_CADIN_H9
L0_CADIN_L9
L0_CADIN_H8
L0_CADIN_L8
L0_CADIN_H7
L0_CADIN_L7
L0_CADIN_H6
L0_CADIN_L6
L0_CADIN_H5
L0_CADIN_L5
L0_CADIN_H4
L0_CADIN_L4
L0_CADIN_H3
L0_CADIN_L3
L0_CADIN_H2
L0_CADIN_L2
L0_CADIN_H1
L0_CADIN_L1
L0_CADIN_H0
L0_CADIN_L0
N6
L0_CLKIN_H(1)
P6
L0_CLKIN_L(1)
N3
L0_CLKIN_H(0)
N2
L0_CLKIN_L(0)
V4
L0_CTLIN_H(1)
V5
L0_CTLIN_L(1)
U1
L0_CTLIN_H(0)
V1
L0_CTLIN_L(0)
U6
L0_CADIN_H(15)
V6
L0_CADIN_L(15)
T4
L0_CADIN_H(14)
T5
L0_CADIN_L(14)
R6
L0_CADIN_H(13)
T6
L0_CADIN_L(13)
P4
L0_CADIN_H(12)
P5
L0_CADIN_L(12)
M4
L0_CADIN_H(11)
M5
L0_CADIN_L(11)
L6
L0_CADIN_H(10)
M6
L0_CADIN_L(10)
K4
L0_CADIN_H(9)
K5
L0_CADIN_L(9)
J6
L0_CADIN_H(8)
K6
L0_CADIN_L(8)
U3
L0_CADIN_H(7)
U2
L0_CADIN_L(7)
R1
L0_CADIN_H(6)
T1
L0_CADIN_L(6)
R3
L0_CADIN_H(5)
R2
L0_CADIN_L(5)
N1
L0_CADIN_H(4)
P1
L0_CADIN_L(4)
L1
L0_CADIN_H(3)
M1
L0_CADIN_L(3)
L3
L0_CADIN_H(2)
L2
L0_CADIN_L(2)
J1
L0_CADIN_H(1)
K1
L0_CADIN_L(1)
J3
L0_CADIN_H(0)
J2
L0_CADIN_L(0)
HYPERTRANSPORT
L0_CLKOUT_H(1)
L0_CLKOUT_L(1)
L0_CLKOUT_H(0)
L0_CLKOUT_L(0)
L0_CTLOUT_H(1)
L0_CTLOUT_L(1)
L0_CTLOUT_H(0)
L0_CTLOUT_L(0)
L0_CADOUT_H(15)
L0_CADOUT_L(15)
L0_CADOUT_H(14)
L0_CADOUT_L(14)
L0_CADOUT_H(13)
L0_CADOUT_L(13)
L0_CADOUT_H(12)
L0_CADOUT_L(12)
L0_CADOUT_H(11)
L0_CADOUT_L(11)
L0_CADOUT_H(10)
L0_CADOUT_L(10)
L0_CADOUT_H(9)
L0_CADOUT_L(9)
L0_CADOUT_H(8)
L0_CADOUT_L(8)
L0_CADOUT_H(7)
L0_CADOUT_L(7)
L0_CADOUT_H(6)
L0_CADOUT_L(6)
L0_CADOUT_H(5)
L0_CADOUT_L(5)
L0_CADOUT_H(4)
L0_CADOUT_L(4)
L0_CADOUT_H(3)
L0_CADOUT_L(3)
L0_CADOUT_H(2)
L0_C
L0_CADOUT_H(1)
L0_CADOUT_L(1)
L0_CADOUT_H(0)
L0_CADOUT_L(0)
M2CPUA
ADOUT_L(2)
AD5
AD4
AD1
AC1
Y6
W6
W2
W3
Y5
Y4
AB6
AA6
AB5
AB4
AD6
AC6
AF6
AE6
AF5
AF4
AH6
AG6
AH5
AH4
Y1
W1
AA2
AA3
AB1
AA1
AC2
AC3
AE2
AE3
AF1
AE1
AG2
AG3
AH1
AG1
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CTLOUT_H0
L0_CTLOUT_L0
L0_CADOUT_H15
L0_CADOUT_L15
L0_CADOUT_H14
L0_CADOUT_L14
L0_CADOUT_H13
L0_CADOUT_L13
L0_CADOUT_H12
L0_CADOUT_L12
L0_CADOUT_H11
L0_CADOUT_L11
L0_CADOUT_H10
L0_CADOUT_L10
L0_CADOUT_H9
L0_CADOUT_L9
L0_CADOUT_H8
L0_CADOUT_L8
L0_CADOUT_H7
L0_CADOUT_L7
L0_CADOUT_H6
L0_CADOUT_L6
L0_CADOUT_H5
L0_CADOUT_L5
L0_CADOUT_H4
L0_CADOUT_L4
L0_CADOUT_H3
L0_CADOUT_L3
L0_CADOUT_H2
L0_CADOUT_L2
L0_CADOUT_H1
L0_CADOUT_L1
L0_CADOUT_H0
L0_CADOUT_L0
1
TP78
1
TP79
L0_CTLOUT_H0 <11>
L0_CTLOUT_L0 <11>
SOCKET_M2 M2/[12KRC-04K807-41R]
Title
Size Document Number Re v
Custom
Date: Sheet
GIGABYTE
CPU HYPER TRANSPORT
GA-M55plus-S3G
438Thursday, July 06, 2006
1.2
of
Gigabyte confidential
M2CPUB
www.kythuatvitinh.com
L27
MEMORY INTERFACE A
MA0_CLK_H(2)
MA0_CLK_L(2)
MA0_CLK_H(1)
MA0_CLK_L(1)
MA0_CLK_H(0)
MA0_CLK_L(0)
MA0_CS_L(1)
MA0_CS_L(0)
MA0_ODT(0)
MA1_CLK_H(2)
MA1_CLK_L(2)
MA1_CLK_H(1)
MA1_CLK_L(1)
MA1_CLK_H(0)
MA1_CLK_L(0)
MA1_CS_L(1)
MA1_CS_L(0)
MA1_ODT(0)
MA_CAS_L
MA_WE_L
MA_RAS_L
MA_BANK(2)
MA_BANK(1)
MA_BANK(0)
MA_CKE(1)
MA_CKE(0)
MA_ADD(15)
MA_ADD(14)
MA_ADD(13)
MA_ADD(12)
MA_ADD(11)
MA_ADD(10)
MA_ADD(9)
MA_ADD(8)
MA_ADD(7)
MA_ADD(6)
MA_ADD(5)
MA_ADD(4)
MA_ADD(3)
MA_ADD(2)
MA_ADD(1)
MA_ADD(0)
MA_DQS_H(7)
MA_DQS_L(7)
MA_DQS_H(6)
MA_DQS_L(6)
MA_DQS_H(5)
MA_DQS_L(5)
MA_DQS_H(4)
MA_DQS_L(4)
MA_DQS_H(3)
A_DQS_L(3)
M
MA_DQS_H(2)
MA_DQS_L(2)
MA_DQS_H(1)
MA_DQS_L(1)
MA_DQS_H(0)
MA_DQS_L(0)
MA_DM(7)
MA_DM(6)
MA_DM(5)
MA_DM(4)
MA_DM(3)
MA_DM(2)
MA_DM(1)
MA_DM(0)
MA_DATA(63)
MA_DATA(62)
MA_DATA(61)
MA_DATA(60)
MA_DATA(59)
MA_DATA(58)
MA_DATA(57)
MA_DATA(56)
MA_DATA(55)
MA_DATA(54)
MA_DATA(53)
MA_DATA(52)
MA_DATA(51)
MA_DATA(50)
MA_DATA(49)
MA_DATA(48)
MA_DATA(47)
MA_DATA(46)
MA_DATA(45)
MA_DATA(44)
MA_DATA(43)
MA_DATA(42)
MA_DATA(41)
MA_DATA(40)
MA_DATA(39)
MA_DATA(38)
MA_DATA(37)
MA_DATA(36)
MA_DATA(35)
MA_DATA(34)
MA_DATA(33)
MA_DATA(32)
MA_DATA(31)
MA_DATA(30)
MA_DATA(29)
MA_DATA(28)
MA_DATA(27)
MA_DATA(26)
MA_DATA(25)
MA_DATA(24)
MA_DATA(23)
MA_DATA(22)
MA_DATA(21)
MA_DATA(20)
MA_DATA(19)
MA_DATA(18)
MA_DATA(17)
MA_DATA(16)
MA_DATA(15)
MA_DATA(14)
A_DATA(13)
M
MA_DATA(12)
MA_DATA(11)
MA_DATA(10)
MA_DATA(9)
MA_DATA(8)
MA_DATA(7)
MA_DATA(6)
MA_DATA(5)
MA_DATA(4)
MA_DATA(3)
MA_DATA(2)
MA_DATA(1)
MA_DATA(0)
MA_DQS_H(8)
MA_DQS_L(8)
MA_DM(8)
MA_CHECK(7)
MA_CHECK(6)
MA_CHECK(5)
MA_CHECK(4)
MA_CHECK(3)
MA_CHECK(2)
MA_CHECK(1)
MA_CHECK(0)
AE14
AG14
AG16
AD17
AD13
AE13
AG15
AE16
AG17
AE18
AD21
AG22
AE17
AF17
AF21
AE21
AF23
AE23
AJ26
AG26
AE22
AG23
AH25
AF25
AJ28
AJ29
AF29
AE26
AJ27
AH27
AG29
AF27
E29
E28
D27
C27
G26
F27
C28
E27
F25
E25
E23
D23
E26
C26
G23
F23
E22
E21
F17
G17
G22
F21
G18
E17
G16
E15
G13
H13
H17
E16
E14
G14
J28
J27
J25
K25
J26
G28
G27
L24
K27
H29
H27
MDA63
MDA62
MDA61
MDA60
MDA59
MDA58
MDA57
MDA56
MDA55
MDA54
MDA53
MDA52
MDA51
MDA50
MDA49
MDA48
MDA47
MDA46
MDA45
MDA44
MDA43
MDA42
MDA41
MDA40
MDA39
MDA38
MDA37
MDA36
MDA35
MDA34
MDA33
MDA32
MDA31
MDA30
MDA29
MDA28
MDA27
MDA26
MDA25
MDA24
MDA23
MDA22
MDA21
MDA20
MDA19
MDA18
MDA17
MDA16
MDA15
MDA14
MDA13
MDA12
MDA11
MDA10
MDA9
MDA8
MDA7
MDA6
MDA5
MDA4
MDA3
MDA2
MDA1
MDA0
MDA[0..63] <8,9> MDB[0..63] <8,9>
DQSB[0..8 ]
DCLKA2
-DCLKA2
DCLKA1
-DCLKA1
DCLKA0
-DCLKA0
MODT_A0
DCLKA5
-DCLKA5
DCLKA4
-DCLKA4
DCLKA3
-DCLKA3
MODT_A1
-SCASA
-SWEA
-SRASA
SBAA2
SBAA1
SBAA0
CKEA1
CKEA0
DQSA7
-DQSA7
DQSA6
-DQSA6
DQSA5
-DQSA5
DQSA4
-DQSA4
DQSA3
-DQSA3
DQSA2
-DQSA2
DQSA1
-DQSA1
DQSA0
-DQSA0
DMA7
DMA6
DMA5
DMA4
DMA3
DMA2
DMA1
DMA0
AG21
AG20
AC25
AA24
AC28
AE20
AE19
AD27
AA25
AC27
AB25
AB27
AA26
AA27
AC26
AD15
AE15
AG18
AG19
AG24
AG25
AG27
AG28
AF15
AF19
AJ25
AH29
G19
H19
U27
U26
G20
G21
V27
W27
N25
Y27
M25
M27
N24
N26
P25
Y25
N27
R24
P27
R25
R26
R27
T25
U25
T27
W24
D29
C29
C25
D25
E19
F19
F15
G15
B29
E24
E18
H15
DCLKA2<8,10>
-DCLKA2<8,10>
DCLKA1<8,10>
-DCLKA1<8,10>
DCLKA0<8,10>
-DCLKA0<8,10>
-CSA1<8,10>
-CSA0<8,10>
MODT_A0<8,10>
DCLKA5<9,10>
-DCLKA5<9,10>
DCLKA4<9,10>
-DCLKA4<9,10>
DCLKA3<9,10> DCLKB3<9,10>
-DCLKA3<9,10>
-CSA3<9,10>
-CSA2<9,10>
MODT_A1<9,10>
-SCASA<8,9,10>
-SWEA<8 ,9,10>
-SRASA<8,9,10>
SBAA2<8,9,10>
SBAA1<8,9,10>
SBAA0<8,9,10>
CKEA1<9,10>
CKEA0<8,10>
MAAA15
MAAA[0..15]<8,9,10> MAAB[0..15]<8,9,10>
-DQSA[0..8] -DQSB[0..8]
DQSA[0..8 ]
DMA[0:8] DMB[0..8]
-DQ SA[0..8 ] <8,9>
DQSA[0..8] <8,9>
DMA [0..8] <8,9> DMB [0..8] <8,9>
MAAA14
MAAA13
MAAA12
MAAA11
MAAA10
MAAA9
MAAA8
MAAA7
MAAA6
MAAA5
MAAA4
MAAA3
MAAA2
MAAA1
MAAA0
-DQS B[0..8] <8,9>
DQS B[0..8] <8,9>
M2CPUC
A18
A19
U31
U30
C19
D19
N31
N28
N29
N30
P29
P31
R29
R28
R31
R30
T31
T29
U29
U28
D31
C31
C24
C23
D17
C17
C14
C13
C30
A23
B17
B13
MEMORY INTERFACE B
MB0_CLK_H(2)
MB0_CLK_L(2)
MB0_CLK_H(1)
MB0_CLK_L(1)
MB0_CLK_H(0)
MB0_CLK_L(0)
MB0_CS_L(1)
MB0_CS_L(0)
MB0_ODT(0)
MB1_CLK_H(2)
MB1_CLK_L(2)
MB1_CLK_H(1)
MB1_CLK_L(1)
MB1_CLK_H(0)
MB1_CLK_L(0)
MB1_CS_L(1)
MB1_CS_L(0)
MB1_ODT(0)
MB_CAS_L
MB_WE_L
MB_RAS_L
MB_BANK(2)
MB_BANK(1)
MB_BANK(0)
MB_CKE(1)
MB_CKE(0)
MB_ADD(15)
MB_ADD(14)
MB_ADD(13)
MB_ADD(12)
MB_ADD(11)
MB_ADD(10)
MB_ADD(9)
MB_ADD(8)
MB_ADD(7)
MB_ADD(6)
MB_ADD(5)
MB_ADD(4)
MB_ADD(3)
MB_ADD(2)
MB_ADD(1)
MB_ADD(0)
MB_DQS_H(7)
MB_DQS_L(7)
MB_DQS_H(6)
MB_DQS_L(6)
MB_DQS_H(5)
MB_DQS_L(5)
MB_DQS_H(4)
MB_DQS_L(4)
MB_DQS_H(3)
B_DQS_L(3)
M
MB_DQS_H(2)
MB_DQS_L(2)
MB_DQS_H(1)
MB_DQS_L(1)
MB_DQS_H(0)
MB_DQS_L(0)
MB_DM(7)
MB_DM(6)
MB_DM(5)
MB_DM(4)
MB_DM(3)
MB_DM(2)
MB_DM(1)
MB_DM(0)
MB_DATA(63)
MB_DATA(62)
MB_DATA(61)
MB_DATA(60)
MB_DATA(59)
MB_DATA(58)
MB_DATA(57)
MB_DATA(56)
MB_DATA(55)
MB_DATA(54)
MB_DATA(53)
MB_DATA(52)
MB_DATA(51)
MB_DATA(50)
MB_DATA(49)
MB_DATA(48)
MB_DATA(47)
MB_DATA(46)
MB_DATA(45)
MB_DATA(44)
MB_DATA(43)
MB_DATA(42)
MB_DATA(41)
MB_DATA(40)
MB_DATA(39)
MB_DATA(38)
MB_DATA(37)
MB_DATA(36)
MB_DATA(35)
MB_DATA(34)
MB_DATA(33)
MB_DATA(32)
MB_DATA(31)
MB_DATA(30)
MB_DATA(29)
MB_DATA(28)
MB_DATA(27)
MB_DATA(26)
MB_DATA(25)
MB_DATA(24)
MB_DATA(23)
MB_DATA(22)
MB_DATA(21)
MB_DATA(20)
MB_DATA(19)
MB_DATA(18)
MB_DATA(17)
MB_DATA(16)
MB_DATA(15)
MB_DATA(14)
MB_DATA(13)
MB_DATA(12)
MB_DATA(11)
MB_DATA(10)
MB_DATA(9)
MB_DATA(8)
MB_DATA(7)
MB_DATA(6)
MB_DATA(5)
MB_DATA(4)
MB_DATA(3)
MB_DATA(2)
MB_DATA(1)
MB_DATA(0)
MB_DQS_H(8)
MB_DQS_L(8)
MB_DM(8)
MB_CHECK(7)
MB_CHECK(6)
MB_CHECK(5)
MB_CHECK(4)
MB_CHECK(3)
MB_CHECK(2)
MB_CHECK(1)
MB_CHECK(0)
DCLKB2
-DCLKB2
DCLKB1
-DCLKB1
DCLKB0
-DCLKB0
MODT_B0
DCLKB5
-DCLKB5
DCLKB4
-DCLKB4
DCLKB3
-DCLKB3
MODT_B1
-SCASB
-SWEB
-SRASB
SBAB2
SBAB1
SBAB0
CKEB1
CKEB0
DQSB7
-DQSB7
DQSB6
-DQSB6
DQSB5
-DQSB5
DQSB4
-DQSB4
DQSB3
-DQSB3
DQSB2
-DQSB2
DQSB1
-DQSB1
DQSB0
-DQSB0
DMB7
DMB6
DMB5
DMB4
DMB3
DMB2
DMB1
DMB0
AJ19
AK19
AE30
AC31
AD29
AL19
AL18
AE29
AB31
AD31
AC29
AC30
AB29
AA31
AA28
AE31
AA29
AA30
AK13
AJ13
AK17
AJ17
AK23
AL23
AL28
AL29
AJ14
AH17
AJ23
AK29
W29
W28
M31
M29
DCLKB2<8,10>
-DCLKB2<8,10>
DCLKB1<8,10>
-DCLKB1<8,10>
DCLKB0<8,10>
-DCLKB0<8,10>
-CSB1<8,10>
-CSB0<8,10>
MODT_B0<8,10>
DCLKB5<9,10>
-DCLKB5<9,10>
DCLKB4<9,10>
-DCLKB4<9,10>
-DCLKB3<9,10>
-CSB3<9,10>
-CSB2<9,10>
MODT_B1<9,10>
-SCASB<8,9,10>
-SWEB<8,9 ,10>
-SRASB<8,9,10>
SBAB2<8,9,10>
SBAB1<8,9,10>
SBAB0<8,9,10>
CKEB1<9,10>
CKEB0<8,10>
MAAB15
MAAB14
MAAB13
MAAB12
MAAB11
MAAB10
MAAB9
MAAB8
MAAB7
MAAB6
MAAB5
MAAB4
MAAB3
MAAB2
MAAB1
MAAB0
AH13
AL13
AL15
AJ15
AF13
AG13
AL14
AK15
AL16
AL17
AK21
AL21
AH15
AJ16
AH19
AL20
AJ22
AL22
AL24
AK25
AJ21
AH21
AH23
AJ24
AL27
AK27
AH31
AG30
AL25
AL26
AJ30
AJ31
E31
E30
B27
A2
F29
F31
A29
A28
A25
A24
C22
D21
A26
B25
B23
A22
B21
A20
C16
D15
C21
A21
A17
A16
B15
A14
E13
F13
C15
A15
A13
D13
J31
J30
J29
K29
K31
G30
G29
L29
L28
H31
G31
MDB63
MDB62
MDB61
MDB60
MDB59
MDB58
MDB57
MDB56
MDB55
MDB54
MDB53
MDB52
MDB51
MDB50
MDB49
MDB48
MDB47
MDB46
MDB45
MDB44
MDB43
MDB42
MDB41
MDB40
MDB39
MDB38
MDB37
MDB36
MDB35
MDB34
MDB33
MDB32
MDB31
MDB30
MDB29
MDB28
7
MDB27
MDB26
MDB25
MDB24
MDB23
MDB22
MDB21
MDB20
MDB19
MDB18
MDB17
MDB16
MDB15
MDB14
MDB13
MDB12
MDB11
MDB10
MDB9
MDB8
MDB7
MDB6
MDB5
MDB4
MDB3
MDB2
MDB1
MDB0
Title
Size Document Number Re v
Custom
Date: Sheet
GIGABYTE
CPU DDRII MEMORY
GA-M55plus-S3G
538Thursday, July 06, 2006
1.2
of
Gigabyte confidential
DDR18V
www.kythuatvitinh.com
-CPURST_C
CPU_PWRGD_C
HTSTOP_L_C
12
13
GND
-HTMCP_PWRGD<12,16>
CPU_PWRGD<11>
-HTMCP_PWRGD<12,16>
-HTMCP_PWRGD<12,16>
CPUVREF
40 MILS WIDTH
CPU_M_VREF
SBC31
SBC12
1N/4/X7R/50V/K
0.1U/4/Y5V/16V/Z
R21 300/4
R22 300/4
R23 300/4
DDR18V
U3D
147
11
74LVC08AD/SO14[10TC1-117408-01R_10TC1-117408-02R]
GND
-HTMCP_PWRGD
CPU_PWRGD
-HTMCP_PWRGD
-CPURST<11>
12
VCC
5VSB
-HTSTOP_L
-HTMCP_PWRGD
-CPURST
SC35
1u/6/Y5V/10V/Z
R988 10K/4
R989 8.2K/4
PWOK<23,32,34,35,37>
THERMTRIP_CPU_L
DDR18V
SR19
16.9/4/1
SR20
16.9/4/1
GND
C1048
1U/6/Y5V/10V/Z
-CPURST
R992 8.2K/4/X
R991 8.2K/4
-HTSTOP_L<11>
-CPURST
CPU_PWRGD
-HTSTOP_L
VDDA25
DDR18V
U3A
147
1
2
74LVC08AD/SO14[10TC1-117408-01R_10TC1-117408-02R]
GND
DDR18V
U3B
147
4
5
74LVC08AD/SO14[10TC1-117408-01R_10TC1-117408-02R]
GND
DDR18V
U3C
147
9
10
74LVC08AD/SO14[10TC1-117408-01R_10TC1-117408-02R]
GND
R990
8.2K/4
R26 1K/4
R33 1K/4
R36 1K/4
FB1 30/6/4A/S
CPUCLK0_H<11>
CPUCLK0_L<11>
CPU_PWRGD _C
3
HTSTOP_L_C
6
-CPURST_C
8
R986 4.7K/4
5VSB
84
U66B
5
+
6
-
KA393D/SO8
Q117
MMBT2222A/SOT23/600mA/40
SOT23
132
C1047
0.1U/6/Y5V/25V/Z
7
VDDA25
C3
4.7u/8/Y5V/10V/Z
GND
CPUCLK0_H
CPUCLK0_L
SI_DAT<36>
VCC
R987
1K/4
3.3n/4/X7R/50V/K
3.9n/4/X7R/50V/K
C1
C2
3.9n/4/X7R/50V/K
R58 300/4
GND
DDR18V
COREFB+<30>
COREFB-<30>
CPU_M_VREF
DDR18V
GND
GND
GNDA<36>
TMPIN3<28,36>
COREFB-<30>
COREFB+<30>
DR10 0/6/X
VCORE
COREFB-<30>
COREFB+<30>
COREFB-<30>
COREFB+<30>
For AMD Validation only
3
D
GS
2
1
3
D
GS
2
1
C13
C4
0.22u/6/X5R/10V/K
GND
CLKIN_H
R5
CLKIN_L
169/4/1
R8 22/4 /X
R9 22/4 /X
R17 300/4/X
-PWRBTSW <35,36>
Q114
2N7002/SOT23/60PF/5
CPUVDD_EN
Q1
2N7002/SOT23/60PF/5
CPU_PWRGD_C
-CPURST_C
CPU_PRESENT_L
TP81
TP83
TP84
TP85
TP86
39.2/6/1R11
39.2/6/1R12
CPU_TEST25_H
CPU_TEST25_L
300/4R13
300/4R14
TP89
TP91
TP93
TP95
TP96
0/4R15
0/4R16
C20
4.7u/8/Y5V/10V/Z/X
C21
0.1U/6/Y5V/25V/Z /X
BC8
0.1U/4/Y5V/16V/Z
CPUVDD_EN <16,30>
M2CPUD
C10
VDDA1
D10
VDDA2
A8
CLKIN_H
B8
CLKIN_L
C9
PWROK
D8
LDTSTOP_L
C7
RESET_L
AL3
CPU_PRESENT_L
AL6
SID
SIC
AK6
SID
AL10
TDI
AJ10
TRST_L
AH10
TCK
AL9
TMS
A5
DBREQ_L
G2
VDD_FB_H
G1
VDD_FB_L
E12
VTT_SENSE
F12
M_VREF
AH11
M_ZN
AJ11
M_ZP
A10
TEST25_H
B10
TEST25_L
F10
TEST19
E9
TEST18
AJ7
TEST13
F6
TEST9
GND
D6
TEST17
E7
TEST16
F8
TEST15
C5
TEST14
AH9
TEST12
E5
TEST7
AJ5
TEST6
AG9
THERMDC
AG8
THERMDA
AH7
TEST3
AJ6
TEST2
RS3 CLOSE CPU VR MOSFET
Plase at PH3 copper
MISC
CPU_VID5
D2
VID(5)
CPU_VID4HTSTOP_L_C
D1
VID(4)
CPU_VID3
C1
VID(3)
CPU_VID2
E3
VID(2)
CPU_VID1
E2
VID(1)
CPU_VID0
E1
VID(0)
PROCHOT_L
TDO
DBRDY
VDDIO_FB_H
VDDIO_FB_L
PSI_L
HTREF1
HTREF0
TEST29_H
TEST29_L
TEST24
TEST23
TEST22
TEST21
TEST20
TEST28_H
TEST28_L
TEST27
TEST26
TEST10
TEST8
AK7
AL7
AK10
B6
AK11
AL11
F1
V8
V7
C11
D11
AK8
AH8
AJ9
AL8
AJ8
J10
H9
AK9
AK5
G7
D4
LAYOUT: Route trace 50 mils wide and
THERMTRIP_L
500 to 750 mils long between these caps.
VCC
R2068
R2069
12K/4/1/X
2.4K/4/1/X
RS3
R2071
1K/4/1/X
100K/1/6/S/X
HR100K/[10RH2-001003-21]
RN251
300/8P4R/X
R55 80.6/4/1
CPU_TEST21
CPU_TEST26
DDR18V
R65
300/4/X
1 2
3 4
5 6
7 8
THERMTRIP_L
TP82
TP87
TP88
VCC12_HT
44.2/6/1R53
44.2/6/1R54
TP90
TP92
TP94
TP97
R2067 6.98K/4/1/X
5VSB VCC
84
U66A
3
+
2
-
KA393D/SO8
C223
0.1U/6/Y5V/25V/Z/X
R57
R56
300/4
300/4
VID 5 <30>
VID 4 <30>
VID 3 <30>
VID 2 <30>
VID 1 <30>
VID 0 <30>
R176 1K/4R19 300/4/X
DDR18V
R174 1K/4
DDR18V
GND
Route as 80-Ohm differential impedance
R60
300/4
R175 1K/4
132
-PROCHOT
Q10
MMBT2222A/SOT23/600mA/40
SOT23
Keep trace to resistor less than 1" from CPU pin
Asserted at 131 degree
Deasserted at 116 degree
-PROCHOT
R2070
680/4/X
1
No pop
Q300
2N7002/SOT23/60PF/5/X
SOT23
132
3VDUAL
R59
1K/4
THERMTRIP_CPU_LSIC
Q9
MMBT222 2A/SOT23/600mA/40
SOT23
132
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
Erratum 133, Revision Guide for
AMD NPT 0Fh Processors
L25
L26
L31
L30
W26
W25
AE27
U24
V24
AE28
Y31
Y30
AG31
V31
W31
AF31
Title
Size Document Number Re v
Custom
Date: Sheet
THERMTRIP_CPU_L <16>SI_CLK<36>
CPU_TEST26
CPU_PRESENT_L
CPU_TEST25_H
CPU_TEST25_L
CPU_TEST21
M2CPUE
INTERNAL MISC
RSVD1
RSVD2
RSVD3
RSVD4
RSVD5
RSVD6
RSVD7
RSVD8
RSVD9
RSVD10
RSVD11
RSVD12
RSVD13
RSVD14
RSVD15
RSVD16
GIGABYTE
CPU CONTROL
GA-M55plus-S3G
RSVD17
RSVD18
RSVD19
RSVD20
RSVD21
RSVD22
RSVD23
RSVD24
RSVD25
RSVD26
RSVD27
RSVD28
RSVD29
RSVD30
RSVD31
RSVD32
RSVD33
RSVD34
RSVD35
RSVD36
RSVD37
RSVD38
R37 300/4
R49 1K/4
R42 510/4
R43 510/4
R47 300/4
E20
B19
AL4
AK4
AK3
F2
F3
G4
G3
G5
AD25
AE24
AE25
AJ18
AJ20
C18
C20
G24
G25
H25
V29
W30
638Thursday, July 06, 2006
of
DDR18V
GND
1.2
Gigabyte confidential
VCORE
www.kythuatvitinh.com
AA10
AA12
AA14
AA16
AA18
AB11
AC10
AE10
VLDT_RUN_B is connected to the VLDT_RUN power
supply through the package or on the die. It is only connected
M2CPUF
VDD1
A4
VDD1
A6
VDD2
AA8
VDD3
VDD4
VDD5
VDD6
VDD7
VDD8
AB7
VDD9
AB9
VDD10
VDD11
AC4
VDD12
AC5
VDD13
AC8
VDD14
VDD15
AD2
VDD16
AD3
VDD17
AD7
VDD18
AD9
VDD19
VDD20
AF7
VDD21
AF9
VDD22
AG4
VDD23
AG5
VDD24
AG7
VDD25
2
AH
VDD26
AH3
VDD27
B3
VDD28
B5
VDD29
B7
VDD30
C2
VDD31
C4
VDD32
C6
VDD33
C8
VDD34
D3
VDD35
D5
VDD36
D7
VDD37
D9
VDD38
E4
VDD39
E6
VDD40
E8
VDD41
E10
VDD42
F5
VDD43
F7
VDD44
F9
VDD45
F11
VDD46
G6
VDD47
G8
VDD48
G10
VDD49
G12
VDD50
H7
VDD51
H11
VDD52
H23
VDD53
J8
VDD54
J12
VDD55
J14
VDD56
J16
VDD57
J18
VDD58
J20
VDD59
J22
VDD60
J24
VDD61
K7
VDD62
K9
VDD63
K11
VDD64
K13
VDD65
K15
VDD66
K17
VDD67
K19
VDD68
K21
VDD69
K23
VDD70
L4
VDD71
L5
VDD72
L8
VDD73
L10
VDD74
L12
VDD75
Y17
VDD150
Y19
D151
VD
VSS1
VSS2
VSS3
VSS4
VSS5
VSS6
VSS7
VSS8
VSS9
VSS10
VSS11
VSS12
VSS13
VSS14
VSS15
VSS16
VSS17
VSS18
VSS19
VSS20
VSS21
VSS22
VSS23
VSS24
VSS25
VSS26
VSS27
VSS28
VSS29
VSS30
VSS31
VSS32
VSS33
VSS34
VSS35
VSS36
VSS37
VSS38
VSS39
VSS40
VSS41
VSS42
VSS43
VSS44
VSS45
VSS46
VSS47
VSS48
VSS49
VSS50
VSS51
VSS
VSS53
VSS54
VSS55
VSS56
VSS57
VSS58
VSS59
VSS61
VSS62
VSS63
VSS64
VSS65
VSS66
VSS67
VSS68
VSS69
VSS70
VSS71
VSS72
VSS73
VSS74
VSS75
VSS240
VSS241
A3
A7
A9
A11
AA4
AA5
AA7
AA9
AA11
AA13
AA15
AA17
AA19
AA21
AA23
AB2
AB3
AB8
AB10
AB12
AB14
AB16
AB18
AB20
AB22
AC7
AC9
AC11
AC13
AC15
AC17
AC19
AC21
AC23
AD8
AD10
AD12
AD14
AD16
AD20
AD22
AD24
AE4
AE5
AE9
AE11
AF2
AF3
AF8
AF10
AF12
AF14
52
AF16
AF18
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AF22
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BC24
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738Thursday, July 06, 2006
of
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8
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D D
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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VDDQ
VDDQ
VDDQ
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VDDQ
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VDDQ
VDDQ
VDD
VDD
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VDD
VDD
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VDD
VDD
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VDD
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VDD
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3
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8
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9
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10
MDA4
122
MDA5
123
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128
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129
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12
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22
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132
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141
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31
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34
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159
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199
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206
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89
90
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227
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110
MDA57
111
MDA58
116
MDA59
117
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229
MDA61
230
MDA62
235
MDA63
236
5
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DQSA[0..7]
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4
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DQSA[0..7] <5,8>
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C122
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MEM_SMBCLK
MEM_SMBDATA
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DCLKB4
DCLKB4<5,10>
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-SRASB
-SRASB<5,8,10>
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-SWEB<5,8,10>
4
DDRII_4
2
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5
VSS
8
VSS
11
VSS
14
VSS
17
VSS
20
VSS
23
VSS
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VSS
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VSS
32
VSS
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VSS
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VSS
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VSS
44
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
94
VSS
97
VSS
100
VSS
103
VSS
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VSS
109
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
201
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDD
59
VDD
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VDD
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VDD
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178
VDD
189
VDD
67
VDD
18
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55
RC0
238
VDDSPD
1
VREF
120
SCL
119
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SA1
239
SA0
190
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171
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52
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A6
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A7
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A8
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A9
70
A10/AP
57
A11
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A12
196
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A16/BA2
74
CAS*
192
RSA*
73
WE*
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3
3
2
68
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102
NC/TEST
19
NC
77
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MODT_B1
195
ODT0
42
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43
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168
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7
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-DQSB0
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GIGABYTE
Title
Size Document Number Rev
Custom
Date: Shee t
2
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DQS8*
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DQS8
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45
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156
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236
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1
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of
938
1
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8
www.kythuatvitinh.com
7
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4
3
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D D
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-DCLKA3
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1.5p/4/NPO/16V/C
C58
1.5p/4/NPO/16V/C
C59
1.5p/4/NPO/16V/C
C60
1.5p/4/NPO/16V/C
C61
1.5p/4/NPO/16V/C
C1403
1.5p/4/NPO/16V/C
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MAAB2
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-SRASB
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-CSB0
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-CSB1
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MODT_B1
R152 47/4
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C73 22p/4/NPO/50V/J
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C72 22p/4/NPO/50V/J
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C76 22p/4/NPO/50V/J
MAAB4
C80 22p/4/NPO/50V/J
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C83 22p/4/NPO/50V/J
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MAAB8
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MAAB9
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MAAB10
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MAAB11
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-SWEB
-SWEB<5,8,9>
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-SRASB<5,8,9>
C67 22p/4/NPO/50V/J
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DCLKB2
DCLKB2<5,8>
C104
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-DCLKB2<5,8>
DCLKB1
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DCLKB0
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-DCLKB0
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-DCLKB5
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C105
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1.5p/4/NPO/16V/C
C120
1.5p/4/NPO/16V/C
SBAA[0:2]
-CSA[0:3]
CKEA[0:1]
MAAA[0..15]
MODT_A [0..1]
A A
8
7
6
SBAA[0:2] <5,8,9>
-CSA[0:3] <5,8,9>
CKEA[0:1] <5,8,9>
MAAA[0..15] <5,8,9>
MODT_A[0..1] <5,8,9>
5
4
MODT_B[0..1 ]
SBAB[0:2]
-CSB[0:3]
CKEB[0:1]
MAAB[0..15]
3
MODT_B[0..1] <5,8,9>
SBAB[0:2] <5,8,9>
-CSB[0 :3] <5,8,9>
CKEB[0:1] <5,8,9>
MAAB[0..15] <5,8,9>
Title
Size Document Number Re v
Custom
Date: Sheet
2
GIGABYTE
DDRII TERMINATOR
GA-M55plus-S3G
10 38Thursday, July 06, 2006
1
1.2
of
Gigabyte confidential
5
www.kythuatvitinh.com
L0_CADOUT_H[0..15]
D D
L0_CADOUT_L[0..15]<4>
L0_CADOUT _L[0..15]
N.B HEATSINK
1
NB_HS
1
C C
2
2
BGASINK_NB/[12S P2-04E004-A1R_12SP2-04E00 4-A2R_12SP2-04E004-A3R_12SP2-04E004-A4R]
BGASINK_NB/[12SP2-04F004-11_12SP2-04F004-12_12SP2-04F004-13]
1P2VPLL_PWR
FB4 0/6/SHT/X
FB use 30/6/200mA/S FB use 30/6/200mA/S
C93
0.1U/6/Y5V/25V/Z
B B
VCC12_HT
C92
0.1U/6/Y5V/25V/Z
L0_CLKOUT_H0<4>
L0_CLKOUT_L0<4>
L0_CLKOUT_H1<4>
L0_CLKOUT_L1<4>
L0_CTLOUT_H0<4>
L0_CTLOUT_L0<4>
R1797 150/4/1
R1798 150/4/1
VCC12_PLLHT
C94
1U/6/Y5V/10V/Z
4
L0_CADOUT_H0
L0_CADOUT_H1
L0_CADOUT_H2
L0_CADOUT_H3
L0_CADOUT_H4
L0_CADOUT_H5
L0_CADOUT_H6
L0_CADOUT_H7
L0_CADOUT_H8
L0_CADOUT_H9
L0_CADOUT_H10
L0_CADOUT_H11
L0_CADOUT_H12
L0_CADOUT_H13
L0_CADOUT_H14
L0_CADOUT_H15
L0_CADOUT_L0
L0_CADOUT_L1
L0_CADOUT_L2
L0_CADOUT_L3
L0_CADOUT_L4
L0_CADOUT_L5
L0_CADOUT_L6
L0_CADOUT_L7
L0_CADOUT_L8
L0_CADOUT_L9
L0_CADOUT_L10
L0_CADOUT_L11
L0_CADOUT_L12
L0_CADOUT_L13
L0_CADOUT_L14
L0_CADOUT_L15
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CTLOUT_H0
L0_CTLOUT_L0
HT_COMP1
HT_COMP2
BC15
10U/8/Y5V/10V/Z
BGA
U1F
Y23
HT_CPU_RXD0_P
W24
HT_CPU_RXD1_P
V24
HT_CPU_RXD2_P
U22
HT_CPU_RXD3_P
R24
HT_CPU_RXD4_P
P24
HT_CPU_RXD5_P
P22
HT_CPU_RXD6_P
N22
HT_CPU_RXD7_P
Y21
HT_CPU_RXD8_P
V21
HT_CPU_RXD9_P
W21
HT_CPU_RXD10_P
T21
HT_CPU_RXD11_P
R18
HT_CPU_RXD12_P
P16
HT_CPU_RXD13_P
N20
HT_CPU_RXD14_P
M17
HT_CPU_RXD15_P
Y22
HT_CPU_RXD0_N
W23
HT_CPU_RXD1_N
V23
HT_CPU_RXD2_N
U21
HT_CPU_RXD3_N
R23
HT_CPU_RXD4_N
P23
HT_CPU_RXD5_N
P21
HT_CPU_RXD6_N
N21
HT_CPU_RXD7_N
Y20
HT_CPU_RXD8_N
W20
HT_CPU_RXD9_N
W22
HT_CPU_RXD10_N
U20
HT_CPU_RXD11_N
R19
HT_CPU_RXD12_N
P17
HT_CPU_RXD13_N
N19
HT_CPU_RXD14_N
N18
HT_CPU_RXD15_N
T23
HT_CPU_RX_CLK0_P
T22
HT_CPU_RX_CLK0_N
R21
HT_CPU_RX_CLK1_P
R20
HT_CPU_RX_CLK1_N
M23
HT_CPU_RXCTL_P
M22
HT_CPU_RXCTL_N
W19
HT_CPU_CAL_1P2V
Y19
HT_CPU_CAL_GND
N16
+1.2V_PLLHTCPU
T13
+1.2V_PLLHTMCP
I105
C51G/NF6100N/A02/S/[10HB5-14C51G-00R]
C51
SEC 1 OF 6
3
HT_CPU_TXD0_P
HT_CPU_TXD1_P
HT_CPU_TXD2_P
HT_CPU_TXD3_P
HT_CPU_TXD4_P
HT_CPU_TXD5_P
HT_CPU_TXD6_P
HT_CPU_TXD7_P
HT_CPU_TXD8_P
HT_CPU_TXD9_P
HT_CPU_TXD10_P
HT_CPU_TXD11_P
HT_CPU_TXD12_P
HT_CPU_TXD13_P
HT_CPU_TXD14_P
HT_CPU_TXD15_P
HT_CPU_TXD0_N
HT_CPU_TXD1_N
HT_CPU_TXD2_N
HT_CPU_TXD3_N
HT_CPU_TXD4_N
HT_CPU_TXD5_N
HT_CPU_TXD6_N
HT_CPU_TXD7_N
HT_CPU_TXD8_N
HT_CPU_TXD9_N
HT_CPU_TXD10_N
HT_CPU_TXD11_N
HT_CPU_TXD12_N
HT_CPU_TXD13_N
HT_CPU_TXD14_N
HT_CPU_TXD15_N
HT_CPU_TX_CLK0_P
HT_CPU_TX_CLK0_N
HT_CPU_TX_CLK1_P
HT_CPU_TX_CLK1_N
HT_CPU_TXCTL_P
HT_CPU_TXCTL_N
CLKOUT_PRI_200MHZ_P
CLKOUT_PRI_200MHZ_N
CLKOUT_SEC_200MHZ_P
CLKOUT_SEC_200MHZ_N
HT_CPU_REQ*
HT_CPU_STOP*
HT_CPU_RESET*
HT_CPU_PWRGD
+2.5V_PLLHTCPU
C23
D23
E22
F23
H22
J21
K21
K23
D21
F19
F21
G20
J19
L17
L20
L18
C24
D24
E23
F24
H23
J22
K22
K24
D22
E20
E21
G19
J18
K17
K19
?
L19
G23
G24
G22
G21
L23
L24
B24
B23
A22
B21
F18
G18
D20
E19
L16
L0_CADIN_H0
L0_CADIN_H1
L0_CADIN_H2
L0_CADIN_H3
L0_CADIN_H4
L0_CADIN_H5
L0_CADIN_H6
L0_CADIN_H7
L0_CADIN_H8
L0_CADIN_H9
L0_CADIN_H10
L0_CADIN_H11
L0_CADIN_H12
L0_CADIN_H13
L0_CADIN_H14
L0_CADIN_H15
L0_CADIN_L0
L0_CADIN_L1
L0_CADIN_L2
L0_CADIN_L3
L0_CADIN_L4
L0_CADIN_L5
L0_CADIN_L6
L0_CADIN_L7
L0_CADIN_L8
L0_CADIN_L9
L0_CADI N_L10
L0_CADI N_L11
L0_CADI N_L12
L0_CADI N_L13
L0_CADI N_L14
L0_CADI N_L15
L0_CLKIN_H0
L0_CLKIN_L0
L0_CLKIN_H1
L0_CLKIN_L1
L0_CTLIN_H0
L0_CTLIN_L0
CPUCLK0_H
CPUCLK0_L
TP_CPUCLK_SEN_H
TP_CPUCLK_SEN_L
-HT_REQ
-HTSTOP_L
-CPURST
CPU_PWRGD
25V_PLLHTCPU
BC677
0.1U/6/Y5V/25V/Z
1
TP7
1
TP28
R1796 8.2K/4/X
BC678
1U/6/Y5V/10V/Z
2
L0_CAD IN_H[0..15]
L0_CADIN_L [0..15]
L0_CLKIN_H0 <4>
L0_CLKIN_L0 <4>
L0_CLKIN_H1 <4>
L0_CLKIN_L1 <4>
L0_CTLIN_H0 <4>
L0_CTLIN_L0 <4>
CPUCLK0_H <6>
CPUCLK0_L <6>
VCC3
-HTSTOP_L <6>
-CPURST <6>
CPU_PWRGD <6>
FB39 0/6/SHT/X
L0_CADIN_H[0..15] <4>L0_CADOUT_H[0..15]<4>
L0_CADIN_L[0 ..15] <4>
2P5V_PWR
BC679
0.1U/6/Y5V/25V/Z
1
COUPON1
COUPON2
A A
5
4
COUPON1 COUPON/X
COUPON2 COUPON/X
3
21
21
VCC12_HT
Title
Size Document Number Re v
Custom
2
Date: Sheet
GIGABYTE
C51-HOST
GA-M55plus-S3G
1
11 38Thursday, July 06, 2006
1.2
of
Gigabyte confidential
5
www.kythuatvitinh.com
D D
HTMCP _UP[0..7]
C C
-HTMC P_UP[0..7]
B B
HTMCP _UP[0..7] <16>
-HTMCP_UP[0..7] <16>
HTMCP_UPCLK0<16>
-HTMCP_UPCLK0<16>
HTMCP_UPCNTL<16>
-HTMCP_UPCNTL<16>
-HTMCP_REQ<16>
-HTMCP_STO P<16>
-HTMCP_RST<16>
-HTMCP_PWRGD<6,16>
MCPOUT_25MHZ<16>
MCPOUT_200MHZ<16>
-MCPOUT_200MHZ<16>
4
HTMCP_UP0
HTMCP_UP1
HTMCP_UP2
HTMCP_UP3
HTMCP_UP4
HTMCP_UP5
HTMCP_UP6
HTMCP_UP7
-HTMCP_UP0
-HTMCP_UP1
-HTMCP_UP2
-HTMCP_UP3
-HTMCP_UP4
-HTMCP_UP5
-HTMCP_UP6
-HTMCP_UP7
HTMCP_UPCLK0
-HTMCP_UPCLK0
HTMCP_UPCNTL
-HTMCP_UPCNTL
-HTMCP_REQ
-HTMCP_STO P
-HTMCP_RST
HTMCP_PWRGD
MCPOUT_25MHZ
MCPOUT_200MHZ
-MCPOUT_200MHZ
AD10
AD11
AC12
AC13
AA11
AC10
AC11
AB12
AB13
AD14
AC14
AD6
AC7
AA8
AA9
AA6
Y10
V11
W12
AC6
AB7
AB8
AB9
AA7
W10
Y12
W11
V13
AD9
AC9
U10
T10
AB5
AA5
AC5
AD5
AC4
W7
Y8
V9
Y6
Y7
W9
Y5
W5
BGA
U1A
HT_MCP_RXD0_P
HT_MCP_RXD1_P
HT_MCP_RXD2_P
HT_MCP_RXD3_P
HT_MCP_RXD4_P
HT_MCP_RXD5_P
HT_MCP_RXD6_P
HT_MCP_RXD7_P
HT_MCP_RXD8_P
HT_MCP_RXD9_P
HT_MCP_RXD10_P
HT_MCP_RXD11_P
HT_MCP_RXD12_P
HT_MCP_RXD13_P
HT_MCP_RXD14_P
HT_MCP_RXD15_P
HT_MCP_RXD0_N
HT_MCP_RXD1_N
HT_MCP_RXD2_N
HT_MCP_RXD3_N
HT_MCP_RXD4_N
HT_MCP_RXD5_N
HT_MCP_RXD6_N
HT_MCP_RXD7_N
HT_MCP_RXD8_N
HT_MCP_RXD9_N
HT_MCP_RXD10_N
HT_MCP_RXD11_N
HT_MCP_RXD12_N
HT_MCP_RXD13_N
HT_MCP_RXD14_N
HT_MCP_RXD15_N
HT_MCP_RX_CLK0_P
HT_MCP_RX_CLK0_N
HT_MCP_RX_CLK1_P
HT_MCP_RX_CLK1_N
HT_MCP_RXCTL_P
HT_MCP_RXCTL_N
HT_MCP_REQ*
HT_MCP_STOP*
HT_MCP_RESET*
HT_MCP_PWRGD
CLKIN_25MHZ
CLKIN_200MHZ_P
CLKIN_200MHZ_N
I164
3
C51
SEC 2 OF 6
C51G/NF6100N/A02/S/[10HB5-14C51G-00R]
HT_MCP_TXD0_P
HT_MCP_TXD1_P
HT_MCP_TXD2_P
HT_MCP_TXD3_P
HT_MCP_TXD4_P
HT_MCP_TXD5_P
HT_MCP_TXD6_P
HT_MCP_TXD7_P
HT_MCP_TXD8_P
HT_MCP_TXD9_P
HT_MCP_TXD10_P
HT_MCP_TXD11_P
HT_MCP_TXD12_P
HT_MCP_TXD13_P
HT_MCP_TXD14_P
HT_MCP_TXD15_P
HT_MCP_TXD0_N
HT_MCP_TXD1_N
HT_MCP_TXD2_N
HT_MCP_TXD3_N
HT_MCP_TXD4_N
HT_MCP_TXD5_N
HT_MCP_TXD6_N
HT_MCP_TXD7_N
HT_MCP_TXD8_N
HT_MCP_TXD9_N
HT_MCP_TXD10_N
HT_MCP_TXD11_N
HT_MCP_TXD12_N
HT_MCP_TXD13_N
HT_MCP_TXD14_N
HT_MCP_TXD15_N
HT_MCP_TX_CLK0_P
HT_MCP_TX_CLK0_N
HT_MCP_TX_CLK1_P
HT_MCP_TX_CLK1_N
HT_MCP_TXCTL_P
HT_MCP_TXCTL_N
CLKOUT_CTERM
SCLKIN_MCLKOUT_200MHZ_P
SCLKIN_MCLKOUT_200MHZ_N
HT_MCP_CAL_1P2V
HT_MCP_CAL_GND
AC24
AD23
AC22
AC20
AB18
AA17
AB16
AC16
AB21
AB20
AB19
W18
W15
AA15
Y14
W13
AC23
AD22
AC21
AD20
AC18
AB17
AB15
AD16
AB22
AA20
AA19
V17
V15
Y15
W14
Y13
AC19
AD19
Y17
W17
AC15
AD15
B22
A20
B20
AB23
AB24
HTMCP_DOWN0
HTMCP_DOWN1
HTMCP_DOWN2
HTMCP_DOWN3
HTMCP_DOWN4
HTMCP_DOWN5
HTMCP_DOWN6
HTMCP_DOWN7
-HTMCP_DOWN0
-HTMCP_DOWN1
-HTMCP_DOWN2
-HTMCP_DOWN3
-HTMCP_DOWN4
-HTMCP_DOWN5
-HTMCP_DOWN6
-HTMCP_DOWN7
HTMCP_DWNCLK0
-HTMCP_DWNCLK0
HTMCP_DWNCNTL
-HTMCP_DWNCNTL
CLKOUT_CTERM
HTMCPCAL_1P2V
HTMCPCAL_GND
HTMCP_DWNCLK0 <16>
-HTMCP_DWNCLK0 <16>
HTMCP_DWNCNTL <16>
-HTMCP_DWNCNTL <16>
R2113 2.37K/4/1
R2114 1 50/4/1
R2115 1 50/4/1
2
HTMCP_DOWN[0..7]
-HTMCP_DOWN[0..7]
VCC12
1
HTMCP _DOWN[0..7] <16>
-HTMCP_DOWN[0..7] <16>
A A
GIGABYTE
Title
Size Document Number Re v
Custom
5
4
3
2
Date: Sheet
C51-HT BUS
GA-M55plus-S3G
1
12 38Thursday, July 06, 2006
1.2
of
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