1-DESCRIÇÃO GERAL DO PROCESSADOR DO SISTEMA ................................................................................................... 3
2-DIAGRAMA DE BLOCOS ................................................................................................................................................. 6
3-DIAGRAMAS DE CIRCUITOS............................................................................................................................................ 7
4-LAY-OUT DAS PLACAS DE CIRCUITO IMPRESSO ........................................................................................................... 21
5-PINAGEM DOS PRINCIPAIS COMPONENTES ................................................................................................................ 25
6-FORMAS DE ONDA ........................................................................................................................................................ 42
8-LISTA DE COMPONENTES............................................................................................................................................... 46
CUIDADO ! COMPONENTES SENSÍVEIS A DESCARGAS ELETROSTÁTICAS
Alguns semicondutores (estado sólido) podem ser facilmente danificados pela eletricidade estática. Tais
componentes são comumente chamados de “componentes sensíveis eletrostaticamente”
Sensitive Devices - ESD)
e
chips
semicondutores. As técnicas a seguir devem ser utilizadas para ajudar a reduzir a incidência de danos
aos componentes causados por eletricidade estática.
1. Mantenha o componente em sua embalagem original até o momento de sua utilização. Se necessário
armazená-lo de outro modo, acondicione-o exclusivamente em material anti-estático.
2. Prepare uma estação de trabalho anti-estática para manuseio da placa montada e/ou componente
2.1. Disponha de uma manta dissipativa sobre a bancada/mesa de trabalho.
2.2. Providencie uma pulseira para descarga de eletricidade estática disponível no comércio.
Efetue diariamente a aferição da pulseira.
2.3. Aterre ambos, manta e pulseira, a uma malha reconhecidamente aterrada.
2.4. Disponha todo o material necessário ao trabalho sobre a manta; minimize os movimentos.
No momento em que for manusear a placa/componente, coloque a pulseira.
Assegure-se de que não haja qualquer potencial que seja aplicado ao chassi ou circuito bem como
retire a pulseira antes de energizar a unidade sob teste/reparo a fim de evitar riscos de choque elétrico.
3. Use somente ferros-de-soldar com a ponta aterrada para soldar ou retirar componentes sensíveis à
eletrostática.
4. Não utilize produtos químicos cujo propelente usado seja freon. Eles podem gerar cargas elétricas suficientes
para danificar componentes
. Exemplos típicos de
ESD
.
ESD’s
são os circuitos integrados, transistores de efeito de campo
IMPORTANTE !
(Electrostatically
ESD
:
2
Page 3
1- DESCRIÇÃO GERAL DO PROCESSADOR DO SISTEMA
1.1- Descrição geral
O MT8105DE/DO da Media Tek é um sistema em
chip (SOC) Codec MPEG que incorpora recursos
avançados, como o decodificador de vídeo
MPEG-2/4, codificador de vídeo MPEG-2/4, DV
Codec, decodificador de TV, codificador de TV
de alta definição, USB, 1394, interface de cartão
de memória versátil, e processamento de
desentrelaçamento de última geração. O MT8105
possibilita aos fabricantes de equipamentos
eletrônicos de consumo construir gravadores de
DVD econômicos e de alta qualidade, gravadores
de vídeo digitais (DVR) ou quaisquer outros
dispositivos de áudio/vídeo de entretenimento
para uso doméstico.
Proporcionando o recurso de gravação e
reprodução simultâneas, o MT8105 fornece
facilmente a função time-shift aos produtos finais.
O MT8105 também suporta drive IDE dual,
incluindo HDD, DVD-ROM, DVD+R/RW, DVD-R/RW
e DVD-RAM. Com tal flexibilidade, os fabricantes
de produtos eletrônicos de consumo podem
produzir diferentes produtos com base na mesma
experiência.
Com a controladora embutida 1394, o MT8105
pode controlar os dispositivos 1394, como DV, e
grava o conteúdo para DVD ou HDD. O MT8105
também fornece interface “glueless”
(incorporada) para Compact Flash, Memory-Stick
e Secure Disk, usada no intercâmbio de dados
com outros dispositivos. Além disso, o MT8105
suporta a USB OTG (on-the-go) para atender
futuras necessidades de conectividade, tais
como modem ou WLAN. Tudo isso torna o MT8105
adequado para os servidores de mídia
doméstica.
Para enriquecer o recurso de reprodução, o
MT8105 equipa um decodificador de vídeo MPEG4, suportando o perfil simples avançado (ASP) do
MPEG-4/DivX1. Torna os produtos baseados no
MT8105 capazes de reproduzir o conteúdo de
MPEG-4 que se torna cada vez mais popular.
A varredura progressiva do MT8105 utiliza o
avançado algoritmo de desentrelaçamento
adaptável ao movimento MDDi™ da Media Tek
para obter a melhor reprodução de filmes e
vídeos. Pode detectar facilmente a fonte de pulldown 3:2/2:2 e restaurar as imagens originais
corretas. Suporta ainda o algoritmo preservador
de bordas, atualmente em processo de
patenteamento, para remover o efeito dente de
serra.
Principais características
•MPEG-2(4) Codec
•DV Codec
•Decodificador de TV 4 canais, 10 bits/27MHz
•Camada de link 1394
•USB OTG
•E/S Direta de Compact Flash, Memory Stick, e
Secure Digital
•Desentrelaçamento de Preservação de Bordas,
Adaptável ao Movimento
•Codificador de TV 6 Canais, 108MHz/12 bits
Aplicações
•Gravadores de DVD autônomos
•Gravadores combinados HDD/DVD
•Servidores de Mídia Doméstica
(*) Algumas das funções descritas não são aplicáveis ao modelo SD RX38D.
3
Page 4
1.2- Lista de Características Gerais
DVD player com super-integração usando um único
chip
• Vídeo MPEG-1/MPEG-2/JPEG
• Vídeo MPEG-4 ASP
• Dolby AC-3/DTS/DVD-Áudio
• Interface para USB/CF/MS/SD
• Escalagem e aprimoramento da qualidade do DVD
• OSD & Subimagem
• Acelerador Gráfico 2-D
• Gerador de clock embutido
• Decodificador de TV embutido de alta qualidade
• Codificador de TV embutido de alta qualidade
• Processador embutido de vídeo progressivo
• Pós-processador de efeitos de áudio
• Clock de Tempo Real
• RISC de 32 bits embutido, Cache/M MU/InstructionRAM suportada
• Suporta resolução de movimento half pel
Decodificador de TV
• Suporta 4 entradas de vídeo analógicas (4 CVBS ou 2
CVBS e 1 Vídeo S)
Alimentação/Terra
64,128, 189,195,199,23AVDD3AlimentaçãoAlimentação Analógica 3,3V
3, 235, 240, 249, 251
65,129, 138,193,197,201,AVSSTerraTerra analógico
234, 236, 239, 250,252
137AVDD18AlimentaçãoAlimentação analógica1,8V
10,19,35, 52,68,DVDD3AlimentaçãoTensão de E/S Digital 3,3V
85, 222
11, 29, 42, 56, 82, 215DVSS3TerraTerra digital
103,112,119,132,147,159,DVDD2AlimentaçãoTensão de E/S Digital de 2,5V para DDR
169, 179,188Tensão de E/S Digital de 3,3V para SDR
106,115,124,140,150,164,DVSS2Terra Terra Digital
174, 184
9,39,61, 73,109, 136,166,DVDD18AlimentaçãoAlimentação digital para circuito interno
219,228
22,50,90,122,154,181,DVSS18TerraAlimentação digital para circuito interno
211,225
232VDDAUXAlimentaçãoAlimentação aux para RTC
229VSSAUXTerraAlimentação aux para RTC
Interface de Áudio
213AOMCLKE/SClock mestre da saída do áudio
2 ~ 16 mA
210AOLRCKO, SRClock esquerdo da saída do áudio
2 mA
212AOBCKE/S, SRClock do bit da saída de áudio
2 ~ 16 mA
209AOSDATA0E/SFunção múltipla
2 mA(1) Linha de dados da saída de áudio 0
(2) GPIO
208AOSDATA1E/SFunção múltipla
2 mA(1) Linha de dados da saída de áudio 1
(2) GPIO
207AOSDATA2E/SFunção múltipla
2 mA(1) Linha de dados da saída de áudio 2
(2) GPIO
26
Page 27
PinoSímboloTipoDescrição
206AOSDATA3E/SFunção múltipla:
2 mA(1) Linha de dados da saída de áudio 3
(2) VSYN
(3) GPIO
205AOSDATA4E/SFunção múltipla:
2 mA(1) Linha de dados da saída de áudio 4
(2) HSYN_
(3) GPIO
214MCINE/SFunção múltipla:
2 mA(1) Microfone - Entrada
(2) GPIO
216PDIFO, SRAudio Digital - Saída
2 ~ 16 mA
221SPMCLKE/SFunção múltipla:
2 ~ 16 mA(1) Clock mestre do SPDIF
(2) MSCLK
3) EXTRD_
(4) GPIO
220SPLRCKE/SFunção múltipla:
2 ~ 16 mA(1) Clock dos canais esquerdo-direito SPDIF
(2) SDCLK
(3) EXTWR_
(4) GPIO
217SPBCKE/S, (PU)Função múltipla:
2 ~ 16 mA(1) Clock de bit SPDIF
(2) VSYN_
(3) FCCTL
(4) EXTINT_
(5) GPIO
218SPSDATAE/S (PU/PD)Função múltipla:
2 ~ 16 mA(1) Linha de dados SPDIF
(2) HSYN_
(3) FCDATA
(4) GPIO
223ARBCKE/S, SRClock de bit de entrada da gravação de áudio
2 ~ 16 mA
224ARMCLKE/S, SRClock mestre de entrada da gravação de áudio
2 ~ 16 mA
226ARLRCKE/S, SRClock esquerdo/direito da entrada da gravação
2 mAde áudio
227ARSDATAE/S, SRDados seriais da entrada de gravação de áudio
2mA
Interface de Vídeo
204YUV7E/SFunção múltipla:
2 mA(1) YUV bit de dados 7
(2) GPIO
203YUV6/RE/SFunção múltipla :
(1) Saída - Vermelho
(2) YUV bit de dados 6
202YUV5/BE/SFunção múltipla:
(1) Saída - Azul
(2) YUV bit de dados 5
200YUV4/GE/SFunção múltipla :
(1) Saída - Verde
(2) YUV bit de dados 4
198YUV3/CVBSE/SFunção múltipla :
(1) Composto - Saída
(2) YUV bit de dados 3
27
Page 28
PinoSímboloTipoDescrição
196YUV2/CE/SFunção múltipla:
(1) Chroma - Saída
(2) YUV bit de dados 2
194YUV1/YE/SFunção múltipla:
(1) Luminância - Saída
(2) YUV bit de dados 1
192YUV0/CINE/SFunção múltipla :
(1)
(2) YUV bit de dados 0
191FSE/SResistor externo para ajuste de escala plena do DAC de vídeo
190VREFE/SCapacitor de desacoplamento para tensão de referência interna do
DAC de vídeo
242
243
244
256VY0EFunção múltipla :
254VY1EFunção múltipla :
248VY2EFunção múltipla :
246VCEFunção múltipla:
241EXTTVD0EFunção múltipla :
245EXTTVD1EFunção múltipla:
253EXTTVD2EFunção múltipla :
255EXTTVD3EFunção múltipla :
247TPEFunção múltipla:
21FCE_E/S,Seleção de chip de Flash
20FOE_E/S,Saída de flash - habilitação
4FWR_E/S,Flash - write
18FD0E/S,Bit 0 do barramento de dados Flash
17FD1E/S,Bit 1 do barramento de dados Flash
16FD2E/S,Bit 2 do barramento de dados Flash
15FD3E/S,Bit 3 do barramento de dados Flash
14FD4E/S,Bit 4 do barramento de dados Flash
13FD5E/S,Bit 5 do barramento de dados flash 5
12FD6E/S,Bit 6 do barramento de dados flash 6
VREFP
VREFN
VCM
E/STensão de referência positiva para ADC de vídeo
E/STensão de referência negativa para ADC de vídeo
E/STensão de referência de modo comum para ADC de vídeo
(1) Luminância - Entrada - Canal 0
(2) entrada do CCIR externo (bit 3)
(1) Luminância - Entrada - Canal 1
(2) entrada do CCIR externo (bit 5)
(1) Luminância - Entrada - Canal 2
(2) entrada do CCIR externo (bit 7)
(1) Chroma - Entrada
(2) entrada do CCIR externo (bit2)
(1) Clock do CCIR externo
(1) entrada do CCIR externo (bit 0)
(1) entrada do CCIR externo (bit 4)
(1) entrada do CCIR externo (bit 6)
(1) Ponto de teste analógico
(2) entrada do CCIR externo (bit 1)
Interface para Flash
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
2 ~ 16 mA
28
Page 29
PinoSímboloTipoDescrição
10FD7E/S,Bit 7 do barramento de dados flash 7
2 ~ 16 mA
1FA16E/S,Função múltipla:
2 ~ 16 mA(1) Bit 16 do barramento de endereços Flash
(2) ALE Baixa para extensão de Flash E373/E/S
(3) Valor de interrupção na reinicialização
1: Modo ICE
0: Modo Não-ICE
8FA17E/S,Função múltipla:
2 ~ 16 mA(1) Bit 17 do barramento de endereços Flash
(2) ALE Média para extensão de Flash E373/E/S
(3) Valor de interrupção na reinicialização
1: Bit 0 do modo de teste
0: Modo normal
7FA18E/S,Função múltipla:
2 ~ 16 mA(1) Bit 18 do barramento de endereços Flash
(2) ALE Alto para Flash E373
(3) Valor de interrupção na reinicialização
1: bit 1 do modo de teste
0: Modo normal
6FA19E/S,Função múltipla:
2 ~ 16 mA(1) Bit 19 do barramento de endereços Flash 19
(2) RD da extensão de E/S
(3) GPIO
(4) Valor de interrupção na reinicialização
2FA20E/S,Função múltipla:
2 ~ 16 mA(1) Bit 20 do barramento de endereços Flash
(2) WR da extensão de E/S
(3) GPIO
(4) Valor de interrupção na reinicialização
1: Flash E373
0: Compartilhamento de Flash a ATA
3FA21E/S,Função múltipla:
2 ~ 16 mA(1) Bit 21 do barramento de Flash
(2) HSYN_
(3) GPIO
5FA22E/S,Função múltipla:
2 ~ 16 mA(1) Bit 21 do barramento de endereço de Flash
(2) TXD
(3) Entrada da linha de áudio
(4) GPIO
MISC
92RESET_E,Reinicialização
PU, SMT
238XTALIECristal de 27M - Entrada
237XTALOSCristal de 27M - Saída
91IVE/SFunção múltipla:
2 mA(1) infravermelho - Entrada
(2) GPIO
81SCLE/S,Função múltipla:
2 mA(1) linha de controle da interface serial
(2) GPIO
80SDAE/S,Função múltipla:
2 mA(1) linha de controle da interface serial
(2) GPIO
89VCLKE/S, PUFunção múltipla :
2 mA(1) Clock de VFD
(2) GPIO
88VDATAE/S, PUFunção múltipla :
2 mA(1) Dados de VFD
(2) GPIO
29
Page 30
PinoSímboloTipoDescrição
87VSTBE/S, PUFunção múltipla :
2 mA(1) VFD strobe
(2) GPIO
86LCDRDE/S,Função múltipla :
2 mA(1) VFD strobe
(2) RXD
(3) Entrada da linha de áudio
(4) GPIO
231RTCXIECristal de 32,768K - Entrada
230RTCXOSCristal de 32,768K - Saída
Interface do 1394
75PHYD0E/S,Função múltipla :
2 ~ 16 mA(1) Bit 0 do barramento de dados 1394
(2) MSCLK
(3) GPIO
74PHYD1E/S,Função múltipla :
2 ~ 16 mA(1) Bit 1 do barramento de dados 1394
(2) MSBS
(3) GPIO
72PHYDE/S (PD),Função múltipla :
2 ~ 16 mA(1) Bit 2 do barramento de dados 1394
(2) MSSDIO
(3) GPIO
71PHYD3E/S (PU),Função múltipla :
2 ~ 16 mA(1) Bit 3 do barramento de dados 1394
(2) SDCLK
(3) GPIO
70PHYD4E/S (PU) ,Função múltipla
30
Page 31
5.2- Transceptor IEEE 1394 - MT8162 (U601)
Pinagem
DGND_IO
DGND
LREQ
48
DVDD
47
46
45
44XO43XI42
DVDD_IO
PLLVDD
PLLGND
41
ATE ST N
RESET_B
ATESTP
40
39
38
37
SCLK1
CTL02
CTL13
D04
D15
D2/GPIO06
D3/GPIO17
D4/GPIO28
D5/GPIO39
D6/GPIO410
D7/GPIO511
PD12
13
LPS
14
15
DGND
C/LINKON
MT8162
PC0/GPIO716PC1/GPIO817PC2/GPIO9
MT8162
TRANSCEPTOR DE CABO PARA UMA PORTA IEEE 1394a2000
MediaTek MT 8162 fornece a função de transceptor
para nó de uma porta em uma rede de cabo I EEE 1394a2000 incorporando um transceptor diferencial. O MT8162
suporta taxas de dados de velocidades S100, S200, e
S400. Foi projetado para fazer a interface com uma
controladora de camadas LLC. A largura do barramento
de dados da interface de LLC aumenta com a
velocidade do barramento serial - dois sinais suportam
velocidades de até 100 Mbit/s, enquanto, a velocidades
maiores, um total de dois sinais por 100 Mbit/s é
necessário. A taxa de clock dos sinais nesta interface
permanece constante em 49,152 MHz, independentemente da velocidade do barramento serial.
Durante a transmissão, os dados recebidos do LLC ficam
definidos pelo clock do sistema 49,152 MHz e são
serializados, codificados e transmitidos a 98, 304, 196,
608, ou 393, 216 Mbits/s (modo S100, S200, S400,
respectivamente). Os dados codificados são transmitidos pelo par de cabos diferenciais, e a amostragem
codificada é transmitida pelo par de cabos diferenciais
TPA. Durante a recepção, os dados são recebidos no
TPA, e a seleção é recebida no TPB. A amostragem dos
dados recebidos é decodificada para recuperar o clock
e dados seriais. Os dados seriais são combinados em
duas, quatro ou oito correntes de bits paralelas (depende
da velocidade de recepção), resincronizadas para o
clock do sistema de 49,152 MHz e enviadas ao LLC.
AGND36
AVD D35
VREF34
ATEST33
AGND32
TPBIAS31
TPA+30
TPA-29
TPB+28
TPB-27
AGND26
AVD D25
18
19
20
21
22
24
CPS
DVDD
DIRECT
TESTM_B
TEST_M0/GPIO1223TEST_M1/GPIO13
Características
• Atende às especificações da IEEE1394a-2000
• Velocidades de dados de 100, 200, 400 Mbps
• Interoperável com IEEE1394-1995 PHY e liga dispositivos
de camadas
• Suporta concatenação mutivelocidade
• Suporta reset de barramento arbitrado
• Melhoria da arbitração
• Suporta arbitração com ACK acelerado
• Atende às exigências da OHC (Open Host Controller)
• Contender programável do reset e bits de classe de
potência
• Suporta concatenação “fly-by”
• Suporta o pacote de ping PHY
• Gerenciamentos avançados de energia conforme
especificado na IEEE1394a-2000
• Suporta novos estados de porta, desabilitados e
suspensos para economizar energia
• Suporta pacote de comandos remotos para
suspender, reiniciar, desabilitar e habilitar outra porta
do PHY
• Gerenciamento de energia adicional através do PD
(desativação do chip)
• Suporta a conexão direta ou de barreira de isolação
com o o LLC
• Operação simples com fonte de alimentação de 3,3V
• Cristal de baixo custo de 24,576 MHz
• Encapsulamento LQFP de 48 pinos e baixo custo
31
Page 32
DESCRIÇÃO DOS PINOS - MT8162
Nº do PinoSímboloTipoDescrição
1 SCLKSClock do Sistema
2-3CTL0E/SLinhas de Controle. Os sinais controlam a comunicação entre os LLC.
CTL1Os suportes de barramento são construídos para esses sinais.
4-11D0E/SLinhas de dados. Sinais de dados entre o MT8162 e o LLC. Os suportes de
D1barramento são construídos para esses sinais.
D2/GPIO0D2~D3 podem ser usados como GPIOs no modo S100 e D4~D5 podem ser usados
D3/GPIO1como GPIOs no modo S100/S200. Os GPIOs são controlados pelos registros GPIO_O,
D4/GPIO2GPIO_I, e GPIO_OE.
D5/GPIO3
D6/GPIO4
D7/GPIO5
12PDESinal de Ultra power-down. Todo o circuito interno, exceto os monitores ativados
por cabo se desliga declarando a entrada PD.
13LPSEStatus de Potência do Link. Indica que o link está ativo e funcional Quando o MT8162
detecta que a entrada de LPS permanece baixa por mais de 25,6us, a interface
do LLC é colocada no estado de baixa potência e a saída do SCLK fica inativa
14,47DGNDTerra digital
15C/LINKONE/SAo reinicializar, o valor fica definido como a entrada do contender. Após a
reinicialização, o pino funciona como o sinal LinkOn. Ele sinaliza a ocorrência do
evento link-on. A frequência deste sinal é 6MHz.
16-18PC0/GPIO7E/SEntradas da programação classe potência. Esses sinais estabelecem a classe de
PC1/GPIO8potência default do PHY na reinicialização. Após a reinicialização, esses terminais
PC2/GPIO9podem ser usados como GPIOs controlados pelos registros.
19DIRETOEControle de isolação da interface do link. O sinal se eleva para desativar as saídas
do diferenciador para o sinais de CTLO, CTL1, D0~D7, e LREQ.
20CPSEEntrada do status da energia do cabo. Este terminal é normalmente ligado ao
cabo de tensão através de um resistor de 400K. Ele ativa um comparador interno
usado para detectar a situação da tensão do cabo.
21,45DVDDVDDAlimentação do circuito digital.
22TESTEN_BESinal de habilitação do modo de teste. Usado no teste de fabricação.É um sinal
baixo ativo. Para operação normal, este sinal deve ser ligado como alto
23-24TEST_M0/E/SSeleção do modo de teste. Esses sinais são usados no teste de fabricação.
GPIO12Os sinais colocam o modo de teste do MT8162 em ativação mediante
TEST_M1/reinicialização. Para a operação normal, ambos ficam ligados ao terra através de
GPIO13resistores de 10K e podem ser usados como GPIO controlados por registradores
25, 35AVDDVDD Alimentação do circuito analógico.
26, 36AGNDGND Terra do circuito analógico.
27TPB-E/SPar diferencial trançado B
28TPBE/S
29TPA-E/SPar diferencial trançado A
30TPA+E/S
31TPBIASE/SSaída polarizada de par trançado. Este sinal fornece a tensão polarizada nominal
de 1,86V necessária para a operação adequada do transceptor de cabo de par
trançado.
32AGNDGND Terra do circuito analógico.
33ATESTE/STerminal de teste analógico. Este sinal é usado no teste de fabricação.
34VREFE/SEntrada de tensão de referência analógica.
37RESET_BEReinicialização. E um sinal baixo ativo.
38,39ATESTNE/STerminal de teste analógico
ATESTP
40PLLVDDVDD Alimentação do Circuito PLL
41PLLGNDDNG Terra do circuito PLL
42XIE/SEntradas dos cristais. Esses terminais se ligam a um cristal de modo resonante
43paralelo de 24,576 MHz
44DVDD_IOVDD Alimentação de E/S Digital
46DGND_IODNG Terra da E/S Digital
48LREQESolicitação de link. O LLC usa este sinal para indicar uma solicitação de serviço ao
MT8162. O suporte do barramento fica embutido.
32
Page 33
5.3- Memória DDR SDRAM (U6)
Pinagem
Tabela de endereços de linhas e colunas
ITENS64Mx432Mx816Mx16
OrganizaçãoBancos de 16M x 4 x 4Bancos de 8M x 8 x 4Bancos de 4M x 16 x 4
Endereço de LinhasA0 - A12A0 - A12A0 - A12
Endereço de ColunasA0-A9, A11A0-A9A0-A8
Endereço do BancoBA0, BA1BA0, BA1BA0, BA1
Sinalizador de
Pré-carga AutomáticoA10A10A10
Atualização8K8K8K
33
Page 34
Descrição dos Pinos
PINOTIPODESCRIÇÃO
CK, /CKEntradaClock: CK e /CK são entradas de clock diferenciais. Todos os sinais de entrada de
controle e endereço são amostrados no cruzamento da borda positiva do CK e
borda negativo do /CK. Dados de saída (read) são encaminhados aos cruzamentos
de CK e /CK (ambas as direções do cruzamento).
CKEEntradaAtivação do Clock: CKE HIGH ativo, e CKE LOW desativa os sinais do clock interno, e
os buffers de entrada do dispositivo e drivers da saída. O uso do CKE LOW desativa
a PRÉ-CARGA e a operação de AUTO-ATUALIZAÇÃO (SELF REFRESH) (todos os bancos
em repouso), ou DESATIVAÇÃO ATIVA (ACTIVE POWER DOWN) (linha ATIVA em qualquer
banco). CKE é síncrono para a entrada e saída da desativação (POWER DOWN), e
para a entrada de auto-atualização (SELF REFRESH). CKE é síncrono para a saída de
auto-atualização (SELF REFRESH), e para desativação de saída. CKE deve ser mantido
alto no decorrer dos acessos de READ e WRITE. Buffers de entrada, excluindo CK, /CK
e CKE são desativadas durante a desativação (POWER DOWN). Buffers de entrada,
excluindo CKE, são desativados durante a auto-atualização (SELF REFRESH). CKE é
uma entrada SSTL_2, mas irá detectar um nível LVCMOS LOW após o VDD ser
aplicado.
/CSEntradaSeleção de Chip: Habilita ou desabilita todas as entradas, exceto CK, /CK, CKE, DQS
e DM. Todos os comandos são mascarados quando CS for registrado alto. CS
proporciona a seleção de bancos externos em sistemas com bancos múltiplos. CS é
considerado parte do código de comando.
BA0, BA1EntradaEntradas dos Endereços dos Bancos BA0 e BA1 definem para qual banco está sendo
aplicado um comando ACTIVE, Read, Write ou PRECHARGE.
A0 ~ A12EntradaEntradas de Endereços: Forneça o endereço da linha para os comandos ACTIVE, e
o bit de AUTO PRECHARGE e endereço de coluna para os comandos READ/WRITE e
selecione um local da memória no banco respectivo. A10 é amostrado durante um
comando de pré-carga para determinar se a pré-carga (PRECHARGE) se aplica a
um banco (A10 LOW) ou todos os bancos (A10 HIGH). Se apenas um banco tiver de
ser pré-carregado, o banco será selecionado por BA0, BA1. As entradas de
endereço também fornecem o código de operação durante um comando MODE
REGISTER SET. BA0 e BA1 definem qual registro de modo é carregado durante o
comando MODE REGISTER SET (MRS ou EMRS).
/RAS, /CAS,EntradaEntradas de Comando: /RAS, /CAS e /WE (juntamente com /CS) definem o comando
/ WEque está sendo digitado.
DMEntradaMáscara de Dados de Entrada: DM é um sinal de máscara de entrada para dados
(LDM,UDM)WRITE. Os dados de entrada são mascarados quando DM for amostrado como
HIGH juntamente com os dados de entrada durante um acesso WRITE. DM é
amostrado em ambas as bordas do DQS. Embora os pinos DM sejam apenas de
entrada, o carregamento de DM faz o casamento com o carregamento de DQ e
DQS. Para o x16, LDM corresponde aos dados no DQ0-Q7; UDM corresponde aos
dados no DQ8-Q115.
DQSE/SAmostragem de Dados: Saída com dados READ, entrada com dados WRITE. Alinhados
(LDQS,UDQS)pela borda com dados READ, centrados nos dados WRITE. Usados para capturar
dados WRITE. Para o x16, LDM corresponde aos dados no DQ0-Q7; UDQS corresponde
aos dados no DQ8Q15.
DQE/SEntrada de dados / pino de saída: Barramento de dados
VDD/VSSAlimentação Fonte de alimentação para circuitos internos e buffers de entrada.
Elétrica
VDDQ/VSSQ Alimentação Fonte de alimentação dos buffers de saída para imunidade a ruído.
Elétrica
VREFAlimentação Tensão de referência de entradas para a interface SSTL.
Elétrica
NCNCSem conexão.
34
Page 35
5.4 - Memória Flash (U8)
Pinagem
48 TSOP (Tipo Padrão) (12mm x 20mm)
DESCRIÇÃO DOS PINOS
SÍMBOLONOME DO PINO
AO-A19Entrada de Endereços
Q0-Q14Entrada/Saída de Dados
Q15/A-1Q15(Modo palavra)/LSB addr (Modo Byte)
CEEntrada de Habilitação do Chip
WEEntrada de Habilitação do Write
BYTEEntrada da Seleção Palavra/Byte
RESETDestravamento da Proteção do Setor/Pino de Reiniciação do Hardware
OEEntrada da Habilitação da Saída
RY/BYSaída Ready/Busy
VCCPino da Fonte de Alimentação (2,7V-3,6V)
GND (TERRA)Pino do Terra
35
Page 36
5.5 - Conversor A-D de Áudio CE2631 (U11)
Pinagem
DESCRIÇÃO DOS PINOS
Nome do Pino Pino NºTipoDescrição
DGND1TERRATerra digital
XCK2EEntrada do Clock Mestre Externo.
DOUT3S PDA saída de dados PCM áudio serial possui internamente um resistor pull-down
de 30K. Durante a ativação, este pino é amostrado para determinar se o
áudio serial deve operar como mestre ou escravo.
BCK4E/SClock de Dados da Serial do Áudio. Entrada no modo escravo e saída no
modo mestre, dependendo do registro REG1[4].
LRCK5E/SPino do clock do canal esquerdo/direito. Entrada no modo escravo e saída
nomodo mestre, dependendo do registro REG1[4]
AGND6TERRATerra analógico
AGND7TERRATerra analógico
CAP8E/SSaída de tensão de referência com buffer do ADC. Deve ser ligada a um
capacitor de 22 µF em paralelo com um 0,1 µF. O nível de sinal é AVDD/2.
AGND9TERRATerra analógico
VCM10E/SA tensão de referência deve ser ligada a um capacitor de 22 µF em paralelo
com outro de 0,1 µF, bem como dois resistores de 390Ω, um para AVDD e
outro para AGND
L011EEntrada esquerda do canal analógico 0
R012EEntrada direita do canal analógico 0
L313EEntrada esquerda do canal analógico 3.
R314EEntrada direita do canal analógico 3
L115EEntrada esquerda do canal analógico 1.
R116EEntrada direita do canal analógico 1
L217EEntrada esquerda do canal analógico 2.
R218EEntrada direita do canal analógico 2
AVDD19VDDFonte de alimentação analógica de 3,3V.
N/C20Sem ligação interna. Pode-se ligar ao terra (GND).
MOD21E PDQuando MOD for ‘1’, o pino SL1 e SL0 serão o controle do multiplexador para
os canais de entrada analógica. Quando MOD for ‘0’, o barramento I2C
será usado para programar o registro interno e selecionar os canais de entrada
analógica. O pino tem um resistor pull-down interno de 30K.
SDA/SL122PU de E/S Seleção do canal de entrada de hardware ou SDA do barramento I2C, SL1,
baseada no nível do pino MOD. Possui um resistor pull-up interno de 8K.
SCL/SL023PU de E/S Seleção do canal de entrada de hardware ou SDA do barramento I2C, SL1,
baseada no nível do pino MOD. Possui um resistor pull-up de 30 K
DVDD24VDDFonte de alimentação digital, 3,3V.
36
Page 37
CE2631
ADC de Áudio Estéreo de 4 Canais, 24 bits, 96K - 32KHz
DESCRIÇÃO
O CE2631 é um ADC (conversor digital/analógico) de
áudio estéreo de 4 entradas, formado por um circuito
integrado monolítico CMOS de sinal misto. Contém um
par de multiplexadores de 4 entradas e um conjunto de
ADCs estéreos sigma delta de 1 bit. É o ideal para
aplicações multimídia
A superamostragem do ADC é feita 128 vezes. Os dados
amostrados são então filtrados e decimados
digitalmente antes de serem enviados. Um filtro passaaltos chaveável foi também incluído para remover o
deslocamento DC (DC offset). Foi incluído também um
circuito auto-mute. Quando ativado, este circuito
remove o ruído de chiado de baixo nível. O ADC utiliza
arquitetura Σ
∆ de 4 ordens. O conversor Σ ∆ de 1 bit
oferece uma linearidade diferencial superior com um
mínimo de distorção que possa ser causada por
componentes com problemas de compatibilidade e
uma alta tolerância a clock jitter. Além disso, inclui um
circuito mute de emudecimento que pode ser
selecionado. O filtro digital interno tem uma largura de
banda de 20K. Este filtro suporta freqüências de
amostragem de até 96 Khz e, com 1 vrms de entrada,
cobre toda a escala digital. Valores maiores que a escala
total serão cortados.
CARACTERÍSTICAS
• ADC de Áudio Estéreo.
- 96dB SNR (A Ponderado).-
- Relação 72 dB THD + N (A Ponderado).
- Taxas de amostragem de 32K - 96 KHz.
- Separação de canais de 91 dB.
- Auto mute
• Chaves Estéreo de 4 Entradas.
2
S, Formatos I/F Digitais Justificados à Esquerda e
•I
Direita.
• Interface de Controle Serial de 2 vias ou Seleção de
Entradas Cabeadas
• Fonte de Alimentação de 3,3V.
Aplicações
• Som “Digital Surround” para Home Theater
• Receptor AV
• Áudio para carro
Desempenho do CE2631
ItemESPECIFICAÇÕES DE DESEMPENHO DO ADCEspec.
1Nível Máximo de Entrada4 Vpp
2Nível de Entrada de Áudio 0 dB1 Vrms
3Largura de Banda de Áudio 20Hz - 20 KHz+/- 0.5 dB
4SNR (Weight A)>96 dB
5Distorção Harmônica Total (THD) + Ruído (Weight A, entrada 0 dB)< -72 dB
6Faixa Dinâmica89 dB
7Separação de Canais< -90 dB
8Distorção Não Linear< 0,5 dB
9Erro de Ganho do Canal< 0,5 dB
37
Page 38
5.6 - Conversor D-A de Áudio CE2711 (U9)
PINAGEM
Descrição dos pinos
NOME
DO PINO
DIN1EEntrada de Dados do Áudio Serial
BCK2EClock de Dados da Serial do Áudio.
LRCk3EPino do Clock do Canal Esquerdo/Direito. Para o modo justificado
XCK4EEntrada do clock mestre.
AL5SSaída analógica do canal esquerdo
GND6TERRA (GND)Terra
VDD7+3,3VFonte de alimentação analógica de 3,3V.
AR8SSaída analógica do canal direito
PINO NºTIPODESCRIÇÃO
à esquerda, um SF alto indica Dados do Canal Esquerdo, um SF
baixo indica Dados do Canal Direito. Para o modo justificado à
esquerda, um SF alto indica Dados do Canal Esquerdo, um SF
baixo indica Dados do Canal Direito.
38
Page 39
CE271X
DAC de Áudio Estéreo, 24 bits, 192kHz
DESCRIÇÃO
O CE271X é um conversor digital analógico de áudio
estéreo formado por um circuito integrado monolítico
CMOS de sinal misto. Contém um DAC sigma delta dual
multibit. O sistema consiste de filtros de interpolação de
128 vezes, moduladores de 3
a
ordem multibit Σ ∆ ,
capacitores de comutação e filtros de reconstrução
analógica. O conversor multibit Σ ∆ oferece alta
tolerância a clock jitter e linearidade.
O CE271X suporta a conversão de dados de 32K para
192KHz. Este chip opera com tensão de 3,3V para reduzir
o consumo de energia e o ruído causado pelo
chaveamento do circuito digital interno. O CE271X é
ideal para tocadores de DVD, receptor de AV e
aplicações em decodificadores de TV a cabo.
O CE271X usa encapsulamento SOIC de 8 pinos 150 mm.
Exige um mínimo de componentes externos, sendo a
escolha ideal para aplicações de baixa potência e com
pouca disponibilidade de espaço.
CARACTERÍSTICAS
• DAC para Áudio Estéreo.
-100 dB SNR (A Ponderado)
- Relação THD + Ruído (A Ponderado).
- Taxas de Amostragem: 32K - 192 KHz.
- Filtros de Reconstrução no Chip.
• Fonte de Alimentação de 3,3V. Ideal para aplicações
portáteis.
2
S Formato de Entrada Digital (CE2711)
•I
• Formato de Entrada Digital Justificado à Direita
(CE2712).
Aplicações
• Som “Digital Surround” para Home Theater.
• Tocador de DVD.
• Áudio para Carro
• CD Portátil
• DVB, Decodificador para TV a cabo
Desempenho do DAC
ItemESPECIFICAÇÕES DE DESEMPENHOEspec.
1Nível de Saída de Áudio (Vdd= 3,3 volt)1,0 Vrms
2Largura da Banda de Áudio 20Hz - 20 KHz+/- 0,04 dB
3SNR (Weight A)>100dB
4THD + Ruído (0dB, Weight A)<84 dB
5Faixa Dinâmica (Weight A)90 dB
6Separação de Canais< -90 dB
7Distorção Não Linear< 0,25 dB
8Erro de Ganho do Canal< 0,1 dB
9NC
10NC
11Segundo SIF
12Saída de Vídeo
13VCC25,0v (MAX 170mA)
14Saída de ÁudioCircuito RC interno
Tabela 1
Tabela 2
5. Desempenho do divisor de antena de RF –entrada para RF-saída
Ganho:1,5dB (tipo) (min. 0,5 dB) VCC1
2,5dB (tipo) (max. -3,5 dB) VCC1
6. Faixa de freqüências
Tabela 3
FAIXAFREQÜÊNCIA (MHz)
VHF Baixo55~160MHz
VHF Alto155~442MHz
UHF442~801,25MHz
7. Freqüências Intermediárias
Tabela 4
PIF45,75 MHz
CIF42,17 MHz
SIF41,25 MHz
8. Dados Elétricos (Para a Seção do Sintonizador:)
Temperatura Ambiente: 25±5°C
Umidade Relativa: 60±15%
Tensão de Alimentação: 5V±0,25V
Impedância de Entrada:75Ω Desbalanceado
Faixa de Cobertura de Freqüências do Oscilador Local 2MHz ( 5 )
A faixa min. ajustável das freqüências locais, incluindo todas as freqüências dos canais altos - baixos, freq. local
nominal de cada faixa e as extremidades, fica acima de 2MHz (veja a tabela 5)
Tabela 5
FaixaCanalFaixa de cobertura
das freqüências do oscilador local
VHF Baixo55~160MHz98,75~207,75MHz
VHF Alto155~442MHz198,75~489,75MHz
UHF442~801,25MHz485,75~849MHz
41
Page 42
6- FORMAS DE ONDA
Y1 27MHz
Y601 24.576Mhz
Y2 32.769K
RESET SYSTEM (U4 92PIN)
COAXIAL
CVBS
42
Page 43
Y
Pb
Pr
AUDIO ALRCLK
AUDIO ACK
AUDIO ABCK
43
Page 44
AUDIO DATA
44
Page 45
7- VISTA EXPLODIDA
7.1 - Aparelho
45
Page 46
8- LISTA DE COMPONENTES
8.1 - Mecânicos
Observação importante: A tabela à seguir apresenta-se ordenada alfa numericamente em função da
posição do componente. Alguns componentes, ainda que eletromecânicos ou elétricos, aparecem
nesta tabela em função de sua presença na "Vista Explodida" deste manual.
NOTA DE SEGURANÇA: As partes marcadas com o símbolo possuem características especiais importantes para segurança. Antes de substituir qualquer
um desses componentes, certifique-se que o está fazendo apenas por componentes com as mesmas características. Não comprometa a segurança do
produto pela utilização de componentes duvidosos durante o serviço.
Tabela de tolerâncias:
SímboloFGJKMNZPSímboloCD
%± 1± 2± 5± 10± 20± 30-20 +800 +100pF± 0,25± 0,5
Observação importante: A tabela à seguir apresenta-se ordenada alfa-numericamente em função da posição do componente.
PosiçãoN.E.Descrição
AE305208610CONTROLE REMOTO DVD3180
AE324208451CABO RF F-F 75OHM, 1.5M
AE361156958CABO AUDIO L=1,5M C/ PLUG
AE362156967CABO VIDEO L=1,5M C/ PLUG
BAT1226262BATERIA CR2032/1VG 3V
C2226413CAP CERA 103 M 1KV Y5V RG050
C6226413CAP CERA 103 M 1KV Y5V RG050
CN1208503CABO FORCA 2VIAS 1,5M C/ CONEC
CN1226440CONECTOR 2P 8MM VH3A2T
CN1226583CONECTOR C/ CABO 7P 120MM
CN2226570CONECTOR CABO BLIND 6P 150MM
CN3226455CONECTOR C/ CABO 4P 60MM
CN3226556CONECTOR C/ CABO 4P 170MM
CN4208488CONECTOR 3V C/ CABO 360MM CJ
CN4226468CONECTOR 3P 2.54MM RAD
CN4226565CONECTOR C/ CABO 4P 195MM
CN5208479CONECTOR 6V C/ CABO 360MM CJ
CN5226495CONECTOR 4P 2.0MM RAD
CN6226473CONECTOR 6P 2.54MM RAD
CON1226235CONECTOR 2X20 2.54MM ATAPI
CP1226543TOMADA AV3-8.4-6A-A RCA 3X1
CP2226538TOMADA 4P RV-ST4D-F16N-D16 DIP
CX1226400CAP PMET 104 K 275V X2 150
CY1226397CAP CERA 222 M 400V Y1 100K
D1226333DIODO RET 1N4007 DO204AL-TB
D10226075DIODO RET BAV99 SOT23 08180
D10226315DIODO SCH 1N5822 DO201AD-B
D11226333DIODO RET 1N4007 DO204AL-TB
D12226333DIODO RET 1N4007 DO204AL-TB
D2226333DIODO RET 1N4007 DO204AL-TB
D3226333DIODO RET 1N4007 DO204AL-TB
D4226333DIODO RET 1N4007 DO204AL-TB
D5226342DIODO SCH FR107 DO204AL-TB
D6226351DIODO SCH FR104 DO204AL-TB
D7226075DIODO RET BAV99 SOT23 08180
D7226351DIODO SCH FR104 DO204AL-TB
D8226075DIODO RET BAV99 SOT23 08180
D8226324DIODO SCH HER303 DO201AD-B
D9226075DIODO RET BAV99 SOT23 08180
D9226315DIODO SCH 1N5822 DO201AD-B
F1226482FUSI FILA T 2A 250V 150
IC1226286CIRC INT TOP244PN DIP8
IC2226388CIRC INT LTV-817-CN DIP4
IC3226277CIRC INT AZ431AZ-BTRE1 TO92
IR1226501RECEPTOR REMOTO PIC-427LM
J1226155CONECTOR 3P 2.54MM RAD
J4226173CONECTOR 7P 2.0MM RAD
PosiçãoN.E.Descrição
J5226191CONECTOR 4P 2.0MM RAD
J601226188CONECTOR 6P 2.0MM RAD
J602226204CONECTOR 3P 2.0MM RAD
J8226217TOMADA RX-4013K RCA 4X1
J9208497CONECTOR 40V C/ CABO 280MM CJ
LED1226529DISPLAY LED ZDC-G40C02YGB-15
LF1226437FILTRO LINHA LB1025-8433 UT-20
P4226226TOMADA RX-6013P RCA 6X1
PWR1226164CONECTOR 6P 2.54MM RAD
Q1226360TRANS 2N5551 TO92 PACK5
Q11226084TRANS 2N3904 SOT23 08180
Q12226084TRANS 2N3904 SOT23 08180
Q13226084TRANS 2N3904 SOT23 08180
Q14226084TRANS 2N3904 SOT23 08180
Q15226084TRANS 2N3904 SOT23 08180
Q2226299CIRC INT KIA78R12PI TO220
Q3226306TRANS AP40N03GP TO220 L2525
Q5226084TRANS 2N3904 SOT23 08180
Q6226093TRANS 2N3906 SOT23 08180
Q7226093TRANS 2N3906 SOT23 08180
Q8226093TRANS 2N3906 SOT23 08180
Q9226084TRANS 2N3904 SOT23 08180
SW1190117CHAVE TACT 6*6*5 AXIAL 12V
T1226428TRAFO FORCA KB1025-8616A EEL25
TU1226066SINTONIZADOR JS-6SNF/13F2-F2
U1225955CIRC INT AZ1117-1.8V TO223 SMD
U1226510CIRC INT AP6928 SOP28
U10226020CIRC INT NJM4558 SOP8 SMD
U11225973CIRC INT CE2631 TSSOP28
U2225968CIRC INT AZ1117-2.5V TO223 SMD
U3225940CIRC INT LT1084 TO263
U4226011CIRC INT MT8105 DOS3 QFP256
U5225995CIRC INT ATMEL24C16 SOP8 SMD
U6226002CIRC INT HY5DU561622CT TSOP66
U601226039CIRC INT MT8162 TQFP48
U603226057CIRC INT PT2328-X QSOP16
U7226048CIRC INT LP2996 SOP8 SMD
U8225937CIRC INT MBMZPDL160BE TSOP48
U9225986CIRC INT CE2711 SOIC16 SMD
Y1226100CRISTAL 27MHZ +-30PPM 20PF
Y2226146CRISTAL 32.768KHZ
Y601226119CRISTAL 24.576MHZ +-20PPM 20PF
ZD1226379DIODO ZEN BZX55C12V-TB 1/2W
47
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SEMP TOSHIBA
Administração Geral:
Av. João Dias, 2476 - CEP 04724-003 - São Paulo - SP
PABX (0xx11) 5645-2100
NE 738802
Rev. A - Jun. / 07
48
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