1
2 43
GIGABYTE GA-M55SLI-S4 Schematics
SHEET TITLE
A
B
01
02
03
04
05
06
07
08
09
10
11
12
13
14
15
COVER SHEET
BOM & PCB MODIFY HISTORY
BLOCK DIAGRAM
M2 CPU Hyper Transport
M2 CPU DDR II
M2 CPU Control
M2 CPU POWER & GND
DDRII A0,B0 MARVELL 88E1116 GbE Phy
DDRII A1,B1
DDRII TERMINATION
CK804 HT
CK804 PCI-EXPRESS
CK804 PCI, LPC, CLOCK
CK804 IDE,SATA
CK804 AC97,USB,MII,GPIO
SHEET TITLE
26
27
28
29
30
31
32
IDE, FDD
ATX POWER CONNCTOR
VCORE POWER
Discrete Power
DDRII Power & Standby Power
BIOS (LPC ROM & SPI Flash)
FRONT PANEL
33
34
35
36
TI 1394A
NV-SLI Swirch Board
COMA , LPT
37
38
39
40
Revision:1.0
16
17
18
19
C
20
21
22
23
24
25
CK804 POWER,GND
PCI EXPRESS X16 SLOT
41
42
PCI EXPRESS X8 SLOT 43
PCI EXPRESS X1 SLOT1,2
PCI 1,2 SLOT
CODEC 850/655/658
AUDIO JACK, F_AUDIO
IT8712KX
FAN, H/W Monitor
KB_MS/FUSEVCC/PS2
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
Cover Sheet
GA-M55SLI-S4
1 36Wednesday, May 24, 2006
1.0
5
4
3
2
1
Model Name:GA-M55SLI-S4 1.0
Component value change history
Date Change Item Reason
D D
95.03.27_0.1
C C
Rev 0.1 pilot-run BOM
M55SLI-S3-00-02
Change RN29 to 220/8P4R For signals level
Add R536 to 8.2K ohm
M55SLI-S3-00-10A95/05/22
Location: COAXITL change 11NR6-501004-81 to 11NR6-501004-81R
Change COMA to COM/GE/SC-6mm/RA/1/D
Remove R255, change C222 to 2.2n/4
Del socket_M2 10SC1-A01940-21
Change F1_1394,F2_1394 to PH/2*5K9/GY/2.54/VA/D
Change PCB to rev:1.0
替料
Circuit or PCB layout change for next version
Date Change Item Reason
95.03.27_0.1
95/04/26
1'st version pilot-run
REV:0.2
For LPC enableNB_HS改Footprint:BGAHSINK45X45-5
Del LPC flash rom
Add DDR protect
Change R0603 to R0402-2
REV:1.095/05/22
Modify COAXIAL pin 1
Del VCC15_OV2
B B
A A
GIGABYTE Technology
Title
Size Document Number Rev
Custom
5
4
3
2
Date: Sheet of
BOM & PCB MODIFY HISTORY
GA-M55SLI-S4
2 36Wednesday, May 24, 2006
1
1.0
1
2 3 4
BLOCK DIAGRAM
A
POWER
SUPPLY
CONNECTOR
VREG
SOCKET 940
K8
200/266/333/400MHZ
DDRII SDRAM CONN 0
DDRII SDRAM CONN 1
DDRII SDRAM CONN 2
PEX X16
PEX X1
PEX X1
B
FLOPPY CONN
PS2/KBRD CONN
PARALLEL CONN
SERIAL CONN
SERIAL HDR
SIO
ITE8712
PRIMARY IDE
SECONDARY IDE
X4 - SATA CONN
C
PCI EXPRESS X16 GRAPHICS
PCI EXPRESS
PCI EXPRESS
ATA 133
INTEGRATED SATA
LPC BUS 33MHZ
LPC HDR
4MB FLASH
HT 16X16 1GHZ
NFORCE
CRUSH K804
740BGA
RGMII
PCI 33MHZ
AC97
X10 USB2
MII/RGMII
AC97
BACK PANEL CONN
USB2 PORTS 5-4
DOUBLE STACK
USB2 PORTS 3-2
X2/GBIT LAN
FRONT PANEL HDR
USB2 PORTS 1-0
USB2 PORTS 7-6
USB2 PORTS 9-8
DDRII SDRAM CONN 3
PCI SLOT 1
PCI SLOT 2
PCI SLOT 3
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
BLOCK DIAGRAM
GA-M55SLI-S4
3 36Wednesday, May 24, 2006
1.0
1
2 43
L0_CADIN_L[0..15]
L0_CADIN_H[0..15]
L0_CLKIN_L[0..1]
L0_CLKIN_H[0..1]
L0_CADOUT_L[0..15]
A
L0_CADOUT_H[0..15]
L0_CLKOUT_L[0..1]
L0_CLKOUT_H[0..1]
L0_CADIN_L[0..15] 11
L0_CADIN_H[0..15] 11
L0_CLKIN_L[0..1] 11
L0_CLKIN_H[0..1] 11
L0_CADOUT_L[0..15] 11
L0_CADOUT_H[0..15] 11
L0_CLKOUT_L[0..1] 11
L0_CLKOUT_H[0..1] 11
CPU_VDD_RUN = VCORE
CPU_VDDA_RUN = VDDA25
VLDT_RUN = VCC12_HT
CPU_VDDIO_SUS = DDR18V
CPU_VTT_SUS = DDRVTT
VLDT_A = VCC12_HT
VLDT_B = HT12B
SOCKET_M2A
L0_CLKIN_H1
L0_CLKIN_L1
L0_CLKIN_H0
L0_CLKIN_L0
VCC12_HT
L0_CTLIN_H011
L0_CTLIN_L011
VCORE
B
SC1
0.01U/4/Y5V/50V/Z
CLOSE CHIPSET &
CROSSING BOUNDARY
SC2
0.01U/4/Y5V/50V/Z
SC3
0.01U/4/Y5V/50V/Z
L0_CTLIN_H0
L0_CTLIN_L0
L0_CADIN_H15
L0_CADIN_L15
L0_CADIN_H14
L0_CADIN_L14
L0_CADIN_H13
L0_CADIN_L13
L0_CADIN_H12
L0_CADIN_L12
L0_CADIN_H11
L0_CADIN_L11
L0_CADIN_H10
L0_CADIN_L10
L0_CADIN_H9
L0_CADIN_L9
L0_CADIN_H8
L0_CADIN_L8
L0_CADIN_H7
L0_CADIN_L7
L0_CADIN_H6
L0_CADIN_L6
L0_CADIN_H5
L0_CADIN_L5
L0_CADIN_H4
L0_CADIN_L4
L0_CADIN_H3
L0_CADIN_L3
L0_CADIN_H2
L0_CADIN_L2
L0_CADIN_H1
L0_CADIN_L1
L0_CADIN_H0
L0_CADIN_L0
N6
P6
N3
N2
49.9/4/1R1
V4
49.9/4/1R2
V5
U1
V1
U6
V6
T4
T5
R6
T6
P4
P5
M4
M5
L6
M6
K4
K5
J6
K6
U3
U2
R1
T1
R3
R2
N1
P1
L1
M1
L3
L2
J1
K1
J3
J2
HYPERTRANSPORT
L0_CLKIN_H(1)
L0_CLKIN_L(1)
L0_CLKIN_H(0)
L0_CLKIN_L(0)
L0_CTLIN_H(1)
L0_CTLIN_L(1)
L0_CTLIN_H(0)
L0_CTLIN_L(0)
L0_CADIN_H(15)
L0_CADIN_L(15)
L0_CADIN_H(14)
L0_CADIN_L(14)
L0_CADIN_H(13)
L0_CADIN_L(13)
L0_CADIN_H(12)
L0_CADIN_L(12)
L0_CADIN_H(11)
L0_CADIN_L(11)
L0_CADIN_H(10)
L0_CADIN_L(10)
L0_CADIN_H(9)
L0_CADIN_L(9)
L0_CADIN_H(8)
L0_CADIN_L(8)
L0_CADIN_H(7)
L0_CADIN_L(7)
L0_CADIN_H(6)
L0_CADIN_L(6)
L0_CADIN_H(5)
L0_CADIN_L(5)
L0_CADIN_H(4)
L0_CADIN_L(4)
L0_CADIN_H(3)
L0_CADIN_L(3)
L0_CADIN_H(2)
L0_CADIN_L(2)
L0_CADIN_H(1)
L0_CADIN_L(1)
L0_CADIN_H(0)
L0_CADIN_L(0)
CPU-SK/940AM2/S/15u
L0_CLKOUT_H(1)
L0_CLKOUT_L(1)
L0_CLKOUT_H(0)
L0_CLKOUT_L(0)
L0_CTLOUT_H(1)
L0_CTLOUT_L(1)
L0_CTLOUT_H(0)
L0_CTLOUT_L(0)
L0_CADOUT_H(15)
L0_CADOUT_L(15)
L0_CADOUT_H(14)
L0_CADOUT_L(14)
L0_CADOUT_H(13)
L0_CADOUT_L(13)
L0_CADOUT_H(12)
L0_CADOUT_L(12)
L0_CADOUT_H(11)
L0_CADOUT_L(11)
L0_CADOUT_H(10)
L0_CADOUT_L(10)
L0_CADOUT_H(9)
L0_CADOUT_L(9)
L0_CADOUT_H(8)
L0_CADOUT_L(8)
L0_CADOUT_H(7)
L0_CADOUT_L(7)
L0_CADOUT_H(6)
L0_CADOUT_L(6)
L0_CADOUT_H(5)
L0_CADOUT_L(5)
L0_CADOUT_H(4)
L0_CADOUT_L(4)
L0_CADOUT_H(3)
L0_CADOUT_L(3)
L0_CADOUT_H(2)
L0_CADOUT_L(2)
L0_CADOUT_H(1)
L0_CADOUT_L(1)
L0_CADOUT_H(0)
L0_CADOUT_L(0)
AD5
AD4
AD1
AC1
Y6
W6
W2
W3
Y5
Y4
AB6
AA6
AB5
AB4
AD6
AC6
AF6
AE6
AF5
AF4
AH6
AG6
AH5
AH4
Y1
W1
AA2
AA3
AB1
AA1
AC2
AC3
AE2
AE3
AF1
AE1
AG2
AG3
AH1
AG1
L0_CLKOUT_H1
L0_CLKOUT_L1
L0_CLKOUT_H0
L0_CLKOUT_L0
L0_CTLOUT_H1
L0_CTLOUT_L1
L0_CTLOUT_H0
L0_CTLOUT_L0
L0_CADOUT_H15
L0_CADOUT_L15
L0_CADOUT_H14
L0_CADOUT_L14
L0_CADOUT_H13
L0_CADOUT_L13
L0_CADOUT_H12
L0_CADOUT_L12
L0_CADOUT_H11
L0_CADOUT_L11
L0_CADOUT_H10
L0_CADOUT_L10
L0_CADOUT_H9
L0_CADOUT_L9
L0_CADOUT_H8
L0_CADOUT_L8
L0_CADOUT_H7
L0_CADOUT_L7
L0_CADOUT_H6
L0_CADOUT_L6
L0_CADOUT_H5
L0_CADOUT_L5
L0_CADOUT_H4
L0_CADOUT_L4
L0_CADOUT_H3
L0_CADOUT_L3
L0_CADOUT_H2
L0_CADOUT_L2
L0_CADOUT_H1
L0_CADOUT_L1
L0_CADOUT_H0
L0_CADOUT_L0
1
TP1
1
TP2
L0_CTLOUT_H0 11
L0_CTLOUT_L0 11
SOCKET_M2
C
K8-940AM2/RM/BP-M/SC/BK/3M/[12KRC-04K807-41R]
Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU HYPER TRANSPORT
GA-M55SLI-S4
4 36Wednesday, May 24, 2006
1.0
1
2 43
SOCKET_M2B
DCLKA2
-DCLKA2
DCLKA1
-DCLKA1
DCLKA0
-DCLKA0
MODT_A0
DCLKA5
-DCLKA5
DCLKA4
-DCLKA4
DCLKA3
-DCLKA3
MODT_A1
-SCASA
-SWEA
-SRASA
SBAA2
SBAA1
SBAA0
CKEA1
CKEA0
DQSA7
-DQSA7
DQSA6
-DQSA6
DQSA5
-DQSA5
DQSA4
-DQSA4
DQSA3
-DQSA3
DQSA2
-DQSA2
DQSA1
-DQSA1
DQSA0
-DQSA0
DMA7
DMA6
DMA5
DMA4
DMA3
DMA2
DMA1
DMA0
AG21
AG20
AC25
AA24
AC28
AE20
AE19
AD27
AA25
AC27
AB25
AB27
AA26
AA27
AC26
AD15
AE15
AG18
AG19
AG24
AG25
AG27
AG28
AF15
AF19
AJ25
AH29
G19
H19
U27
U26
G20
G21
V27
W27
N25
Y27
L27
M25
M27
N24
N26
P25
Y25
N27
R24
P27
R25
R26
R27
T25
U25
T27
W24
D29
C29
C25
D25
E19
F19
F15
G15
B29
E24
E18
H15
A
B
MAAA[0..15]8,9,10 MAAB[0..15]8,9,10
-DQSA[0..7] -DQSB[0..7]
DQSA[0..7]
-DQSA[0..7] 8,9
DQSA[0..7] 8,9
DCLKA28,10
-DCLKA28,10
DCLKA18,10
-DCLKA18,10
DCLKA08,10
-DCLKA08,10
-CSA18,10
-CSA08,10
MODT_A08,10
DCLKA59,10
-DCLKA59,10
DCLKA49,10
-DCLKA49,10
DCLKA39,10 DCLKB39,10
-DCLKA39,10
-CSA39,10
-CSA29,10
MODT_A19,10
-SCASA8,9,10
-SWEA8,9,10
-SRASA8,9,10
SBAA28,9,10
SBAA18,9,10
SBAA08,9,10
CKEA19,10
CKEA08,10
MAAA15
MAAA14
MAAA13
MAAA12
MAAA11
MAAA10
MAAA9
MAAA8
MAAA7
MAAA6
MAAA5
MAAA4
MAAA3
MAAA2
MAAA1
MAAA0
C
MEMORY INTERFACE A
MA0_CLK_H(2)
MA0_CLK_L(2)
MA0_CLK_H(1)
MA0_CLK_L(1)
MA0_CLK_H(0)
MA0_CLK_L(0)
MA0_CS_L(1)
MA0_CS_L(0)
MA0_ODT(0)
MA1_CLK_H(2)
MA1_CLK_L(2)
MA1_CLK_H(1)
MA1_CLK_L(1)
MA1_CLK_H(0)
MA1_CLK_L(0)
MA1_CS_L(1)
MA1_CS_L(0)
MA1_ODT(0)
MA_CAS_L
MA_WE_L
MA_RAS_L
MA_BANK(2)
MA_BANK(1)
MA_BANK(0)
MA_CKE(1)
MA_CKE(0)
MA_ADD(15)
MA_ADD(14)
MA_ADD(13)
MA_ADD(12)
MA_ADD(11)
MA_ADD(10)
MA_ADD(9)
MA_ADD(8)
MA_ADD(7)
MA_ADD(6)
MA_ADD(5)
MA_ADD(4)
MA_ADD(3)
MA_ADD(2)
MA_ADD(1)
MA_ADD(0)
MA_DQS_H(7)
MA_DQS_L(7)
MA_DQS_H(6)
MA_DQS_L(6)
MA_DQS_H(5)
MA_DQS_L(5)
MA_DQS_H(4)
MA_DQS_L(4)
MA_DQS_H(3)
MA_DQS_L(3)
MA_DQS_H(2)
MA_DQS_L(2)
MA_DQS_H(1)
MA_DQS_L(1)
MA_DQS_H(0)
MA_DQS_L(0)
MA_DM(7)
MA_DM(6)
MA_DM(5)
MA_DM(4)
MA_DM(3)
MA_DM(2)
MA_DM(1)
MA_DM(0)
CPU-SK/940AM2/S/15u
MA_DATA(63)
MA_DATA(62)
MA_DATA(61)
MA_DATA(60)
MA_DATA(59)
MA_DATA(58)
MA_DATA(57)
MA_DATA(56)
MA_DATA(55)
MA_DATA(54)
MA_DATA(53)
MA_DATA(52)
MA_DATA(51)
MA_DATA(50)
MA_DATA(49)
MA_DATA(48)
MA_DATA(47)
MA_DATA(46)
MA_DATA(45)
MA_DATA(44)
MA_DATA(43)
MA_DATA(42)
MA_DATA(41)
MA_DATA(40)
MA_DATA(39)
MA_DATA(38)
MA_DATA(37)
MA_DATA(36)
MA_DATA(35)
MA_DATA(34)
MA_DATA(33)
MA_DATA(32)
MA_DATA(31)
MA_DATA(30)
MA_DATA(29)
MA_DATA(28)
MA_DATA(27)
MA_DATA(26)
MA_DATA(25)
MA_DATA(24)
MA_DATA(23)
MA_DATA(22)
MA_DATA(21)
MA_DATA(20)
MA_DATA(19)
MA_DATA(18)
MA_DATA(17)
MA_DATA(16)
MA_DATA(15)
MA_DATA(14)
MA_DATA(13)
MA_DATA(12)
MA_DATA(11)
MA_DATA(10)
MA_DATA(9)
MA_DATA(8)
MA_DATA(7)
MA_DATA(6)
MA_DATA(5)
MA_DATA(4)
MA_DATA(3)
MA_DATA(2)
MA_DATA(1)
MA_DATA(0)
MA_DQS_H(8)
MA_DQS_L(8)
MA_DM(8)
MA_CHECK(7)
MA_CHECK(6)
MA_CHECK(5)
MA_CHECK(4)
MA_CHECK(3)
MA_CHECK(2)
MA_CHECK(1)
MA_CHECK(0)
AE14
AG14
AG16
AD17
AD13
AE13
AG15
AE16
AG17
AE18
AD21
AG22
AE17
AF17
AF21
AE21
AF23
AE23
AJ26
AG26
AE22
AG23
AH25
AF25
AJ28
AJ29
AF29
AE26
AJ27
AH27
AG29
AF27
E29
E28
D27
C27
G26
F27
C28
E27
F25
E25
E23
D23
E26
C26
G23
F23
E22
E21
F17
G17
G22
F21
G18
E17
G16
E15
G13
H13
H17
E16
E14
G14
J28
J27
J25
K25
J26
G28
G27
L24
K27
H29
H27
MDA63
MDA62
MDA61
MDA60
MDA59
MDA58
MDA57
MDA56
MDA55
MDA54
MDA53
MDA52
MDA51
MDA50
MDA49
MDA48
MDA47
MDA46
MDA45
MDA44
MDA43
MDA42
MDA41
MDA40
MDA39
MDA38
MDA37
MDA36
MDA35
MDA34
MDA33
MDA32
MDA31
MDA30
MDA29
MDA28
MDA27
MDA26
MDA25
MDA24
MDA23
MDA22
MDA21
MDA20
MDA19
MDA18
MDA17
MDA16
MDA15
MDA14
MDA13
MDA12
MDA11
MDA10
MDA9
MDA8
MDA7
MDA6
MDA5
MDA4
MDA3
MDA2
MDA1
MDA0
MDA[0..63] 8,9 MDB[0..63] 8,9
DQSB[0..7]
DMB[0..7]DMA[0:7]
-DQSB[0..7] 8,9
DQSB[0..7] 8,9
DMB[0..7] 8,9DMA[0..7] 8,9
DCLKB2
DCLKB28,10
-DCLKB2
-DCLKB28,10
DCLKB1
DCLKB18,10
-DCLKB1
-DCLKB18,10
DCLKB0
DCLKB08,10
-DCLKB0
-DCLKB08,10
-CSB18,10
-CSB08,10
MODT_B0
MODT_B08,10
DCLKB5
DCLKB59,10
-DCLKB5
-DCLKB59,10
DCLKB4
DCLKB49,10
-DCLKB4
-DCLKB49,10
DCLKB3
-DCLKB3
-DCLKB39,10
-CSB39,10
-CSB29,10
MODT_B1
MODT_B19,10
-SCASB
-SCASB8,9,10
-SWEB
-SWEB8,9,10
-SRASB
-SRASB8,9,10
SBAB2
SBAB28,9,10
SBAB1
SBAB18,9,10
SBAB0
SBAB08,9,10
CKEB1
CKEB19,10
CKEB0
CKEB08,10
MAAB15
MAAB14
MAAB13
MAAB12
MAAB11
MAAB10
MAAB9
MAAB8
MAAB7
MAAB6
MAAB5
MAAB4
MAAB3
MAAB2
MAAB1
MAAB0
DQSB7
-DQSB7
DQSB6
-DQSB6
DQSB5
-DQSB5
DQSB4
-DQSB4
DQSB3
-DQSB3
DQSB2
-DQSB2
DQSB1
-DQSB1
DQSB0
-DQSB0
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DMB0
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AJ19
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A19
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U30
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AL18
MB1_CLK_L(2)
C19
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D19
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R28
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R31
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R30
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T31
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T29
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U28
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AA30
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C31
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C23
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D17
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C17
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C14
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C13
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AJ14
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C30
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A23
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B17
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B13
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Title
Size Document Number Rev
Custom
Date: Sheet of
GIGABYTE Technology
CPU DDRII MEMORY
GA-M55SLI-S4
5 36Wednesday, May 24, 2006
1.0
8
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D1
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3
1
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SOT23
D2
2
3
1
BAV99/SOT23/300mA/X
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3VDUAL
D D
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SOT23
C C
VCC3
BC5
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R45
59/4/1
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DDR_VREF
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BC7
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8
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BC8
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B B
A A
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DDR18V
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DCLKA2
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DCLKA0
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124
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192
7
DDRII1
2
VSS
5
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
VSS
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VDDQ
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VDDQ
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VDDQ
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VDDQ
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VDDQ
78
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
VDDQ
53
VDD
59
VDD
64
VDD
VDD
69
VDD
VDD
VDD
VDD
VDD
VDD
67
VDD
18
RC1
55
RC0
VDDSPD
1
VREF
SCL
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SA1
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CKE0
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S0*
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CK2/RFU
CK1*/RFU
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A2
A3
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A7
A8
A9
70
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57
A11
A12
A13
A14
A15
54
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74
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73
WE*
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68
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NC
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DCLKB2
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1
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120
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119
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3
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-DQSA0
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C33
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MAAB14
MAAB15
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6
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NC/DQS16*
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NC/DQS17*
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DQS8
DQS8*
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233
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165
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236
GIGABYTE Technology
Title
Size Document Number Rev
Custom
Date: Sheet of
2
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-DQSB[0..7]
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1
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-DQSB[0..7] 5,9
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1
8
D D
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C C
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C37
B B
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DCLKA55,10
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DCLKA45,10
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7
6
DDRII3
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5
VSS
8
VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VSS
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VDDQ
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VDDQ
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
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VDD
184
VDD
178
VDD
189
VDD
67
VDD
18
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55
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VDDSPD
1
VREF
120
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A9
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WE*
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SBAA25,8,10
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NC
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233
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165
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VDD
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238
VDDSPD
1
VREF
120
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119
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101
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A7
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A8
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A9
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A10/AP
57
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CAS*
192
RSA*
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WE*
DDR18V
VCC3
DDR_SMBCLK
DDR_SMBDATA
SBAB15,8,10
SBAB05,8,10
CKEB15,10
-CSB35,10
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-SWEB5,8,10
NC/TEST
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DQS*(7)
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DQ(55)
DQ(56)
DQ(57)
DQ(58)
DQ(59)
DQ(60)
DQ(61)
DQ(62)
DQ(63)
ODT1
ODT0
CB(0)
CB(1)
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CB(4)
CB(5)
CB(6)
CB(7)
DQS8
DQ(0)
DQ(1)
DQ(2)
DQ(3)
DQ(4)
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DQ(6)
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DQ(9)
68
NC
102
19
NC
77
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43
48
49
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162
167
168
7
6
16
15
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27
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36
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83
93
92
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104
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113
46
45
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126
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135
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147
155
156
202
203
211
212
223
224
232
233
164
165
3
4
9
10
122
123
128
129
12
13
21
22
131
132
140
141
24
25
30
31
143
144
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150
33
34
39
40
152
153
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159
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81
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87
199
200
205
206
89
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96
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227
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111
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117
229
230
235
236
MODT_B1
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-DQSB0
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-DQSB2
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-DQSB3
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-DQSB4
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-DQSB5
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-DQSB6
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-DQSB7
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DMB7
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MDB61
MDB62
MDB63
1
MDB[0..63] 5,8
DDR2/240/RE/VA/D
GIGABYTE Technology
Title
Size Document Number Rev
Custom
8
7
6
5
4
3
Date: Sheet of
2
DDRII CHANNEL B
GA-M55SLI-S4 1.0
9 36
1
8
DDR18V
C39 100P/4/NPO/50V/J/X
C41 100P/4/NPO/50V/J/X
C42 100P/4/NPO/50V/J/X
FOR EMI SOLUTION
DDRVTT
D D
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C C
DDRVTT
1
2
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3
4
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5
6
7
8
1
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3
4
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5
6
7
8
1
2
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3
4
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5
6
7
8
1
2
CN4
3
4
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5
6
7
8
DDRVTT DDR18V
B B
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7
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MAAA15
MAAA0
MAAA1
MAAA2
MAAA3
MAAA4
MAAA5
MAAA6
MAAA7
MAAA8
MAAA9
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MAAA12
MAAA13
MAAA14
MAAA15
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MODT_A1
R98 47/4
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C48 22P/4/NPO/50V/J
C49 22P/4/NPO/50V/J
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-SWEA
C78 22P/4/NPO/50V/J
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C80 22P/4/NPO/50V/J
-SRASA
C82 22P/4/NPO/50V/J
SBAA0
C85 22P/4/NPO/50V/J
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C86 22P/4/NPO/50V/J
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C87 22P/4/NPO/50V/J
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6
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CKEA[0:1] 5,8,9
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MODT_A[0..1]5,8,9
MODT_B[0..1]5,8,9
SBAB[0:2] 5,8,9
-CSB[0:3] 5,8,9
CKEB[0:1] 5,8,9
MAAB[0..15]5,8,9
DDRVTT
DDR18V
5
DCLKA2
DCLKA25,8
C40
-DCLKA2
-DCLKA25,8
DCLKA1
DCLKA15,8
-DCLKA1
-DCLKA15,8
DCLKA0
DCLKA05,8
-DCLKA0
-DCLKA05,8
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-DCLKA5
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-DCLKA4
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DCLKA35,9
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DCLKB2
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-DCLKB2
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-DCLKB1
-DCLKB15,8
DCLKB0
DCLKB05,8
-DCLKB0
-DCLKB05,8
DCLKB5
DCLKB55,9
-DCLKB5
-DCLKB55,9
DCLKB4
DCLKB45,9
-DCLKB4
-DCLKB45,9
DCLKB3
DCLKB35,9
-DCLKB3
-DCLKB35,9
1.5p/4/NPO/50V/B
C43
1.5p/4/NPO/50V/B
C44
1.5p/4/NPO/50V/B
C45
1.5p/4/NPO/50V/B
C46
1.5p/4/NPO/50V/B
C53
1.5p/4/NPO/50V/B
C69
1.5p/4/NPO/50V/B
C83
1.5p/4/NPO/50V/B
C92
1.5p/4/NPO/50V/B
C101
1.5p/4/NPO/50V/B
C108
1.5p/4/NPO/50V/B
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1.5p/4/NPO/50V/B
4
3
2
1
DDRVTT
MAAB0
MAAB1
MAAB2
MAAB3
MAAB4
MAAB5
MAAB6
MAAB7
MAAB8
MAAB9
MAAB10
MAAB11
MAAB12
MAAB13
MAAB14
MAAB15
-SWEB
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-SRASB
SBAB0
SBAB1
SBAB2
CKEB0
CKEB1
-CSB0
-CSB1
MODT_B0
-CSB2
-CSB3
MODT_B1
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R52 47/4
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R58 47/4
R60 47/4
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R75 47/4
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R85 47/4
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R99 47/4
R100 47/4
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R104 47/4
R105 47/4
DDR18V
MAAB0
C55 22P/4/NPO/50V/J
MAAB1
C57 22P/4/NPO/50V/J
MAAB2
C59 22P/4/NPO/50V/J
MAAB3
C61 22P/4/NPO/50V/J
MAAB4
C63 22P/4/NPO/50V/J
MAAB5
C65 22P/4/NPO/50V/J
MAAB6
C67 22P/4/NPO/50V/J
MAAB7
C70 22P/4/NPO/50V/J
MAAB8
C72 22P/4/NPO/50V/J
MAAB9
C74 22P/4/NPO/50V/J
MAAB10
C75 22P/4/NPO/50V/J
MAAB11
C76 22P/4/NPO/50V/J
MAAB12
C77 22P/4/NPO/50V/J
MAAB13
C79 22P/4/NPO/50V/J
MAAB14
C81 22P/4/NPO/50V/J
MAAB15
C84 22P/4/NPO/50V/J
-SWEB
-SWEB5,8,9
-SCASB5,8,9
-SRASB5,8,9
C88 22P/4/NPO/50V/J
-SCASB
C89 22P/4/NPO/50V/J
-SRASB
C90 22P/4/NPO/50V/J
SBAB0
C91 22P/4/NPO/50V/J
SBAB1
C93 22P/4/NPO/50V/J
SBAB2
C94 22P/4/NPO/50V/J
A A
GIGABYTE Technology
Title
Size Document Number Rev
B
8
7
6
5
4
3
Date: Sheet of
2
DDRII TERMINATOR
GA-M55SLI-S4
10 36Wednesday, May 24, 2006
1
1.0