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Stratix IV GX EP4SGX180
Service Manual
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ALTERA Stratix IV GX EP4SGX180 Service Manual

Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
1A TDI TDI J20 G28 C29 J29 1A TMS TMS G23 H28 A33 N27 1A TRST TRST D26 K26 B34 A32 1A TCK TCK D25 F29 B33 G30 1A TDO TDO E25 G29 E29 F30 1A VREFB1AN0 IO DIFFIO_TX_L1n DIFFOUT_L1n H23 G30 K26 K29 1A VREFB1AN0 IO DIFFIO_TX_L1p DIFFOUT_L1p H22 H29 L26 L29 1A VREFB1AN0 IO RDN1A DIFFIO_RX_L1n DIFFOUT_L2n D28 E31 F30 C34 1A VREFB1AN0 IO RUP1A DIFFIO_RX_L1p DIFFOUT_L2p D27 E30 F29 D34 1A VREFB1AN0 IO DIFFIO_TX_L2n DIFFOUT_L3n G25 J29 J27 J30 DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L2p DIFFOUT_L3p G24 J28 J26 K30 DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L2n DIFFOUT_L4n B28 C32 D30 C31 DQSn1L DQ1L DQ1L DQSn1L DQ1L DQ1L DQSn1L DQ1L DQ1L DQSn1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L2p DIFFOUT_L4p C28 D32 D29 D31 DQS1L DQ1L/CQn1L DQ1L DQS1L DQ1L/CQn1L DQ1L DQS1L DQ1L/CQn1L DQ1L DQS1L DQ1L/CQn1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L3n DIFFOUT_L5n F26 K28 G28 M28 DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L3p DIFFOUT_L5p F25 L27 G27 N28 DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L3n DIFFOUT_L6n E28 B34 G30 C35 DQSn2L DQSn1L/DQ1L DQ1L DQSn2L DQSn1L/DQ1L DQ1L DQSn2L DQSn1L/DQ1L DQ1L DQSn2L DQSn1L/DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L3p DIFFOUT_L6p E27 A33 G29 D35 DQS2L DQS1L/CQ1L DQ1L/CQn1L DQS2L DQS1L/CQ1L DQ1L/CQn1L DQS2L DQS1L/CQ1L DQ1L/CQn1L DQS2L DQS1L/CQ1L DQ1L/CQn1L 1A VREFB1AN0 IO DIFFIO_TX_L4n DIFFOUT_L7n H25 L26 K28 H32 DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L4p DIFFOUT_L7p H24 M25 K27 J32 DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L4n DIFFOUT_L8n G27 C34 H30 B32 DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L4p DIFFOUT_L8p G26 B33 H29 C32 DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L DQ2L DQ1L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L5n DIFFOUT_L9n K24 N25 M28 M31 DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L5p DIFFOUT_L9p K23 N24 L27 N31 DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L5n DIFFOUT_L10n F28 F32 J30 C33 DQSn3L DQ2L DQSn1L/DQ1L DQSn3L DQ2L DQSn1L/DQ1L DQSn3L DQ2L DQSn1L/DQ1L DQSn3L DQ2L DQSn1L/DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L5p DIFFOUT_L10p G28 F31 J29 D33 DQS3L DQ2L/CQn2L DQS1L/CQ1L DQS3L DQ2L/CQn2L DQS1L/CQ1L DQS3L DQ2L/CQn2L DQS1L/CQ1L DQS3L DQ2L/CQn2L DQS1L/CQ1L 1A VREFB1AN0 IO DIFFIO_TX_L6n DIFFOUT_L11n K22 K29 M26 M30 DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_TX_L6p DIFFOUT_L11p K21 L28 N26 N30 DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L DQ3L DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L6n DIFFOUT_L12n J26 D34 K30 G31 DQSn4L DQSn2L/DQ2L DQ1L DQSn4L DQSn2L/DQ2L DQ1L DQSn4L DQSn2L/DQ2L DQ1L DQSn4L DQSn2L/DQ2L DQ1L 1A VREFB1AN0 IO DIFFIO_RX_L6p DIFFOUT_L12p J25 D33 K29 H31 DQS4L DQS2L/CQ2L DQ1L DQS4L DQS2L/CQ2L DQ1L DQS4L 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DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L9n DIFFOUT_L18n F34 R25 E34 DQSn6L DQSn3L/DQ3L DQSn6L DQSn3L/DQ3L DQSn6L DQSn3L/DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L9p DIFFOUT_L18p G33 P24 F34 DQS6L DQS3L/CQ3L DQS6L DQS3L/CQ3L DQS6L DQS3L/CQ3L 1A VREFB1AN0 IO DIFFIO_TX_L10n DIFFOUT_L19n K31 U27 R27 DQ6L DQ3L DQ6L DQ3L DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L10p DIFFOUT_L19p L30 U26 T27 DQ6L DQ3L DQ6L DQ3L DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L10n DIFFOUT_L20n J32 T30 F35 DQ6L DQ3L DQ6L DQ3L DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_RX_L10p DIFFOUT_L20p J31 T29 G35 DQ6L DQ3L DQ6L DQ3L DQ6L DQ3L 1A VREFB1AN0 IO DIFFIO_TX_L11n DIFFOUT_L21n M29 U25 J33 DQ7L DQ7L DQ7L 1A VREFB1AN0 IO DIFFIO_TX_L11p DIFFOUT_L21p N28 V24 K32 DQ7L DQ7L DQ7L 1A VREFB1AN0 IO DIFFIO_RX_L11n DIFFOUT_L22n G34 U29 F33 DQSn7L DQSn7L DQSn7L 1A VREFB1AN0 IO DIFFIO_RX_L11p DIFFOUT_L22p H33 U28 G33 DQS7L DQS7L DQS7L 1A VREFB1AN0 IO DIFFIO_TX_L12n DIFFOUT_L23n P24 T24 P29 DQ7L DQ7L DQ7L 1A VREFB1AN0 IO DIFFIO_TX_L12p DIFFOUT_L23p P23 U24 R29 DQ7L DQ7L DQ7L 1A VREFB1AN0 IO DIFFIO_RX_L12n DIFFOUT_L24n H34 V28 H35 1A VREFB1AN0 IO DIFFIO_RX_L12p DIFFOUT_L24p J34 V27 H34 1C VREFB1CN0 IO DIFFIO_TX_L13n DIFFOUT_L25n P26 W24 L32 DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L13p DIFFOUT_L25p R25 Y24 M32 DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L13n DIFFOUT_L26n K32 V30 J35 DQSn8L DQ8L DQ8L DQSn8L DQ8L DQ8L DQSn8L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L13p DIFFOUT_L26p L31 V29 J34 DQS8L DQ8L/CQn8L DQ8L DQS8L DQ8L/CQn8L DQ8L DQS8L DQ8L/CQn8L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L14n DIFFOUT_L27n N30 AA26 P32 DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L14p DIFFOUT_L27p N29 Y25 P31 DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L14n DIFFOUT_L28n K34 AB30 K35 DQSn9L DQSn8L/DQ8L DQ8L DQSn9L DQSn8L/DQ8L DQ8L DQSn9L DQSn8L/DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L14p DIFFOUT_L28p K33 AA29 K34 DQS9L DQS8L/CQ8L DQ8L/CQn8L DQS9L DQS8L/CQ8L DQ8L/CQn8L DQS9L DQS8L/CQ8L DQ8L/CQn8L 1C VREFB1CN0 IO DIFFIO_TX_L15n DIFFOUT_L29n P28 AB26 T31 DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L15p DIFFOUT_L29p P27 AB25 T30 DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L15n DIFFOUT_L30n L34 AB29 N34 DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L15p DIFFOUT_L30p L33 AC29 N33 DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L DQ9L DQ8L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L16n DIFFOUT_L31n T25 AC25 R33 DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L16p DIFFOUT_L31p T24 AC24 R32 DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L 1C VREFB1CN0 IO 1C VREFB1CN0 IO DIFFIO_RX_L16p DIFFOUT_L32p M31 AB27 M33 DQS10L DQ9L/CQn9L DQS8L/CQ8L DQS10L DQ9L/CQn9L DQS8L/CQ8L DQS10L DQ9L/CQn9L DQS8L/CQ8L 1C VREFB1CN0 IO DIFFIO_TX_L17n DIFFOUT_L33n L24 T23 AF27 V28 DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L17p DIFFOUT_L33p M23 U23 AE26 W28 DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L DQ10L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L17n DIFFOUT_L34n L26 N32 AH30 L35 DQSn8L DQSn11L DQSn9L/DQ9L DQ8L DQSn11L DQSn9L/DQ9L DQ8L DQSn11L DQSn9L/DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L17p DIFFOUT_L34p L25 N31 AG29 L34 DQS8L DQS11L DQS9L/CQ9L DQ8L DQS11L DQS9L/CQ9L DQ8L DQS11L DQS9L/CQ9L DQ8L 1C VREFB1CN0 IO CLKUSR DIFFIO_TX_L18n DIFFOUT_L35n N21 P29 AH28 R31 DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_TX_L18p DIFFOUT_L35p N20 R29 AG27 R30 DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L18n DIFFOUT_L36n J28 M34 AJ30 V31 DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L 1C VREFB1CN0 IO DIFFIO_RX_L18p DIFFOUT_L36p K28 N33 AH29 U31 DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L DQ11L DQ9L DQ8L 1C VREFB1CN0 IO DATA0 DIFFIO_TX_L19n DIFFOUT_L37n N23 T29 AC27 W30 DQ9L DQ8L DQ12L DQ10L DQ12L DQ10L DQ12L DQ10L 1C VREFB1CN0 IO DATA1 DIFFIO_TX_L19p DIFFOUT_L37p N22 T28 AC26 W29 DQ9L DQ8L DQ12L DQ10L DQ12L DQ10L DQ12L DQ10L 1C VREFB1CN0 IO DATA2 DIFFIO_RX_L19n DIFFOUT_L38n L28 P32 AG30 N35 DQSn9L DQ8L DQSn12L DQ10L DQSn12L DQ10L DQSn12L DQ10L 1C VREFB1CN0 IO DATA3 DIFFIO_RX_L19p DIFFOUT_L38p K27 P31 AF29 P34 DQS9L DQ8L/CQn8L DQS12L DQ10L/CQn10L DQS12L DQ10L/CQn10L DQS12L DQ10L/CQn10L 1C VREFB1CN0 IO DATA4 DIFFIO_TX_L20n DIFFOUT_L39n P21 T27 AD27 V27 DQ9L DQ8L DQ12L DQ10L DQ12L DQ10L DQ12L DQ10L 1C VREFB1CN0 IO DATA5 DIFFIO_TX_L20p DIFFOUT_L39p P20 T26 AE27 W26 DQ9L DQ8L DQ12L DQ10L DQ12L DQ10L DQ12L DQ10L 1C VREFB1CN0 IO DATA6 DIFFIO_RX_L20n DIFFOUT_L40n M26 N34 AE30 R35 DQSn10L DQSn8L/DQ8L DQSn13L DQSn10L/DQ10L DQSn13L DQSn10L/DQ10L DQSn13L DQSn10L/DQ10L 1C VREFB1CN0 IO DATA7 DIFFIO_RX_L20p DIFFOUT_L40p M25 P33 AE29 R34 DQS10L DQS8L/CQ8L DQS13L DQS10L/CQ10L DQS13L DQS10L/CQ10L DQS13L DQS10L/CQ10L 1C VREFB1CN0 IO INIT_DONE DIFFIO_TX_L21n DIFFOUT_L41n N25 V25 AE28 V30 DQ10L DQ8L DQ13L DQ10L DQ13L DQ10L DQ13L DQ10L 1C VREFB1CN0 IO CRC_ERROR DIFFIO_TX_L21p DIFFOUT_L41p N24 U24 AF28 V29 DQ10L DQ8L DQ13L DQ10L DQ13L DQ10L DQ13L DQ10L 1C VREFB1CN0 IO DEV_OE DIFFIO_RX_L21n DIFFOUT_L42n M28 R32 AD30 U35 DQ10L DQ8L DQ13L DQ10L DQ13L DQ10L DQ13L DQ10L 1C VREFB1CN0 IO DEV_CLRn DIFFIO_RX_L21p DIFFOUT_L42p L27 R31 AD29 V34 DQ10L DQ8L DQ13L DQ10L DQ13L DQ10L DQ13L DQ10L 1C VREFB1CN0 IO PLL_L2_CLKOUT0n DIFFIO_TX_L22n DIFFOUT_L43n P26 V23 AK30 W33 1C VREFB1CN0 IO PLL_L2_FB_CLKOUT0p DIFFIO_TX_L22p DIFFOUT_L43p P25 W23 AJ29 W32 1C VREFB1CN0 IO CLK0n DIFFIO_RX_L22n DIFFOUT_L44n N28 T31 AL30 W35 1C VREFB1CN0 IO CLK0p DIFFIO_RX_L22p DIFFOUT_L44p N27 T30 AK29 W34 1C VREFB1CN0 CLK1n CLK1n P28 P34 AM34 AA35 1C VREFB1CN0 CLK1p CLK1p P27 R34 AM33 AB34 2C VREFB2CN0 CLK3p CLK3p T28 AC34 2C VREFB2CN0 CLK3n CLK3n R28 AC35 2C VREFB2CN0 IO CLK2p DIFFIO_RX_L23p DIFFOUT_L45p T27 AF34 2C VREFB2CN0 IO CLK2n DIFFIO_RX_L23n DIFFOUT_L45n U28 AE35 2C VREFB2CN0 IO PLL_L3_FB_CLKOUT0p DIFFIO_TX_L23p DIFFOUT_L46p R25 AG34 2C VREFB2CN0 IO PLL_L3_CLKOUT0n DIFFIO_TX_L23n DIFFOUT_L46n R26 AG35 2C VREFB2CN0 IO DIFFIO_RX_L24p DIFFOUT_L47p T25 AC31 DQ17L DQ19L DQ14L DQ17L 2C VREFB2CN0 IO DIFFIO_RX_L24n DIFFOUT_L47n U26 AC32 DQ17L DQ19L DQ14L DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L24p DIFFOUT_L48p R20 AB30 DQ17L DQ19L DQ14L DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L24n DIFFOUT_L48n T21 AB31 DQ17L DQ19L DQ14L DQ17L 2C VREFB2CN0 IO DIFFIO_RX_L25p DIFFOUT_L49p U27 AJ34 DQS17L DQS19L/CQ19L DQS14L DQS17L/CQ17L 2C VREFB2CN0 IO DIFFIO_RX_L25n DIFFOUT_L49n V28 AJ35 DQSn17L DQSn19L/DQ19L DQSn14L DQSn17L/DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L25p DIFFOUT_L50p T22 AB27 DQ18L DQ19L DQ15L DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L25n DIFFOUT_L50n T23 AB28 DQ18L DQ19L DQ15L DQ17L 2C VREFB2CN0 IO DIFFIO_RX_L26p DIFFOUT_L51p U25 AH34 DQS18L DQ19L/CQn19L DQS15L DQ17L/CQn17L 2C VREFB2CN0 IO DIFFIO_RX_L26n DIFFOUT_L51n V26 AH35 DQSn18L DQ19L DQSn15L DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L26p DIFFOUT_L52p T20 AC28 DQ18L DQ19L DQ15L DQ17L 2C VREFB2CN0 IO DIFFIO_TX_L26n DIFFOUT_L52n U21 AC29 DQ18L DQ19L DQ15L DQ17L 2C VREFB2CN0 IO DIFFIO_RX_L27p DIFFOUT_L53p W27 AK34 DQ19L DQ16L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_RX_L27n DIFFOUT_L53n W28 AK35 DQ19L DQ16L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_TX_L27p DIFFOUT_L54p U23 AG31 DQ19L DQ16L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_TX_L27n DIFFOUT_L54n U24 AG32 DQ19L DQ16L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_RX_L28p DIFFOUT_L55p V25 AL34 DQS19L DQS16L DQS18L/CQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_RX_L28n DIFFOUT_L55n W26 AL35 DQSn19L DQSn16L DQSn18L/DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_TX_L28p DIFFOUT_L56p V22 AD28 DQ17L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_TX_L28n DIFFOUT_L56n V23 AD29 DQ17L DQ18L DQ19L 2C VREFB2CN0 IO DIFFIO_RX_L29p DIFFOUT_L57p AH32 DQS17L DQ18L/CQn18L DQS19L/CQ19L 2C VREFB2CN0 IO DIFFIO_RX_L29n DIFFOUT_L57n AH33 DQSn17L DQ18L DQSn19L/DQ19L
PT-EP4SGX180-1.1 Copyright © 2009 Altera Corp.
Configuration
Dedicated Tx/Rx
Function
Channel
DIFFIO_RX_L16n DIFFOUT_L32n M32 AC28 M34 DQSn10L
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
DIFFOUT_L16n K26 E34 M30 E32 DQSn5L DQ3L DQSn5L DQ3L DQSn5L DQ3L
F1517
DQS for X4 for F780
DQS for X8/X9 for F780

Pin List Page 1 of 18

DQS for X16/X18 for F780
DQS for X4 for
DQS for X8/X9 for
DQS for X16/X18 for
DQS for X4 for F1152
F1152
F1152
DQ9L DQSn8L/DQ8L DQSn10L DQ9L DQSn8L/DQ8L DQSn10L DQ9L DQSn8L/DQ8L
F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4 for F1517
DQS for X8/X9 for F1517
ersion 1.1
DQS for X16/ X18 for F1517
Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
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PT-EP4SGX180-1.1 Copyright © 2009 Altera Corp.
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Configuration Function
Dedicated Tx/Rx Channel
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
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DQS for X4 for
DQS for X8/X9 for
DQS for X16/X18 for
DQS for X4 for
DQS for X8/X9 for
F1517
DQS for X16/X18 for
DQS for X4 for F1152
F780
F780
F780
F1152
F1152
F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4
DQS for X8/X9 for
for F1517
F1517
DQ21L DQ24L
Pin List Page 2 of 18
ersion 1.1
DQS for X16/ X18 for F1517
Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
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PT-EP4SGX180-1.1 Copyright © 2009 Altera Corp.
Configuration Function
Dedicated Tx/Rx Channel
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
DIFFOUT_B58p AB12 AL16 AK14 AG18 DQ14B DQ14B DQ14B DQ14B
DIFFOUT_B77p Y12 Y12 AC12 AN15
F1517
DQS for X4 for F780
DQS for X8/X9 for F780
DQS for X16/X18 for F780
DQS for X4 for F1152
DQS for X8/X9 for F1152
DQS for X16/X18 for F1152
DQS for X4 for F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4 for F1517
Pin List Page 3 of 18
DQS for X8/X9 for F1517
ersion 1.1
DQS for X16/ X18 for F1517
Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
4A VREFB4AN0 IO DIFFOUT_B90n AD8 AH9 AM5 AM14 DQ24B DQ25B DQ26B DQ24B DQ25B DQ26B DQ24B DQ25B DQ26B DQ24B DQ25B DQ26B 4A VREFB4AN0 IO DIFFIO_RX_B46p DIFFOUT_B91p AG4 AD9 AN8 AJ13 DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B 4A VREFB4AN0 IO DIFFIO_RX_B46n DIFFOUT_B91n AH4 AE9 AP8 AK13 DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B92p AF3 AE11 AP7 AH13 DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B92n AF4 AE12 AP9 AK14 DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B DQ25B DQ26B DQ26B 4A VREFB4AN0 IO DIFFIO_RX_B47p DIFFOUT_B93p AH2 AD11 AN6 AH14 DQS25B DQS26B/CQ26B DQ26B/CQn26B DQS25B DQS26B/CQ26B DQ26B/CQn26B DQS25B DQS26B/CQ26B DQ26B/CQn26B DQS25B DQS26B/CQ26B DQ26B/CQn26B 4A VREFB4AN0 IO DIFFIO_RX_B47n DIFFOUT_B93n AH3 AE10 AP6 AJ14 DQSn25B DQSn26B/DQ26B DQ26B DQSn25B DQSn26B/DQ26B DQ26B DQSn25B DQSn26B/DQ26B DQ26B DQSn25B DQSn26B/DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B94p AC6 AB11 AN3 AG14 DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B94n AC8 AB12 AN5 AG15 DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B 4A VREFB4AN0 IO RUP4A DIFFIO_RX_B48p DIFFOUT_B95p AA8 AB10 AP4 AE14 DQS26B DQ26B/CQn26B DQ26B DQS26B DQ26B/CQn26B DQ26B DQS26B DQ26B/CQn26B DQ26B DQS26B DQ26B/CQn26B DQ26B 4A VREFB4AN0 IO RDN4A DIFFIO_RX_B48n DIFFOUT_B95n AB7 AC10 AP5 AF14 DQSn26B DQ26B DQ26B DQSn26B DQ26B DQ26B DQSn26B DQ26B DQ26B DQSn26B DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B96p Y9 AA10 AM4 AD15 DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B 4A VREFB4AN0 IO DIFFOUT_B96n AA10 AA11 AP3 AE15 DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B DQ26B
5A VREFB5AN0 IO DIFFIO_TX_R1n DIFFOUT_R1n AM10 5A VREFB5AN0 IO DIFFIO_TX_R1p DIFFOUT_R1p AL10 5A VREFB5AN0 IO RDN5A DIFFIO_RX_R1n DIFFOUT_R2n AW7 5A VREFB5AN0 IO RUP5A DIFFIO_RX_R1p DIFFOUT_R2p AV7 5A VREFB5AN0 IO DIFFIO_TX_R2n DIFFOUT_R3n AP10 DQ1R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_TX_R2p DIFFOUT_R3p AN10 DQ1R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R2n DIFFOUT_R4n AW8 DQSn1R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R2p DIFFOUT_R4p AV8 DQS1R DQ1R/CQn1R DQ1R 5A VREFB5AN0 IO DIFFIO_TX_R3n DIFFOUT_R5n AJ11 DQ1R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_TX_R3p DIFFOUT_R5p AH11 DQ1R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R3n DIFFOUT_R6n AU10 DQSn2R DQSn1R/DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R3p DIFFOUT_R6p AT10 DQS2R DQS1R/CQ1R DQ1R/CQn1R 5A VREFB5AN0 IO DIFFIO_TX_R4n DIFFOUT_R7n AH12 DQ2R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_TX_R4p DIFFOUT_R7p AG12 DQ2R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R4n DIFFOUT_R8n AW10 DQ2R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_RX_R4p DIFFOUT_R8p AV10 DQ2R DQ1R DQ1R 5A VREFB5AN0 IO DIFFIO_TX_R5n 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PT-EP4SGX180-1.1 Copyright © 2009 Altera Corp.
nIO_PULLUP nIO_PULLUP Y8 AM6 AP2 AM11 nCEO nCEO W6 AE8 AK3 AT11 DCLK DCLK Y6 AM5 AL3 AR11 nCSO nCSO W7 AD8 AL4 AP11 ASDO ASDO Y7 AN5 AN1 AN11
VREFB5AN0 IO DIFFIO_RX_R12n DIFFOUT_R24n AW5
Configuration
Dedicated Tx/Rx
Function
Channel
DIFFIO_TX_R12p DIFFOUT_R23p AD13 DQ7R
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
DIFFOUT_R11n AP9 DQ3R DQ2R DQ1R
DIFFOUT_R36p AJ6 DQ11R DQ9R DQ8R
F1517
DQS for X4 for F780
DQS for X8/X9 for F780
DQS for X16/X18 for F780
DQS for X4 for F1152
DQS for X8/X9 for F1152
DQS for X16/X18 for F1152
DQS for X4 for F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
Pin List Page 4 of 18
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4 for F1517
DQS for X8/X9 for F1517
ersion 1.1
DQS for X16/ X18 for F1517
Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
6C VREFB6CN0 IO DIFFIO_RX_R26n DIFFOUT_R51n N1 AG5 R5 DQSn15R DQ17R DQSn15R DQ17R DQSn15R DQ17R 6C VREFB6CN0 IO DIFFIO_TX_R26p DIFFOUT_R52p T11 AC9 V10 DQ15R DQ17R DQ15R DQ17R DQ15R DQ17R 6C VREFB6CN0 IO DIFFIO_TX_R26n DIFFOUT_R52n T10 AC8 V9 DQ15R DQ17R DQ15R DQ17R DQ15R DQ17R 6C VREFB6CN0 IO DIFFIO_RX_R27p DIFFOUT_R53p M2 AG6 R7 DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R 6C VREFB6CN0 IO DIFFIO_RX_R27n DIFFOUT_R53n M1 AH5 P6 DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R 6C VREFB6CN0 IO DIFFIO_TX_R27p DIFFOUT_R54p T7 AG8 N9 DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R 6C VREFB6CN0 IO DIFFIO_TX_R27n DIFFOUT_R54n T6 AH7 P8 DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R DQ16R DQ18R DQ19R 6C VREFB6CN0 IO DIFFIO_RX_R28p DIFFOUT_R55p N4 AH6 N6 DQS16R DQS18R/CQ18R DQ19R DQS16R DQS18R/CQ18R DQ19R DQS16R DQS18R/CQ18R DQ19R 6C VREFB6CN0 IO DIFFIO_RX_R28n DIFFOUT_R55n N3 AJ5 N5 DQSn16R DQSn18R/DQ18R DQ19R DQSn16R DQSn18R/DQ18R DQ19R DQSn16R DQSn18R/DQ18R DQ19R 6C VREFB6CN0 IO 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MSEL2 MSEL2 J7 K9 E6 A8 MSEL1 MSEL1 J9 L10 C6 H11 MSEL0 MSEL0 K9 J9 C5 J11
Configuration Function
Dedicated Tx/Rx Channel
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
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DIFFOUT_R84n K7 G7 M12 DQ26R DQ26R DQ26R DQ26R DQ26R DQ26R DQ26R DQ26R DQ26R
DIFFOUT_T21n M15 A11 G15 DQ7T
F1517
DQS for X4 for F780
DQS for X8/X9 for F780
DQS for X16/X18 for F780
DQS for X4 for
DQS for X8/X9 for
DQS for X16/X18 for
DQS for X4 for F1152
F1152
F1152
DQ7T DQ7T DQ7T DQ7T DQ7T DQ7T DQ7T DQ7T
F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4 for F1517
DQS for X8/X9 for F1517
Pin List Page 5 of 18
ersion 1.1
DQS for X16/ X18 for F1517
Pin Information for the Stratix® IV GX EP4SGX180 Device
V
Bank Number VREF Pin Name/Function Optional Function(s)
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PT-EP4SGX180-1.1 Copyright © 2009 Altera Corp.
Configuration Function
Dedicated Tx/Rx Channel
Emulated LVDS Output Channel F780 F1152 Note(1), (2)
DIFFOUT_T42p D14 H15 J16 B19
DIFFOUT_T71n H21 E24 F24 DQ19T DQ20T DQ20T DQ19T DQ20T DQ20T DQ19T DQ20T DQ20T
F1517
DQS for X4 for F780
DQS for X8/X9 for F780
DQS for X16/X18 for F780
DQS for X4 for F1152
DQS for X8/X9 for F1152
DQS for X16/X18 for F1152
DQS for X4 for F1152
(with PMA Transceiver)
DQS for X8/X9 for F1152 (with PMA Transceiver)
DQS for X16/X18 for F1152
(with PMA Transceiver)
DQS for X4 for F1517
DQS for X8/X9 for F1517
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ersion 1.1
DQS for X16/ X18 for F1517
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