
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
1A TDI TDI J29
1A TMS TMS N27
1A TRST TRST A32
1A TCK TCK G30
1A TDO TDO F30
1A VREFB1AN0 IO DIFFIO_TX_L1n DIFFOUT_L1n K29
1A VREFB1AN0 IO DIFFIO_TX_L1p DIFFOUT_L1p L29
1A VREFB1AN0 IO RDN1A DIFFIO_RX_L1n DIFFOUT_L2n C34
1A VREFB1AN0 IO RUP1A DIFFIO_RX_L1p DIFFOUT_L2p D34
1A VREFB1AN0 IO DIFFIO_TX_L2n DIFFOUT_L3n J30 DQ1L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L2p DIFFOUT_L3p K30 DQ1L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L2n DIFFOUT_L4n C31 DQSn1L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L2p DIFFOUT_L4p D31 DQS1L DQ1L/CQn1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L3n DIFFOUT_L5n M28 DQ1L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L3p DIFFOUT_L5p N28 DQ1L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L4n DIFFOUT_L7n H32 DQ2L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L4p DIFFOUT_L7p J32 DQ2L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L4n DIFFOUT_L8n B32 DQ2L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L4p DIFFOUT_L8p C32 DQ2L DQ1L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L5n DIFFOUT_L9n M31 DQ3L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L5p DIFFOUT_L9p N31 DQ3L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L5n DIFFOUT_L10n C33 DQSn3L DQ2L DQSn1L/DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L5p DIFFOUT_L10p D33 DQS3L DQ2L/CQn2L DQS1L/CQ1L
1A VREFB1AN0 IO DIFFIO_TX_L6n DIFFOUT_L11n M30 DQ3L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L6p DIFFOUT_L11p N30 DQ3L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L6n DIFFOUT_L12n G31 DQSn4L DQSn2L/DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L6p DIFFOUT_L12p H31 DQS4L DQS2L/CQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L7n DIFFOUT_L13n M29 DQ4L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L7p DIFFOUT_L13p N29 DQ4L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L7n DIFFOUT_L14n E31 DQ4L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_RX_L7p DIFFOUT_L14p F31 DQ4L DQ2L DQ1L
1A VREFB1AN0 IO DIFFIO_TX_L8n DIFFOUT_L15n K31 DQ5L DQ3L
1A VREFB1AN0 IO DIFFIO_TX_L8p DIFFOUT_L15p L31 DQ5L DQ3L
1A VREFB1AN0 IO DIFFIO_RX_L8n DIFFOUT_L16n E32 DQSn5L DQ3L
1A VREFB1AN0 IO DIFFIO_RX_L8p DIFFOUT_L16p F32 DQS5L DQ3L/CQn3L
1A VREFB1AN0 IO DIFFIO_TX_L9n DIFFOUT_L17n R28 DQ5L DQ3L
1A VREFB1AN0 IO DIFFIO_TX_L9p DIFFOUT_L17p T28 DQ5L DQ3L
1A VREFB1AN0 IO DIFFIO_RX_L9n DIFFOUT_L18n E34 DQSn6L DQSn3L/DQ3L
1A VREFB1AN0 IO DIFFIO_RX_L9p DIFFOUT_L18p F34 DQS6L DQS3L/CQ3L
1A VREFB1AN0 IO DIFFIO_TX_L10n DIFFOUT_L19n R27 DQ6L DQ3L
1A VREFB1AN0 IO DIFFIO_TX_L10p DIFFOUT_L19p T27 DQ6L DQ3L
1A VREFB1AN0 IO DIFFIO_TX_L11n DIFFOUT_L21n J33 DQ7L
1A VREFB1AN0 IO DIFFIO_TX_L11p DIFFOUT_L21p K32 DQ7L
1A VREFB1AN0 IO DIFFIO_RX_L11n DIFFOUT_L22n F33 DQSn7L
1A VREFB1AN0 IO DIFFIO_RX_L11p DIFFOUT_L22p G33 DQS7L
1A VREFB1AN0 IO DIFFIO_TX_L12n DIFFOUT_L23n P29 DQ7L
1A VREFB1AN0 IO DIFFIO_TX_L12p DIFFOUT_L23p R29 DQ7L
1A VREFB1AN0 IO DIFFIO_RX_L12p DIFFOUT_L24p H34
1C VREFB1CN0 IO DIFFIO_TX_L19n DIFFOUT_L37n L32 DQ12L DQ12L DQ12L
1C VREFB1CN0 IO DIFFIO_TX_L19p DIFFOUT_L37p M32 DQ12L DQ12L DQ12L
1C VREFB1CN0 IO DIFFIO_TX_L20n
1C VREFB1CN0 IO DIFFIO_TX_L20p DIFFOUT_L39p P31 DQ12L DQ12L DQ12L
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DIFFOUT_L39n P32 DQ12L DQ12L DQ12L
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
Pin List Page 1 of 35

Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
1C VREFB1CN0 IO DIFFIO_TX_L21p DIFFOUT_L41p T30 DQ13L DQ12L DQ12L
1C VREFB1CN0 IO DIFFIO_RX_L21n DIFFOUT_L42n N34 DQ13L DQ12L DQ12L
1C VREFB1CN0 IO DIFFIO_RX_L21p DIFFOUT_L42p N33 DQ13L DQ12L DQ12L
1C VREFB1CN0 IO DIFFIO_RX_L22n DIFFOUT_L44n M34 DQSn14L DQ13L DQSn12L/DQ12L
1C VREFB1CN0 IO DIFFIO_RX_L22p DIFFOUT_L44p M33 DQS14L DQ13L/CQn13L DQS12L/CQ12L
1C VREFB1CN0 IO DIFFIO_TX_L23n DIFFOUT_L45n V28 DQ14L DQ13L DQ12L
1C VREFB1CN0 IO DIFFIO_TX_L23p DIFFOUT_L45p W28 DQ14L DQ13L DQ12L
1C VREFB1CN0 IO DIFFIO_RX_L23p DIFFOUT_L46p L34 DQS15L DQS13L/CQ13L DQ12L
1C VREFB1CN0 CLKUSR CLKUSR R31
1C VREFB1CN0 IO DIFFIO_TX_L24p DIFFOUT_L47p R30 DQ15L DQ13L DQ12L
1C VREFB1CN0 IO DATA0 DIFFIO_TX_L25n DIFFOUT_L49n W30 DQ16L DQ14L
1C VREFB1CN0 IO DATA1 DIFFIO_TX_L25p DIFFOUT_L49p W29 DQ16L DQ14L
1C VREFB1CN0 DATA2 DATA2 N35
1C VREFB1CN0 IO DATA3 DIFFIO_RX_L25p DIFFOUT_L50p P34 DQS16L DQ14L/CQn14L
1C VREFB1CN0 IO DATA4 DIFFIO_TX_L26n DIFFOUT_L51n V27 DQ16L DQ14L
1C VREFB1CN0 IO DATA5 DIFFIO_TX_L26p DIFFOUT_L51p W26 DQ16L DQ14L
1C VREFB1CN0 DATA6 DATA6 R35
1C VREFB1CN0 DATA7 DATA7 R34
1C VREFB1CN0 IO INIT_DONE DIFFIO_TX_L27n DIFFOUT_L53n V30 DQ17L DQ14L
1C VREFB1CN0 IO CRC_ERROR DIFFIO_TX_L27p DIFFOUT_L53p V29 DQ17L DQ14L
1C VREFB1CN0 DEV_OE DEV_OE U35
1C VREFB1CN0 DEV_CLRn DEV_CLRn V34
1C VREFB1CN0 CLK1n CLK1n J34
1C VREFB1CN0 CLK1p CLK1p K34
2C VREFB2CN0 CLK3p CLK3p AJ34
2C VREFB2CN0 CLK3n CLK3n AH34
2C VREFB2CN0 IO DIFFIO_TX_L30p DIFFOUT_L60p AB30 DQ18L DQ21L
2C VREFB2CN0 IO DIFFIO_TX_L31p DIFFOUT_L62p AB27 DQ19L DQ21L
2C VREFB2CN0 IO DIFFIO_TX_L31n DIFFOUT_L62n AB28 DQ19L DQ21L
2C VREFB2CN0 IO DIFFIO_TX_L32p DIFFOUT_L64p AC28 DQ19L DQ21L
2C VREFB2CN0 IO DIFFIO_TX_L32n DIFFOUT_L64n AC29 DQ19L DQ21L
2C VREFB2CN0 IO DIFFIO_RX_L33p DIFFOUT_L65p AK34 DQ20L DQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L34p DIFFOUT_L67p AL34 DQS20L DQS22L/CQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L34p DIFFOUT_L68p AD28 DQ21L DQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L34n DIFFOUT_L68n AD29 DQ21L DQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L35p DIFFOUT_L69p AH32 DQS21L DQ22L/CQn22L DQS23L/CQ23L
2C VREFB2CN0 IO DIFFIO_RX_L35n DIFFOUT_L69n AH33 DQSn21L DQ22L DQSn23L/DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L35p DIFFOUT_L70p AE28 DQ21L DQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L35n DIFFOUT_L70n AE29 DQ21L DQ22L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L36p DIFFOUT_L71p AN34 DQ22L DQ23L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L36p DIFFOUT_L72p AD30 DQ22L DQ23L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L37p DIFFOUT_L73p AM34 DQS22L DQS23L/CQ23L DQ23L/CQn23L
2C VREFB2CN0 IO DIFFIO_TX_L37p DIFFOUT_L74p AF29 DQ23L DQ23L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L37n DIFFOUT_L74n AG30 DQ23L DQ23L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L38p DIFFOUT_L75p AJ32 DQS23L DQ23L/CQn23L DQ23L
2C VREFB2CN0 IO DIFFIO_RX_L38n DIFFOUT_L75n AK33 DQSn23L DQ23L DQ23L
2C VREFB2CN0 IO DIFFIO_TX_L38p DIFFOUT_L76p AE30 DQ23L DQ23L DQ23L
2A VREFB2AN0 IO DIFFIO_RX_L45p DIFFOUT_L89p AN32
2A VREFB2AN0 IO DIFFIO_RX_L45n DIFFOUT_L89n AP33
2A VREFB2AN0 IO DIFFIO_TX_L45p DIFFOUT_L90p AC26 DQ28L
2A VREFB2AN0 IO DIFFIO_TX_L45n DIFFOUT_L90n AD26 DQ28L
2A VREFB2AN0 IO DIFFIO_RX_L46p DIFFOUT_L91p AN33 DQS28L
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
Pin List Page 2 of 35

Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
2A VREFB2AN0 IO DIFFIO_RX_L46n DIFFOUT_L91n AP34 DQSn28L
2A VREFB2AN0 IO DIFFIO_TX_L46p DIFFOUT_L92p AD27 DQ28L
2A VREFB2AN0 IO DIFFIO_TX_L46n DIFFOUT_L92n AE27 DQ28L
2A VREFB2AN0 IO DIFFIO_RX_L47p DIFFOUT_L93p AT34 DQ29L DQ32L
2A VREFB2AN0 IO DIFFIO_RX_L47n DIFFOUT_L93n AR34 DQ29L DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L47p DIFFOUT_L94p AJ31 DQ29L DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L47n DIFFOUT_L94n AH30 DQ29L DQ32L
2A VREFB2AN0 IO DIFFIO_RX_L48p DIFFOUT_L95p AT33 DQS29L DQS32L/CQ32L
2A VREFB2AN0 IO DIFFIO_RX_L48n DIFFOUT_L95n AU33 DQSn29L DQSn32L/DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L48p DIFFOUT_L96p AK32 DQ30L DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L48n DIFFOUT_L96n AL32 DQ30L DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L49p DIFFOUT_L98p AG29 DQ30L DQ32L
2A VREFB2AN0 IO DIFFIO_TX_L49n DIFFOUT_L98n AH29 DQ30L DQ32L
2A VREFB2AN0 IO DIFFIO_RX_L50p DIFFOUT_L99p AP32 DQ31L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L50n DIFFOUT_L99n AR32 DQ31L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L50p DIFFOUT_L100p AK31 DQ31L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L50n DIFFOUT_L100n AL31 DQ31L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L51p DIFFOUT_L101p AN30 DQS31L DQS33L/CQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L51n DIFFOUT_L101n AP30 DQSn31L DQSn33L/DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L51p DIFFOUT_L102p AE26 DQ32L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L51n DIFFOUT_L102n AF26 DQ32L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L52p DIFFOUT_L103p AM31 DQS32L DQ33L/CQn33L DQS34L/CQ34L
2A VREFB2AN0 IO DIFFIO_RX_L52n DIFFOUT_L103n AN31 DQSn32L DQ33L DQSn34L/DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L52p DIFFOUT_L104p AK30 DQ32L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L52n DIFFOUT_L104n AL30 DQ32L DQ33L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L53p DIFFOUT_L105p AT31 DQ33L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L53n DIFFOUT_L105n AU31 DQ33L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L53p DIFFOUT_L106p AG28 DQ33L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L53n DIFFOUT_L106n AH28 DQ33L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L54p DIFFOUT_L107p AR31 DQS33L DQS34L/CQ34L DQ34L/CQn34L
2A VREFB2AN0 IO DIFFIO_RX_L54n DIFFOUT_L107n AT30 DQSn33L DQSn34L/DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L54p DIFFOUT_L108p AG27 DQ34L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L54n DIFFOUT_L108n AH27 DQ34L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L55p DIFFOUT_L109p AT32 DQS34L DQ34L/CQn34L DQ34L
2A VREFB2AN0 IO DIFFIO_RX_L55n DIFFOUT_L109n AU32 DQSn34L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L55p DIFFOUT_L110p AL29 DQ34L DQ34L DQ34L
2A VREFB2AN0 IO DIFFIO_TX_L55n DIFFOUT_L110n AM29 DQ34L DQ34L DQ34L
2A VREFB2AN0 IO RUP2A DIFFIO_RX_L56p DIFFOUT_L111p AU34
2A VREFB2AN0 IO RDN2A DIFFIO_RX_L56n DIFFOUT_L111n AV34
2A VREFB2AN0 IO DIFFIO_TX_L56p DIFFOUT_L112p AJ29
2A VREFB2AN0 IO DIFFIO_TX_L56n DIFFOUT_L112n AK29
nCONFIG nCONFIG AW36
nSTATUS nSTATUS AW35
CONF_DONE CONF_DONE AV35
PORSEL PORSEL AP29
nCE nCE AN29
3A VREFB3AN0 IO DIFFOUT_B1n AD25 DQ1B DQ1B DQ1B
3A VREFB3AN0 IO DIFFOUT_B1p AE25 DQ1B DQ1B DQ1B
3A VREFB3AN0 IO RDN3A DIFFIO_RX_B1n DIFFOUT_B2n AG25 DQSn1B DQ1B DQ1B
3A VREFB3AN0 IO RUP3A DIFFIO_RX_B1p DIFFOUT_B2p AF25 DQS1B DQ1B/CQn1B DQ1B
3A VREFB3AN0 IO DIFFOUT_B3n AE24 DQ1B DQ1B DQ1B
3A VREFB3AN0 IO DIFFOUT_B3p AK27 DQ1B DQ1B DQ1B
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
Pin List Page 3 of 35

Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
3A VREFB3AN0 IO DIFFIO_RX_B2n DIFFOUT_B4n AK26 DQSn2B DQSn1B/DQ1B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B2p DIFFOUT_B4p AJ26 DQS2B DQS1B/CQ1B DQ1B/CQn1B
3A VREFB3AN0 IO DIFFOUT_B5n AH26 DQ2B DQ1B DQ1B
3A VREFB3AN0 IO DIFFOUT_B5p AL27 DQ2B DQ1B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B3n DIFFOUT_B6n AK25 DQ2B DQ1B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B3p DIFFOUT_B6p AJ25 DQ2B DQ1B DQ1B
3A VREFB3AN0 IO DIFFOUT_B7n AW34 DQ3B DQ2B DQ1B
3A VREFB3AN0 IO DIFFOUT_B7p AW33 DQ3B DQ2B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B4n DIFFOUT_B8n AW32 DQSn3B DQ2B DQSn1B/DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B4p DIFFOUT_B8p AV32 DQS3B DQ2B/CQn2B DQS1B/CQ1B
3A VREFB3AN0 IO DIFFOUT_B9n AV31 DQ3B DQ2B DQ1B
3A VREFB3AN0 IO DIFFOUT_B9p AW31 DQ3B DQ2B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B5n DIFFOUT_B10n AW30 DQSn4B DQSn2B/DQ2B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B5p DIFFOUT_B10p AV29 DQS4B DQS2B/CQ2B DQ1B
3A VREFB3AN0 IO DIFFOUT_B11n AW28 DQ4B DQ2B DQ1B
3A VREFB3AN0 IO DIFFOUT_B11p AW27 DQ4B DQ2B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B6n DIFFOUT_B12n AW29 DQ4B DQ2B DQ1B
3A VREFB3AN0 IO DIFFIO_RX_B6p DIFFOUT_B12p AV28 DQ4B DQ2B DQ1B
3A VREFB3AN0 IO DIFFOUT_B13n AN27 DQ5B DQ3B
3A VREFB3AN0 IO DIFFOUT_B13p AP27 DQ5B DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B7n DIFFOUT_B14n AN26 DQSn5B DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B7p DIFFOUT_B14p AM26 DQS5B DQ3B/CQn3B
3A VREFB3AN0 IO DIFFOUT_B15n AP26 DQ5B DQ3B
3A VREFB3AN0 IO DIFFOUT_B15p AL25 DQ5B DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B8n DIFFOUT_B16n AR28 DQSn6B DQSn3B/DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B8p DIFFOUT_B16p AP28 DQS6B DQS3B/CQ3B
3A VREFB3AN0 IO DIFFOUT_B17n AT29 DQ6B DQ3B
3A VREFB3AN0 IO DIFFOUT_B17p AU29 DQ6B DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B9n DIFFOUT_B18n AU28 DQ6B DQ3B
3A VREFB3AN0 IO DIFFIO_RX_B9p DIFFOUT_B18p AT28 DQ6B DQ3B
3A VREFB3AN0 IO DIFFOUT_B19n AG24
3A VREFB3AN0 IO DIFFOUT_B19p AH24
3A VREFB3AN0 IO DIFFIO_RX_B10n DIFFOUT_B20n AU27
3A VREFB3AN0 IO DIFFIO_RX_B10p DIFFOUT_B20p AT27
3B VREFB3BN0 IO DIFFOUT_B25n AM25 DQ9B DQ9B DQ9B
3B VREFB3BN0 IO DIFFOUT_B25p AN25 DQ9B DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B13n DIFFOUT_B26n AP24 DQSn9B DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B13p DIFFOUT_B26p AN24 DQS9B DQ9B/CQn9B DQ9B
3B VREFB3BN0 IO DIFFOUT_B27n AP25 DQ9B DQ9B DQ9B
3B VREFB3BN0 IO DIFFOUT_B27p AR25 DQ9B DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B14n DIFFOUT_B28n AU26 DQSn10B DQSn9B/DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B14p DIFFOUT_B28p AT26 DQS10B DQS9B/CQ9B DQ9B/CQn9B
3B VREFB3BN0 IO DIFFOUT_B29n AT25 DQ10B DQ9B DQ9B
3B VREFB3BN0 IO DIFFOUT_B29p AU25 DQ10B DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B15n DIFFOUT_B30n AW26 DQ10B DQ9B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B15p DIFFOUT_B30p AV26 DQ10B DQ9B DQ9B
3B VREFB3BN0 IO DIFFOUT_B31n AH22 DQ11B DQ10B DQ9B
3B VREFB3BN0 IO DIFFOUT_B31p AE23 DQ11B DQ10B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B16n DIFFOUT_B32n AG22 DQSn11B DQ10B DQSn9B/DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B16p DIFFOUT_B32p AF22 DQS11B DQ10B/CQn10B DQS9B/CQ9B
3B VREFB3BN0 IO
3B
VREFB3BN0 IO DIFFOUT_B33p AF23 DQ11B DQ10B DQ9B
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DIFFOUT_B33n AE22 DQ11B DQ10B DQ9B
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
Pin List Page 4 of 35

Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
3B VREFB3BN0 IO DIFFIO_RX_B17n DIFFOUT_B34n AL23 DQSn12B DQSn10B/DQ10B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B17p DIFFOUT_B34p AK23 DQS12B DQS10B/CQ10B DQ9B
3B VREFB3BN0 IO DIFFOUT_B35n AK24 DQ12B DQ10B DQ9B
3B VREFB3BN0 IO DIFFOUT_B35p AJ22 DQ12B DQ10B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B18n DIFFOUT_B36n AJ23 DQ12B DQ10B DQ9B
3B VREFB3BN0 IO DIFFIO_RX_B18p DIFFOUT_B36p AH23 DQ12B DQ10B DQ9B
3C VREFB3CN0 IO DIFFOUT_B49n AN23 DQ17B DQ17B
3C VREFB3CN0 IO DIFFOUT_B49p AM23 DQ17B DQ17B
3C VREFB3CN0 IO RDN3C DIFFIO_RX_B25n DIFFOUT_B50n AN22 DQSn17B DQ17B
3C VREFB3CN0 IO RUP3C DIFFIO_RX_B25p DIFFOUT_B50p AM22 DQS17B DQ17B/CQn17B
3C VREFB3CN0 IO DIFFOUT_B51n AL21 DQ17B DQ17B
3C VREFB3CN0 IO DIFFOUT_B51p AL22 DQ17B DQ17B
3C VREFB3CN0 IO DIFFIO_RX_B26n DIFFOUT_B52n AU24 DQSn18B DQSn17B/DQ17B
3C VREFB3CN0 IO DIFFIO_RX_B26p DIFFOUT_B52p AT24 DQS18B DQS17B/CQ17B
3C VREFB3CN0 IO DIFFOUT_B53n AR23 DQ18B DQ17B
3C VREFB3CN0 IO DIFFOUT_B53p AP23 DQ18B DQ17B
3C VREFB3CN0 IO DIFFIO_RX_B27n DIFFOUT_B54n AU23 DQ18B DQ17B
3C VREFB3CN0 IO DIFFIO_RX_B27p DIFFOUT_B54p AT23 DQ18B DQ17B
3C VREFB3CN0 IO DIFFOUT_B55n AG20 DQ19B
3C VREFB3CN0 IO DIFFOUT_B55p AD21 DQ19B
3C VREFB3CN0 IO DIFFIO_RX_B28n DIFFOUT_B56n AF20 DQSn19B
3C VREFB3CN0 IO DIFFIO_RX_B28p DIFFOUT_B56p AE20 DQS19B
3C VREFB3CN0 IO DIFFOUT_B57n AE21 DQ19B
3C VREFB3CN0 IO DIFFOUT_B57p AG21 DQ19B
3C VREFB3CN0 IO DIFFIO_RX_B29n DIFFOUT_B58n AW25
3C VREFB3CN0 IO DIFFIO_RX_B29p DIFFOUT_B58p AV25
3C VREFB3CN0 IO PLL_B1_CLKOUT4 DIFFOUT_B59n AJ20
3C VREFB3CN0 IO PLL_B1_CLKOUT3 DIFFOUT_B59p AH20
3C VREFB3CN0 IO DIFFIO_RX_B30n DIFFOUT_B60n AW23
3C VREFB3CN0 IO DIFFIO_RX_B30p DIFFOUT_B60p AV23
3C VREFB3CN0 IO PLL_B1_CLKOUT0n DIFFOUT_B61n AP21
3C VREFB3CN0 IO PLL_B1_CLKOUT0p DIFFOUT_B61p AN21
3C VREFB3CN0 IO PLL_B1_FBn/CLKOUT2 DIFFIO_RX_B31n DIFFOUT_B62n AU22
3C VREFB3CN0 IO PLL_B1_FBp/CLKOUT1 DIFFIO_RX_B31p DIFFOUT_B62p AT22
3C VREFB3CN0 IO CLK5n DIFFOUT_B63n AW22
3C VREFB3CN0 IO CLK5p DIFFOUT_B63p AV22
3C VREFB3CN0 IO CLK4n DIFFIO_RX_B32n DIFFOUT_B64n AT21
3C VREFB3CN0 IO CLK4p DIFFIO_RX_B32p DIFFOUT_B64p AR22
4C VREFB4CN0 IO CLK6p DIFFIO_RX_B33p DIFFOUT_B65p AW20
4C VREFB4CN0 IO CLK6n DIFFIO_RX_B33n DIFFOUT_B65n AW21
4C VREFB4CN0 IO CLK7p DIFFOUT_B66p AV19
4C VREFB4CN0 IO CLK7n DIFFOUT_B66n AW19
4C VREFB4CN0 IO PLL_B2_FBp/CLKOUT1 DIFFIO_RX_B34p DIFFOUT_B67p AR20
4C VREFB4CN0 IO PLL_B2_FBn/CLKOUT2 DIFFIO_RX_B34n DIFFOUT_B67n AT20
4C VREFB4CN0 IO PLL_B2_CLKOUT0p DIFFOUT_B68p AN20
4C VREFB4CN0 IO PLL_B2_CLKOUT0n DIFFOUT_B68n AP20
4C VREFB4CN0 IO DIFFIO_RX_B35p DIFFOUT_B69p AU20
4C VREFB4CN0 IO DIFFIO_RX_B35n DIFFOUT_B69n AV20
4C VREFB4CN0 IO PLL_B2_CLKOUT3 DIFFOUT_B70p AH18
4C VREFB4CN0 IO PLL_B2_CLKOUT4 DIFFOUT_B70n AH19
4C VREFB4CN0 IO DIFFIO_RX_B36p DIFFOUT_B71p AT19
4C VREFB4CN0 IO DIFFIO_RX_B36n DIFFOUT_B71n AU19
PT-EP4S40G5-1.1
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Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
Pin List Page 5 of 35
DQS for X16/ X18 for
H1517

Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
4C VREFB4CN0 IO DIFFOUT_B72p AD19 DQ20B
4C VREFB4CN0 IO DIFFOUT_B72n AG19 DQ20B
4C VREFB4CN0 IO DIFFIO_RX_B37p DIFFOUT_B73p AE19 DQS20B
4C VREFB4CN0 IO DIFFIO_RX_B37n DIFFOUT_B73n AF19 DQSn20B
4C VREFB4CN0 IO DIFFOUT_B74p AG18 DQ20B
4C VREFB4CN0 IO DIFFOUT_B74n AE18 DQ20B
4C VREFB4CN0 IO DIFFIO_RX_B38p DIFFOUT_B75p AT18 DQ21B DQ22B
4C VREFB4CN0 IO DIFFIO_RX_B38n DIFFOUT_B75n AU18 DQ21B DQ22B
4C VREFB4CN0 IO DIFFOUT_B76p AT17 DQ21B DQ22B
4C VREFB4CN0 IO DIFFOUT_B76n AW18 DQ21B DQ22B
4C VREFB4CN0 IO DIFFIO_RX_B39p DIFFOUT_B77p AU17 DQS21B DQS22B/CQ22B
4C VREFB4CN0 IO DIFFIO_RX_B39n DIFFOUT_B77n AV17 DQSn21B DQSn22B/DQ22B
4C VREFB4CN0 IO DIFFOUT_B78p AN19 DQ22B DQ22B
4C VREFB4CN0 IO DIFFOUT_B78n AM19 DQ22B DQ22B
4C VREFB4CN0 IO DIFFIO_RX_B40p DIFFOUT_B79p AN18 DQS22B DQ22B/CQn22B
4C VREFB4CN0 IO DIFFIO_RX_B40n DIFFOUT_B79n AP18 DQSn22B DQ22B
4C VREFB4CN0 IO DIFFOUT_B80p AR19 DQ22B DQ22B
4C VREFB4CN0 IO DIFFOUT_B80n AP19 DQ22B DQ22B
4B VREFB4BN0 IO DIFFIO_RX_B47p DIFFOUT_B93p AK17 DQ27B DQ29B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B47n DIFFOUT_B93n AL17 DQ27B DQ29B DQ30B
4B VREFB4BN0 IO DIFFOUT_B94p AJ16 DQ27B DQ29B DQ30B
4B VREFB4BN0 IO DIFFOUT_B94n AM17 DQ27B DQ29B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B48p DIFFOUT_B95p AK16 DQS27B DQS29B/CQ29B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B48n DIFFOUT_B95n AL16 DQSn27B DQSn29B/DQ29B DQ30B
4B VREFB4BN0 IO DIFFOUT_B96p AH17 DQ28B DQ29B DQ30B
4B VREFB4BN0 IO DIFFOUT_B96n AE17 DQ28B DQ29B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B49p DIFFOUT_B97p AF17 DQS28B DQ29B/CQn29B DQS30B/CQ30B
4B VREFB4BN0 IO DIFFIO_RX_B49n DIFFOUT_B97n AG17 DQSn28B DQ29B DQSn30B/DQ30B
4B VREFB4BN0 IO DIFFOUT_B98p AH16 DQ28B DQ29B DQ30B
4B VREFB4BN0 IO DIFFOUT_B98n AG16 DQ28B DQ29B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B50p DIFFOUT_B99p AP17 DQ29B DQ30B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B50n DIFFOUT_B99n AR17 DQ29B DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B100p AN16 DQ29B DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B100n AN17 DQ29B DQ30B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B51p DIFFOUT_B101p AP16 DQS29B DQS30B/CQ30B DQ30B/CQn30B
4B VREFB4BN0 IO DIFFIO_RX_B51n DIFFOUT_B101n AR16 DQSn29B DQSn30B/DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B102p AW16 DQ30B DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B102n AT16 DQ30B DQ30B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B52p DIFFOUT_B103p AU16 DQS30B DQ30B/CQn30B DQ30B
4B VREFB4BN0 IO DIFFIO_RX_B52n DIFFOUT_B103n AV16 DQSn30B DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B104p AU15 DQ30B DQ30B DQ30B
4B VREFB4BN0 IO DIFFOUT_B104n AT15 DQ30B DQ30B DQ30B
4A VREFB4AN0 IO DIFFIO_RX_B55p DIFFOUT_B109p AN15
4A VREFB4AN0 IO DIFFIO_RX_B55n DIFFOUT_B109n AP15
4A VREFB4AN0 IO DIFFOUT_B110p AE16
4A VREFB4AN0 IO DIFFOUT_B110n AF16
4A VREFB4AN0 IO DIFFIO_RX_B56p DIFFOUT_B111p AV14 DQ33B DQ36B
4A VREFB4AN0 IO DIFFIO_RX_B56n DIFFOUT_B111n AW14 DQ33B DQ36B
4A VREFB4AN0 IO DIFFOUT_B112p AT14 DQ33B DQ36B
4A VREFB4AN0 IO DIFFOUT_B112n AU14 DQ33B DQ36B
4A VREFB4AN0 IO
4A
VREFB4AN0 IO DIFFIO_RX_B57n DIFFOUT_B113n AW13 DQSn33B DQSn36B/DQ36B
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
DIFFIO_RX_B57p DIFFOUT_B113p AV13 DQS33B DQS36B/CQ36B
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
4A VREFB4AN0 IO DIFFOUT_B114p AW12 DQ34B DQ36B
4A VREFB4AN0 IO DIFFOUT_B114n AW11 DQ34B DQ36B
4A VREFB4AN0 IO DIFFIO_RX_B58p DIFFOUT_B115p AU11 DQS34B DQ36B/CQn36B
4A VREFB4AN0 IO DIFFIO_RX_B58n DIFFOUT_B115n AV11 DQSn34B DQ36B
4A VREFB4AN0 IO DIFFOUT_B116p AT12 DQ34B DQ36B
4A VREFB4AN0 IO DIFFOUT_B116n AU12 DQ34B DQ36B
4A VREFB4AN0 IO DIFFIO_RX_B59p DIFFOUT_B117p AP14 DQ35B DQ37B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B59n DIFFOUT_B117n AR14 DQ35B DQ37B DQ38B
4A VREFB4AN0 IO DIFFOUT_B118p AP13 DQ35B DQ37B DQ38B
4A VREFB4AN0 IO DIFFOUT_B118n AN14 DQ35B DQ37B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B60p DIFFOUT_B119p AR13 DQS35B DQS37B/CQ37B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B60n DIFFOUT_B119n AT13 DQSn35B DQSn37B/DQ37B DQ38B
4A VREFB4AN0 IO DIFFOUT_B120p AN13 DQ36B DQ37B DQ38B
4A VREFB4AN0 IO DIFFOUT_B120n AL15 DQ36B DQ37B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B61p DIFFOUT_B121p AL13 DQS36B DQ37B/CQn37B DQS38B/CQ38B
4A VREFB4AN0 IO DIFFIO_RX_B61n DIFFOUT_B121n AM13 DQSn36B DQ37B DQSn38B/DQ38B
4A VREFB4AN0 IO DIFFOUT_B122p AL14 DQ36B DQ37B DQ38B
4A VREFB4AN0 IO DIFFOUT_B122n AM14 DQ36B DQ37B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B62p DIFFOUT_B123p AJ13 DQ37B DQ38B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B62n DIFFOUT_B123n AK13 DQ37B DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B124p AH13 DQ37B DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B124n AK14 DQ37B DQ38B DQ38B
4A VREFB4AN0 IO DIFFIO_RX_B63p DIFFOUT_B125p AH14 DQS37B DQS38B/CQ38B DQ38B/CQn38B
4A VREFB4AN0 IO DIFFIO_RX_B63n DIFFOUT_B125n AJ14 DQSn37B DQSn38B/DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B126p AG14 DQ38B DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B126n AG15 DQ38B DQ38B DQ38B
4A VREFB4AN0 IO RUP4A DIFFIO_RX_B64p DIFFOUT_B127p AE14 DQS38B DQ38B/CQn38B DQ38B
4A VREFB4AN0 IO RDN4A DIFFIO_RX_B64n DIFFOUT_B127n AF14 DQSn38B DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B128p AD15 DQ38B DQ38B DQ38B
4A VREFB4AN0 IO DIFFOUT_B128n AE15 DQ38B DQ38B DQ38B
nIO_PULLUP nIO_PULLUP AM11
nCEO nCEO AT11
DCLK DCLK AR11
nCSO nCSO AP11
ASDO ASDO AN11
5A VREFB5AN0 IO DIFFIO_TX_R1n DIFFOUT_R1n AM10
5A VREFB5AN0 IO DIFFIO_TX_R1p DIFFOUT_R1p AL10
5A VREFB5AN0 IO RDN5A DIFFIO_RX_R1n DIFFOUT_R2n AW7
5A VREFB5AN0 IO RUP5A DIFFIO_RX_R1p DIFFOUT_R2p AV7
5A VREFB5AN0 IO DIFFIO_TX_R2n DIFFOUT_R3n AP10 DQ1R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R2p DIFFOUT_R3p AN10 DQ1R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R2n DIFFOUT_R4n AW8 DQSn1R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R2p DIFFOUT_R4p AV8 DQS1R DQ1R/CQn1R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R3n DIFFOUT_R5n AJ11 DQ1R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R3p DIFFOUT_R5p AH11 DQ1R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R3n DIFFOUT_R6n AU10 DQSn2R DQSn1R/DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R3p DIFFOUT_R6p AT10 DQS2R DQS1R/CQ1R DQ1R/CQn1R
5A VREFB5AN0 IO DIFFIO_TX_R4n DIFFOUT_R7n AH12 DQ2R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R4p DIFFOUT_R7p AG12 DQ2R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R4n DIFFOUT_R8n AW10 DQ2R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R4p DIFFOUT_R8p AV10 DQ2R DQ1R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R5n DIFFOUT_R9n AG13 DQ3R DQ2R DQ1R
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
5A VREFB5AN0 IO DIFFIO_TX_R5p DIFFOUT_R9p AF13 DQ3R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R5n DIFFOUT_R10n AU9 DQSn3R DQ2R DQSn1R/DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R5p DIFFOUT_R10p AT9 DQS3R DQ2R/CQn2R DQS1R/CQ1R
5A VREFB5AN0 IO DIFFIO_TX_R6n DIFFOUT_R11n AP9 DQ3R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R6p DIFFOUT_R11p AN9 DQ3R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R6n DIFFOUT_R12n AU8 DQSn4R DQSn2R/DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R6p DIFFOUT_R12p AT8 DQS4R DQS2R/CQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R7n DIFFOUT_R13n AP7 DQ4R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R7p DIFFOUT_R13p AN7 DQ4R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R7n DIFFOUT_R14n AR8 DQ4R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_RX_R7p DIFFOUT_R14p AP8 DQ4R DQ2R DQ1R
5A VREFB5AN0 IO DIFFIO_TX_R8n DIFFOUT_R15n AL9 DQ5R DQ3R
5A VREFB5AN0 IO DIFFIO_TX_R8p DIFFOUT_R15p AK9 DQ5R DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R8n DIFFOUT_R16n AU7 DQSn5R DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R8p DIFFOUT_R16p AT7 DQS5R DQ3R/CQn3R
5A VREFB5AN0 IO DIFFIO_TX_R9n DIFFOUT_R17n AM8 DQ5R DQ3R
5A VREFB5AN0 IO DIFFIO_TX_R9p DIFFOUT_R17p AL8 DQ5R DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R9n DIFFOUT_R18n AU6 DQSn6R DQSn3R/DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R9p DIFFOUT_R18p AT6 DQS6R DQS3R/CQ3R
5A VREFB5AN0 IO DIFFIO_TX_R10n DIFFOUT_R19n AJ10 DQ6R DQ3R
5A VREFB5AN0 IO DIFFIO_TX_R10p DIFFOUT_R19p AH10 DQ6R DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R10n DIFFOUT_R20n AW4 DQ6R DQ3R
5A VREFB5AN0 IO DIFFIO_RX_R10p DIFFOUT_R20p AV5 DQ6R DQ3R
5A VREFB5AN0 IO DIFFIO_TX_R11n DIFFOUT_R21n AE12 DQ7R
5A VREFB5AN0 IO DIFFIO_TX_R11p DIFFOUT_R21p AE13 DQ7R
5A VREFB5AN0 IO DIFFIO_TX_R12n DIFFOUT_R23n AD12 DQ7R
5A VREFB5AN0 IO DIFFIO_TX_R12p DIFFOUT_R23p AD13 DQ7R
5A VREFB5AN0 IO DIFFIO_RX_R12n DIFFOUT_R24n AW5
5A VREFB5AN0 IO DIFFIO_RX_R12p DIFFOUT_R24p AW6
5C VREFB5CN0 IO DIFFIO_TX_R19n DIFFOUT_R37n AH8 DQ12R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R19p DIFFOUT_R37p AH9 DQ12R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_RX_R19p DIFFOUT_R38p AP6 DQS12R DQ12R/CQn12R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R20n DIFFOUT_R39n AK7 DQ12R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R20p DIFFOUT_R39p AK8 DQ12R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_RX_R20p DIFFOUT_R40p AM6 DQS13R DQS12R/CQ12R DQ12R/CQn12R
5C VREFB5CN0 IO DIFFIO_TX_R21n DIFFOUT_R41n AE10 DQ13R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R21p DIFFOUT_R41p AE11 DQ13R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_RX_R21p DIFFOUT_R42p AN6 DQ13R DQ12R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R22n DIFFOUT_R43n AF10 DQ14R DQ13R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R22p DIFFOUT_R43p AF11 DQ14R DQ13R DQ12R
5C VREFB5CN0 IO DIFFIO_RX_R22p DIFFOUT_R44p AL6 DQS14R DQ13R/CQn13R DQS12R/CQ12R
5C VREFB5CN0 IO DIFFIO_TX_R23p DIFFOUT_R45p AG10 DQ14R DQ13R DQ12R
5C VREFB5CN0 IO DIFFIO_RX_R23p DIFFOUT_R46p AK6 DQS15R DQS13R/CQ13R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R24p DIFFOUT_R47p AD10 DQ15R DQ13R DQ12R
5C VREFB5CN0 IO DIFFIO_TX_R26n DIFFOUT_R51n AB10 DQ16R DQ14R
5C VREFB5CN0 IO DIFFIO_TX_R26p DIFFOUT_R51p AB11 DQ16R DQ14R
5C VREFB5CN0 IO DIFFIO_TX_R27n DIFFOUT_R53n AB12 DQ17R DQ14R
5C VREFB5CN0 IO DIFFIO_TX_R27p DIFFOUT_R53p AB13 DQ17R DQ14R
5C VREFB5CN0 IO PLL_R3_CLKOUT0n DIFFIO_TX_R28n DIFFOUT_R55n AC10
5C VREFB5CN0 IO PLL_R3_FB_CLKOUT0p DIFFIO_TX_R28p DIFFOUT_R55p AC11
5C VREFB5CN0 CLK8n CLK8n AH6
5C VREFB5CN0 CLK8p CLK8p AJ6
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Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
6C VREFB6CN0 CLK10p CLK10p P6
6C VREFB6CN0 CLK10n CLK10n N6
6C VREFB6CN0 IO PLL_R2_FB_CLKOUT0p DIFFIO_TX_R29p DIFFOUT_R58p W12
6C VREFB6CN0 IO PLL_R2_CLKOUT0n DIFFIO_TX_R29n DIFFOUT_R58n W11
6C VREFB6CN0 IO DIFFIO_TX_R30p DIFFOUT_R60p V12 DQ18R DQ21R
6C VREFB6CN0 IO DIFFIO_TX_R30n DIFFOUT_R60n V11 DQ18R DQ21R
6C VREFB6CN0 IO DIFFIO_TX_R31p DIFFOUT_R62p U10 DQ19R DQ21R
6C VREFB6CN0 IO DIFFIO_TX_R32p DIFFOUT_R64p V10 DQ19R DQ21R
6C VREFB6CN0 IO DIFFIO_TX_R33p DIFFOUT_R66p N9 DQ20R DQ22R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R33n DIFFOUT_R66n P8 DQ20R DQ22R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R34p DIFFOUT_R68p T10 DQ21R DQ22R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R34n DIFFOUT_R68n R10 DQ21R DQ22R DQ23R
6C VREFB6CN0 IO DIFFIO_RX_R35p DIFFOUT_R69p M6 DQS21R DQ22R/CQn22R DQS23R/CQ23R
6C VREFB6CN0 IO DIFFIO_RX_R36p DIFFOUT_R71p N8 DQ22R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_RX_R36n DIFFOUT_R71n N7 DQ22R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R36p DIFFOUT_R72p M8 DQ22R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R36n DIFFOUT_R72n M7 DQ22R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_RX_R37p DIFFOUT_R73p K6 DQS22R DQS23R/CQ23R DQ23R/CQn23R
6C VREFB6CN0 IO DIFFIO_TX_R37p DIFFOUT_R74p L8 DQ23R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R37n DIFFOUT_R74n L7 DQ23R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_RX_R38p DIFFOUT_R75p J6 DQS23R DQ23R/CQn23R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R38p DIFFOUT_R76p K7 DQ23R DQ23R DQ23R
6C VREFB6CN0 IO DIFFIO_TX_R38n DIFFOUT_R76n J7 DQ23R DQ23R DQ23R
6A VREFB6AN0 IO DIFFIO_RX_R45p DIFFOUT_R89p G8
6A VREFB6AN0 IO DIFFIO_RX_R45n DIFFOUT_R89n F8
6A VREFB6AN0 IO DIFFIO_TX_R45p DIFFOUT_R90p T13 DQ28R
6A VREFB6AN0 IO DIFFIO_TX_R45n DIFFOUT_R90n T12 DQ28R
6A VREFB6AN0 IO DIFFIO_RX_R46p DIFFOUT_R91p F7 DQS28R
6A VREFB6AN0 IO DIFFIO_RX_R46n DIFFOUT_R91n E7 DQSn28R
6A VREFB6AN0 IO DIFFIO_TX_R46p DIFFOUT_R92p H7 DQ28R
6A VREFB6AN0 IO DIFFIO_TX_R46n DIFFOUT_R92n G7 DQ28R
6A VREFB6AN0 IO DIFFIO_TX_R47p DIFFOUT_R94p R13 DQ29R DQ32R
6A VREFB6AN0 IO DIFFIO_TX_R47n DIFFOUT_R94n P13 DQ29R DQ32R
6A VREFB6AN0 IO DIFFIO_RX_R48p DIFFOUT_R95p G6 DQS29R DQS32R/CQ32R
6A VREFB6AN0 IO DIFFIO_RX_R48n DIFFOUT_R95n F6 DQSn29R DQSn32R/DQ32R
6A VREFB6AN0 IO DIFFIO_TX_R48p DIFFOUT_R96p R12 DQ30R DQ32R
6A VREFB6AN0 IO DIFFIO_TX_R48n DIFFOUT_R96n R11 DQ30R DQ32R
6A VREFB6AN0 IO DIFFIO_RX_R49p DIFFOUT_R97p G9 DQS30R DQ32R/CQn32R
6A VREFB6AN0 IO DIFFIO_RX_R49n DIFFOUT_R97n F9 DQSn30R DQ32R
6A VREFB6AN0 IO DIFFIO_TX_R49p DIFFOUT_R98p N11 DQ30R DQ32R
6A VREFB6AN0 IO DIFFIO_TX_R49n DIFFOUT_R98n N10 DQ30R DQ32R
6A VREFB6AN0 IO DIFFIO_RX_R50p DIFFOUT_R99p F10 DQ31R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R50n DIFFOUT_R99n E10 DQ31R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R50p DIFFOUT_R100p M10 DQ31R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R50n DIFFOUT_R100n L10 DQ31R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R51p DIFFOUT_R101p D7 DQS31R DQS33R/CQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R51n DIFFOUT_R101n C7 DQSn31R DQSn33R/DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R51p DIFFOUT_R102p K9 DQ32R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R51n DIFFOUT_R102n J9 DQ32R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R52p DIFFOUT_R103p D8 DQS32R DQ33R/CQn33R DQS34R/CQ34R
6A VREFB6AN0 IO DIFFIO_RX_R52n DIFFOUT_R103n C8 DQSn32R DQ33R DQSn34R/DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R52p DIFFOUT_R104p K8 DQ32R DQ33R DQ34R
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
6A VREFB6AN0 IO DIFFIO_TX_R52n DIFFOUT_R104n J8 DQ32R DQ33R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R53p DIFFOUT_R105p D9 DQ33R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R53n DIFFOUT_R105n C9 DQ33R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R53p DIFFOUT_R106p M11 DQ33R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R53n DIFFOUT_R106n L11 DQ33R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R54p DIFFOUT_R108p N12 DQ34R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R54n DIFFOUT_R108n M12 DQ34R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R55p DIFFOUT_R109p D10 DQS34R DQ34R/CQn34R DQ34R
6A VREFB6AN0 IO DIFFIO_RX_R55n DIFFOUT_R109n C10 DQSn34R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R55p DIFFOUT_R110p K10 DQ34R DQ34R DQ34R
6A VREFB6AN0 IO DIFFIO_TX_R55n DIFFOUT_R110n J10 DQ34R DQ34R DQ34R
6A VREFB6AN0 IO RUP6A DIFFIO_RX_R56p DIFFOUT_R111p D6
6A VREFB6AN0 IO RDN6A DIFFIO_RX_R56n DIFFOUT_R111n C6
6A VREFB6AN0 IO DIFFIO_TX_R56p DIFFOUT_R112p H10
6A VREFB6AN0 IO DIFFIO_TX_R56n DIFFOUT_R112n G10
MSEL2 MSEL2 A8
MSEL1 MSEL1 H11
MSEL0 MSEL0 J11
7A VREFB7AN0 IO DIFFOUT_T1n M13 DQ1T DQ1T DQ1T
7A VREFB7AN0 IO DIFFOUT_T1p N13 DQ1T DQ1T DQ1T
7A VREFB7AN0 IO RDN7A DIFFIO_RX_T1n DIFFOUT_T2n N14 DQSn1T DQ1T DQ1T
7A VREFB7AN0 IO RUP7A DIFFIO_RX_T1p DIFFOUT_T2p P14 DQS1T DQ1T/CQn1T DQ1T
7A VREFB7AN0 IO DIFFOUT_T3n N15 DQ1T DQ1T DQ1T
7A VREFB7AN0 IO DIFFOUT_T3p R14 DQ1T DQ1T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T2n DIFFOUT_T4n K13 DQSn2T DQSn1T/DQ1T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T2p DIFFOUT_T4p L13 DQS2T DQS1T/CQ1T DQ1T/CQn1T
7A VREFB7AN0 IO DIFFOUT_T5n K12 DQ2T DQ1T DQ1T
7A VREFB7AN0 IO DIFFOUT_T5p M14 DQ2T DQ1T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T3n DIFFOUT_T6n K14 DQ2T DQ1T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T3p DIFFOUT_T6p L14 DQ2T DQ1T DQ1T
7A VREFB7AN0 IO DIFFOUT_T7n J13 DQ3T DQ2T DQ1T
7A VREFB7AN0 IO DIFFOUT_T7p J12 DQ3T DQ2T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T4n DIFFOUT_T8n G13 DQSn3T DQ2T DQSn1T/DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T4p DIFFOUT_T8p H13 DQS3T DQ2T/CQn2T DQS1T/CQ1T
7A VREFB7AN0 IO DIFFOUT_T9n G14 DQ3T DQ2T DQ1T
7A VREFB7AN0 IO DIFFOUT_T9p H14 DQ3T DQ2T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T5n DIFFOUT_T10n E13 DQSn4T DQSn2T/DQ2T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T5p DIFFOUT_T10p F13 DQS4T DQS2T/CQ2T DQ1T
7A VREFB7AN0 IO DIFFOUT_T11n D13 DQ4T DQ2T DQ1T
7A VREFB7AN0 IO DIFFOUT_T11p F12 DQ4T DQ2T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T6n DIFFOUT_T12n E14 DQ4T DQ2T DQ1T
7A VREFB7AN0 IO DIFFIO_RX_T6p DIFFOUT_T12p F14 DQ4T DQ2T DQ1T
7A VREFB7AN0 IO DIFFOUT_T13n C11 DQ5T DQ3T
7A VREFB7AN0 IO DIFFOUT_T13p A10 DQ5T DQ3T
7A VREFB7AN0 IO DIFFIO_RX_T7n DIFFOUT_T14n A11 DQSn5T DQ3T
7A VREFB7AN0 IO DIFFIO_RX_T7p DIFFOUT_T14p B11 DQS5T DQ3T/CQn3T
7A VREFB7AN0 IO DIFFOUT_T15n B10 DQ5T DQ3T
7A VREFB7AN0 IO DIFFOUT_T15p D11 DQ5T DQ3T
7A VREFB7AN0 IO DIFFIO_RX_T8n DIFFOUT_T16n C14 DQSn6T DQSn3T/DQ3T
7A VREFB7AN0 IO DIFFIO_RX_T8p DIFFOUT_T16p D14 DQS6T DQS3T/CQ3T
7A VREFB7AN0 IO DIFFOUT_T17n C13 DQ6T DQ3T
7A VREFB7AN0 IO DIFFOUT_T17p C12 DQ6T DQ3T
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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
Pin Information for the Stratix® IV GT EP4S40G5 Device
Version 1.1
Note (1)
Bank
Number VREF Pin Name/Function Optional Function(s)
7A VREFB7AN0 IO DIFFIO_RX_T9n DIFFOUT_T18n A13 DQ6T DQ3T
7A VREFB7AN0 IO DIFFIO_RX_T9p DIFFOUT_T18p B13 DQ6T DQ3T
7A VREFB7AN0 IO DIFFOUT_T19n J15
7A VREFB7AN0 IO DIFFOUT_T19p K15
7A VREFB7AN0 IO DIFFIO_RX_T10n DIFFOUT_T20n A14
7A VREFB7AN0 IO DIFFIO_RX_T10p DIFFOUT_T20p B14
7B VREFB7BN0 IO DIFFOUT_T25n G15 DQ9T DQ9T DQ9T
7B VREFB7BN0 IO DIFFOUT_T25p E16 DQ9T DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T13n DIFFOUT_T26n F16 DQSn9T DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T13p DIFFOUT_T26p G16 DQS9T DQ9T/CQn9T DQ9T
7B VREFB7BN0 IO DIFFOUT_T27n G17 DQ9T DQ9T DQ9T
7B VREFB7BN0 IO DIFFOUT_T27p F15 DQ9T DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T14n DIFFOUT_T28n C15 DQSn10T DQSn9T/DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T14p DIFFOUT_T28p D15 DQS10T DQS9T/CQ9T DQ9T/CQn9T
7B VREFB7BN0 IO DIFFOUT_T29n A16 DQ10T DQ9T DQ9T
7B VREFB7BN0 IO DIFFOUT_T29p D16 DQ10T DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T15n DIFFOUT_T30n B16 DQ10T DQ9T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T15p DIFFOUT_T30p C16 DQ10T DQ9T DQ9T
7B VREFB7BN0 IO DIFFOUT_T31n P16 DQ11T DQ10T DQ9T
7B VREFB7BN0 IO DIFFOUT_T31p P17 DQ11T DQ10T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T16n DIFFOUT_T32n M16 DQSn11T DQ10T DQSn9T/DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T16p DIFFOUT_T32p N16 DQS11T DQ10T/CQn10T DQS9T/CQ9T
7B VREFB7BN0 IO DIFFOUT_T33n N17 DQ11T DQ10T DQ9T
7B VREFB7BN0 IO DIFFOUT_T33p M17 DQ11T DQ10T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T17n DIFFOUT_T34n J16 DQSn12T DQSn10T/DQ10T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T17p DIFFOUT_T34p K16 DQS12T DQS10T/CQ10T DQ9T
7B VREFB7BN0 IO DIFFOUT_T35n K17 DQ12T DQ10T DQ9T
7B VREFB7BN0 IO DIFFOUT_T35p L16 DQ12T DQ10T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T18n DIFFOUT_T36n H17 DQ12T DQ10T DQ9T
7B VREFB7BN0 IO DIFFIO_RX_T18p DIFFOUT_T36p J17 DQ12T DQ10T DQ9T
7C VREFB7CN0 IO DIFFOUT_T49n C17 DQ17T DQ17T
7C VREFB7CN0 IO DIFFOUT_T49p F17 DQ17T DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T25n DIFFOUT_T50n D17 DQSn17T DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T25p DIFFOUT_T50p E17 DQS17T DQ17T/CQn17T
7C VREFB7CN0 IO DIFFOUT_T51n C18 DQ17T DQ17T
7C VREFB7CN0 IO DIFFOUT_T51p D18 DQ17T DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T26n DIFFOUT_T52n F18 DQSn18T DQSn17T/DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T26p DIFFOUT_T52p G18 DQS18T DQS17T/CQ17T
7C VREFB7CN0 IO DIFFOUT_T53n G20 DQ18T DQ17T
7C VREFB7CN0 IO DIFFOUT_T53p F20 DQ18T DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T27n DIFFOUT_T54n F19 DQ18T DQ17T
7C VREFB7CN0 IO DIFFIO_RX_T27p DIFFOUT_T54p G19 DQ18T DQ17T
7C VREFB7CN0 IO DIFFOUT_T55n R18 DQ19T
7C VREFB7CN0 IO DIFFOUT_T55p J18 DQ19T
7C VREFB7CN0 IO DIFFIO_RX_T28n DIFFOUT_T56n A17 DQSn19T
7C VREFB7CN0 IO DIFFIO_RX_T28p DIFFOUT_T56p B17 DQS19T
7C VREFB7CN0 IO DIFFOUT_T57n H19 DQ19T
7C VREFB7CN0 IO DIFFOUT_T57p P18 DQ19T
7C VREFB7CN0 IO DIFFIO_RX_T29n DIFFOUT_T58n A18
7C VREFB7CN0 IO DIFFIO_RX_T29p DIFFOUT_T58p B19
7C VREFB7CN0 IO PLL_T2_CLKOUT4 DIFFOUT_T59n M19
7C VREFB7CN0 IO PLL_T2_CLKOUT3 DIFFOUT_T59p L19
PT-EP4S40G5-1.1
Copyright © 2009 Altera Corp.
Configuration
Function
Dedicated Tx/Rx
Channel
Emulated LVDS
Output Channel H1517
DQS for X4 for
H1517
DQS for X8/X9 for
H1517
DQS for X16/ X18 for
H1517
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